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[发明专利]一种低功耗D触发器-CN201810728846.5有效
发明人：占凡;吴为敬;吴建东;刘玉荣 -专利权人：华南理工大学
申请日： 2018-07-05 - 公布日： 2023-06-20 - 主分类号： H03K3/012 文献下载
摘要：本发明公开了一种低功耗D触发器，该D触发器是由N型管构成的低功耗D触发器。D触发器由六个或非门组成，其中一个三输入或非门、五个二输入或非门。或非门采用的伪cmos结构，以提高输出电压的摆幅。通过反馈实现低功耗的功能，解决了由于全N型管设计所带来的高功耗问题。该D触发器由于只使用N型管，所以降低了工艺步骤的复杂度，有利于控制成本。
一种功耗触发器

[实用新型]一种低功耗D触发器-CN201821058189.X有效
发明人：占凡;吴为敬;吴建东;刘玉荣 -专利权人：华南理工大学
申请日： 2018-07-05 - 公布日： 2019-05-10 - 主分类号： H03K3/012 文献下载
摘要：本实用新型公开了一种低功耗D触发器，该D触发器是由N型管构成的低功耗D触发器。D触发器由六个或非门组成，其中一个三输入或非门、五个二输入或非门。或非门采用的伪cmos结构，以提高输出电压的摆幅。通过反馈实现低功耗的功能，解决了由于全N型管设计所带来的高功耗问题。该D触发器由于只使用N型管，所以降低了工艺步骤的复杂度，有利于控制成本。
低功耗D触发器或非门二输入或非门三输入或非门本实用新型工艺步骤输出电压低功耗复杂度高功耗摆幅反馈

[实用新型]一种基于数据变化的时钟门控低功耗电路-CN202320858242.9有效
发明人：牛英山;唐虹;王爽;王涣;陈晓棠 -专利权人：中国电子科技集团公司第四十七研究所
申请日： 2023-04-18 - 公布日： 2023-10-03 - 主分类号： G06F1/04 文献下载
摘要：本实用新型目的是提供一种基于数据变化的时钟门控低功耗电路，包括：一个与门、一个异或门以及一个D触发器单元，其中，所述异或门的第一输入端连接D触发器单元的输出端，第二输入端以及D触发器单元的数据信号输入端共同作为时钟门控低功耗电路的数据信号输入端；所述第一与门的第一输入端连接异或门的输出端，第二输入端作为时钟门控低功耗电路的时钟信号输入端，输出端连接D触发器单元的时钟信号输入端；D触发器单元的输出端所为时钟门控低功耗电路的输出端。该电路无需通过设置系统工作模式，切换工作电路完成降低功耗，而是通过对输入数据的检测进行时钟开关的切换完成降低功耗。
一种基于数据变化时钟门控功耗电路

[发明专利]低功耗流水线结构的相位累加器-CN201210109997.5有效
发明人：陈建武;吴旦昱;周磊;刘新宇;武锦;金智 -专利权人：中国科学院微电子研究所
申请日： 2012-04-13 - 公布日： 2012-08-15 - 主分类号： H03L7/099 文献下载
摘要：本发明公开了一种低功耗流水线结构相位累加器，摒弃传统结构中通过级联D触发器增加延时的方法，通过改变频率控制字单元中D触发器的时钟信号来调节延时，从而减少频率控制字单元中D触发器数量，降低功耗。对于M级流水线结构的N比特相位累加器，传统结构需要N×(M+1)/2个D触发器，本发明提供方法只需要N+M+1个D触发器。本发明的低功耗流水线结构相位累加器具有设计简单、功耗低、频率变化快的特点。
功耗流水线结构相位累加器

[发明专利]一种低功耗RS锁存器单元及低功耗主从型D触发器-CN200910157039.3无效
发明人：胡建平;邬建波;李林峰;张卫强 -专利权人：宁波大学
申请日： 2009-12-31 - 公布日： 2010-07-14 - 主分类号： H03K19/094 文献下载
摘要：本发明公开了一种低功耗RS锁存器单元及低功耗主从型D触发器，特点是低功耗RS锁存器单元包括输入驱动与同步电路、下拉电路、功控电路及相互交叉耦合的第一反相器和第二反相器，低功耗主从型D触发器由输入反相器、时钟反相器和两个内部结构相同的级联的第一低功耗RS锁存器单元和第二低功耗RS锁存器单元构成，优点在于低功耗RS锁存器单元使用了P型逻辑技术、功控技术和双阈值技术三种漏功耗降低技术，具有较好漏功耗抑制性能；低功耗主从型D触发器电路结构简单且完全对称，与传统的单阈值传输门D触发器电路相比，在90nm工艺下可以节省80％的漏功耗和40％的总功耗，非常适合在深亚微米CMOS工艺下作为数字电路单元应用于低功耗集成电路设计中
一种功耗 rs 锁存器单元主从触发器

[发明专利]一种低功耗短脉冲产生电路及低功耗脉冲型D触发器-CN201110426084.1有效
发明人：胡建平;余晓颖;邹凯裕 -专利权人：宁波大学
申请日： 2011-12-19 - 公布日： 2012-05-02 - 主分类号： H03K3/012 文献下载
摘要：本发明公开了一种低功耗短脉冲产生电路及低功耗脉冲型D触发器，特点是低功耗短脉冲产生电路包括第一PMOS管、第一NMOS管、第一与非门和第一反相器，低功耗脉冲型D触发器包括低功耗短脉冲产生电路、输入反相电路、钟控CMOS逻辑D锁存器单元和输出反相电路；优点是在不影响电路性能的情况下，电路的晶体管数量少，结构更简单，有效地降低了电路功耗。
一种功耗脉冲产生电路触发器

[发明专利]高速低功耗真单相时钟2D型2/3双模分频器-CN201210199324.3有效
发明人：尹喜珍;石坚;甘业兵;钱敏;马成炎 -专利权人：江苏物联网研究发展中心
申请日： 2012-06-15 - 公布日： 2012-10-17 - 主分类号： H03K23/44 文献下载
摘要：本发明公开一种高速低功耗真单相时钟2D型2/3双模分频器，包括两个D触发器，D触发器采用同步触发，CK端接输入时钟，D端接逻辑控制单元的输出；模式切换控制单元输入接分频比控制端MODin和P；自适应功耗控制单元输入接触发器单元输出和模式切换控制单元的输出本发明的控制电路内嵌集成于D触发器且D触发器采用有比逻辑降低电容负载来提高工作速度，同步工作模式降低分频器引入的时钟抖动，在同等高速下真单相时钟较电流模逻辑结构的电流由毫安级降为微安级，且将传统的由4个D触发器结构优化为2个D触发器，管子节省一半，相应的面积和功耗都减小了，自适应功耗控制模式根据分频比配置使双模预分频器功耗进一步节省50%。
高速功耗单相时钟双模分频器

[发明专利]双边沿触发MUX-D扫描触发器-CN202011010699.1在审
发明人：埃米特·阿加瓦尔;史蒂文·许;阿纳帕玛·安巴德·塔普洛;西蒙·雷洛夫;拉姆·克里希纳穆尔蒂 -专利权人：英特尔公司
申请日： 2020-09-23 - 公布日： 2021-07-09 - 主分类号： G05B19/042 文献下载
摘要：本公开涉及双边沿触发MUX‑D扫描触发器。提供了一系列新颖的、低功耗、最小驱动强度、双边沿触发(DET)输入数据多路复用器(Mux‑D)扫描触发器(FF)。触发器利用从设备中没有状态节点的优势来移除传统DET FF中的数据反相器以节省功率，而不影响耦合/故障情况下的触发器功能。
双边触发 mux 扫描触发器

[发明专利]基于电压控制延迟单元的高速超低功耗比较器-CN200810114514.4无效
发明人：克兵格·赛客帝·玻梅;杨华中 -专利权人：清华大学
申请日： 2008-06-06 - 公布日： 2008-12-10 - 主分类号： H03M1/50 文献下载
摘要：基于电压控制延迟单元的高速超低功耗比较器属于超低功耗模拟数字转换器领域，其特征在于，在相同的时钟信号控制下，采用分别由若干级CSI电路串联构成的输入信号的电压－时间转换电路和参考信号的电压－时间转换电路来控制一个D触发器的翻转；当参考信号大于输入信号时，参考信号的电压－时间转换电路的输出先于输入信号的电压－时间转换电路的输出变成高电平，使D触发器翻转，在降低功耗的同时，也提高了比较器的工作速率。
基于电压控制延迟单元高速功耗比较

[发明专利]一种基于E-TSPC结构的低功耗2/3分频器电路-CN201510785565.X在审
发明人：吴建辉;陈怀昊;陈超;李红;黄成;张萌 -专利权人：东南大学
申请日： 2015-11-16 - 公布日： 2016-01-20 - 主分类号： H03K23/00 文献下载
摘要：本发明公开了一种基于E-TSPC结构的低功耗2/3分频器电路，包括两级E-TSPC结构D触发器和内嵌门电路。该电路适用于低电源电压下，锁相环电路中的双模预分频电路。同传统TSPC结构的分频器相比，该电路具有更高的工作频率。通过模式控制信号，在2分频模式下实现对前级D触发器的完全关断，后级D触发器单独完成2分频功能。相比传统E-TSPC结构的2/3分频电路，该电路具有更小的功耗。本发明适应低电压低功耗的设计要求，实现了可以工作在吉赫兹频率下的极低功耗2/3分频电路。
一种基于 tspc 结构功耗分频器电路

[发明专利]高速低功耗多阈值双边沿触发D型触发器-CN201510061574.4有效
发明人：胡封林;窦强;刘仲;陈跃跃;胡少飞;罗恒;许邦建;刘胜;刘宗林;吴家铸 -专利权人：中国人民解放军国防科学技术大学
申请日： 2015-02-06 - 公布日： 2015-05-06 - 主分类号： H03K3/012 文献下载
摘要：本发明公开了一种高速低功耗多阈值双边沿触发D型触发器，包括：低功耗控制电路，用来接收低功耗控制输入信号slp，对低功耗控制输入信号slp进行缓冲处理后分别输出信号：sleep和nsleep；正沿触发锁存器，用来接收数据信号d，正相时钟输入信号clk、反相时钟输入信号nclk以及信号sleep和nsleep；正沿触发锁存器对数据信号d进行锁存处理后输出信号qtp；负沿触发锁存器，用来接收数据信号d，正相时钟输入信号clk、反相时钟输入信号nclk以及信号sleep和nsleep；负沿触发锁存器对数据信号d进行锁存处理后输出信号：qtn；低功耗输出控制电路，用来选择输出正沿触发锁存器或负沿触发锁存器的值。本发明具有结构简单、可提高传输效率、降低静态漏电流和功耗等优点。
高速功耗阈值双边触发触发器

[发明专利]低功耗两级放大器STT‑RAM读取电路的控制方法-CN201510190009.8有效
发明人：魏榕山;王珏;郭仕忠;于静;胡惠文;张泽鹏;何明华 -专利权人：福州大学
申请日： 2015-04-21 - 公布日： 2017-05-10 - 主分类号： G11C7/06 文献下载
摘要：本发明涉及一种低功耗两级放大器STT‑RAM读取电路的控制方法。提供一低功耗STT‑RAM读取电路，包括控制电路、并行磁隧道结、开环放大器、控制逻辑电路、第一反相器、第一D触发器、第二D触发器、时钟输出模块；通过控制电路控制低功耗STT‑RAM读取电路进入工作及待机状态本发明采用树型的读取方案，不但具有较快的读取速度，且通过引入了控制电路，只在进入工作状态时产生功耗，从而又节省了读取电路的功耗。
功耗两级放大器 stt ram 读取电路控制方法

[发明专利]一种高速低功耗的2/3双模预分频器-CN201510518075.3有效
发明人：吴建辉;程康;张文通;陈超;黄成;李红 -专利权人：东南大学
申请日： 2015-08-21 - 公布日： 2018-06-01 - 主分类号： H03L7/18 文献下载
摘要：本发明公开了一种高速低功耗的2/3双模预分频器，包括两个D触发器，分别记为触发器DFF1和触发器DFF2，触发器DFF1的工作状态受分频模式控制信号MC控制，触发器DFF2的第一级采用动态浮动输入的E‑TSPC电路来提高电路速度，第二级和第三级采用TSPC结构的动态D锁存器来进一步降低功耗；当MC＝1时，触发器DFF1不工作，触发器DFF2正常工作，2/3双模预分频器工作在二分频模式；当MC＝0时，触发器DFF1正常工作，触发器DFF2正常工作，2/3双模预分频器工作在三分频模式。
触发器双模预分频器低功耗电路电路结构分频模式工作频率降低功耗控制信号输出分频信号抖动第三级第一级二分频三分频分频浮动

[发明专利]高速低功耗真单相时钟双模预分频器-CN201210199062.0有效
发明人：尹喜珍;石坚;甘业兵;钱敏;马成炎 -专利权人：江苏物联网研究发展中心
申请日： 2012-06-15 - 公布日： 2012-10-03 - 主分类号： H03L7/18 文献下载
摘要：本发明公开一种高速低功耗真单相时钟双模预分频器，包括由多个静态CMOSD触发器组成的触发器单元、模式切换控制单元和自适应功耗控制单元，静态CMOSD触发器采用同步触发，静态CMOSD触发器的CK端接输入时钟，静态CMOSD触发器的D端接模式切换控制单元的输出；模式切换控制单元的输入接分频及模式控制端和触发器单元的输出；自适应功耗控制单元的输入接模块电源关断控制字和模式切换控制单元的输出。本发明的D触发器采用有比逻辑降低电容负载来提高工作速度，在同等高速下真单相时钟较电流模逻辑结构的电流由毫安级降为微安级，自适应功耗控制模式根据总分频比配置使双模预分频器功耗进一步节省15～50%。
高速功耗单相时钟双模分频器

[实用新型]一种低功耗时序电路-CN201820207351.3有效
发明人：王润泽;董坤;陈宇;桂林;王涛;陶媛勤 -专利权人：王润泽
申请日： 2018-02-06 - 公布日： 2018-08-14 - 主分类号： H03K19/00 文献下载
摘要：本实用新型公开了一种低功耗时序电路，由对应位数数量的异或门自控触发器连接构成，所述异或门自控触发器包括异或门、与门和D触发器，所述异或门的输入端A接D触发器的D脚，异或门的输入端B接D触发器的输出Q脚，异或门的输出端Y接与门的输入端A，与门的输入端B接时钟CLK端子，与门输出端Y接D触发器的CP端并引出CLKXOR输出端子，D触发器的复位端连接CLR输入端子，D触发器的输出端Q连接Q输出端子，D触发器的输出端本实用新型完全抑制了保持“0”与保持“1”状态的冗余时钟信号，同时有效的释放了“α”跃变与“β”跃变的时钟信号，能全面消除电路系统中的冗余时钟信号，保证了电路系统功能的正确性，降低系统功耗，提高系统安全性与稳定性
异或门输入端输出端与门冗余时钟信号本实用新型自控触发器时序电路输出端子低功耗跃变系统安全性与门输出端电路系统降低系统时钟信号输入端子消除电路非连接复位端功耗释放输出保证

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