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[发明专利]一种乘除法器及运算方法-CN201410490083.7在审
发明人：严伟;杨维;张文荣;陆健;王成;王鹏;沈骅 -专利权人：上海晟矽微电子股份有限公司;北京大学软件与微电子学院无锡产学研合作教育基地
申请日： 2014-09-23 - 公布日： 2015-02-25 - 主分类号： G06F7/52 文献下载
摘要：本发明公开一种乘除法器，用于实现任意位数无符号或有符号数除法运算和任意位数的无符号乘法运算，该乘除法器包括：一数据预处理器，该数据预处理器与一第一、第二操作数、一乘除法运算选择信号以及一除法模式选择信号连接，根据该一乘除法运算选择信号以及一除法模式选择信号对该第一、第二操作数进行处理；一迭代运算单元，用于根据该乘除法运算选择信号，进行余数补零及除数移位，或者进行乘数移位及被乘数扩展；一除法运算单元，用于生成一两位商和一余数
一种乘除法器运算方法

[发明专利]基于资源复用的微处理器运算系统的硬件除法单元-CN201110289005.7无效
发明人：孟建熠;梁静;吕冬明;刘兵 -专利权人：杭州中天微系统有限公司
申请日： 2011-09-26 - 公布日： 2012-02-22 - 主分类号： G06F7/535 文献下载
摘要：一种基于资源复用的低成本硬件除法单元，包括状态控制逻辑模块，用于接收外部输入、操作数和运算中间结果，并根据外部输入、操作数、运算中间结果和除法单元当前所处状态决定除法单元的下一状态，产生相应的对除法单元其他逻辑的控制信号；操作数准备逻辑模块，用于接收被除数、除数和除法运算各个状态的运算中间结果，为下一状态的运算准备操作数；资源复用接口，用于根据除法单元所处状态复用处理器运算系统中已有的硬件单元，实现该状态所需的操作；加法器，用于根据除法单元所处状态完成取绝对值运算和减法运算；寄存器，用于为除法各个状态保存运算中间结果和操作数。本发明在实现硬件除法的基础上，利用资源复用，降低成本。
基于资源微处理器运算系统硬件除法单元

[实用新型]一种乘除法器-CN201420548842.6有效
发明人：严伟;杨维;张文荣;陆健;王成;王鹏;沈骅 -专利权人：上海晟矽微电子股份有限公司;北京大学软件与微电子学院无锡产学研合作教育基地
申请日： 2014-09-23 - 公布日： 2015-02-04 - 主分类号： G06F7/52 文献下载
摘要：本实用新型公开一种乘除法器，用于实现任意位数无符号或有符号数除法运算和任意位数的无符号乘法运算，该乘除法器包括：一数据预处理器，该数据预处理器与一第一、第二操作数、一乘除法运算选择信号以及一除法模式选择信号连接，根据该一乘除法运算选择信号以及一除法模式选择信号对该第一、第二操作数进行处理；一迭代运算单元用于根据该乘除法运算选择信号，进行余数补零及除数移位，或者进行乘数移位及被乘数扩展；一除法运算单元，用于生成一两位商和一余数
一种乘除法器

[发明专利]矩阵运算装置-CN200680018156.6无效
发明人：多田俊树 -专利权人：松下电器产业株式会社
申请日： 2006-05-01 - 公布日： 2008-05-14 - 主分类号： G06F17/14 文献下载
摘要：本发明提供一种矩阵运算装置，具备：用对加权系数组(202a)进行2的k201次方倍后经过整数化的k201次方倍加权系数组(202b)，对输入进行加权的k201次方加权乘法电路(202)；对k201次方加权乘法电路(202)的乘法运算结果，用k202位移进行位移乘法运算处理的k202位移乘法电路(206)；对k202位移乘法电路(206)的乘法运算结果，进行修正处理值的加法运算处理的修正处理电路(207)；对修正处理电路(207)的运算结果进行四舍五入处理的四舍五入处理电路(204)；对四舍五入处理电路(204)的运算结果，用n位移(设n＝k201+k202)进行位移除法运算处理的n位移除法电路(205)，在能够减少运算量并削减电路规模的同时
矩阵运算装置

[发明专利]一种除法器、数据处理方法及芯片-CN202310871665.9在审
发明人：马仕清;王耀强 -专利权人：新华三半导体技术有限公司
申请日： 2023-07-14 - 公布日： 2023-10-13 - 主分类号： G06F7/535 文献下载
摘要：本申请实施例提供了一种除法器、数据处理方法及芯片，涉及数字电路技术领域，该除法器包括：选择模块、位宽分割模块和运算模块，选择模块与位宽分割模块连接，位宽分割模块与运算模块连接，其中，选择模块用于获取除数对应的目标倒数应用本申请实施例提供的技术方案，能够降低除法运算的时延。
一种法器数据处理方法芯片

[发明专利]无线电系统的电路、应用以及运行方法-CN200910204233.2有效
发明人： D·亨切尔;L·达特 -专利权人：爱特梅尔汽车股份有限公司
申请日： 2009-10-14 - 公布日： 2010-06-09 - 主分类号： H04L29/00 文献下载
摘要：无线电系统中的电路以其运行方法，其中系统时间被划分成符号，其中，在运行模式中，激活系统时钟发生器，使得由所述系统时钟发生器的输出时钟信号通过计数来确定系统时间，其中，在休眠模式中，禁用系统时钟发生器，其中，在休眠模式中，根据模数除法器的输出信号来消隐休眠时钟发生器的输出时钟信号并且通过计数来确定系统时间，其中，休眠时钟发生器的输出时钟信号的输出频率是符号频率的非整数倍，其中，模数除法器将休眠时钟发生器的输出时钟信号除以除数因子，其中，通过在至少两个整数除数值之间的改变来形成模数除法器的除数因子。
无线电系统电路应用以及运行方法

[发明专利]弧焊电源的电弧功率控制方法及装置-CN200510129344.3在审
发明人：陈大可 -专利权人：陈大可
申请日： 2005-11-30 - 公布日： 2007-06-13 - 主分类号： B23K9/095 文献下载
摘要：它采用一个具有线性或非线性取样变换功能的电路(A1)、将弧焊电压(V0)变换为弧电压信号(V1)，用一个除法电路将电压信号(V1)与电弧功率设定信号(P1)进行除法运算(P1/V1)，输出商数(I1)，为防止过电流，采用两种箝位电路(A31与A32)分别对除数与商数进行箝位。
电源电弧功率控制方法装置

[实用新型]校正信道质量标示的装置-CN200520047224.4无效
发明人：陈琦帆;谢一宁 -专利权人：凯明信息科技股份有限公司
申请日： 2005-12-05 - 公布日： 2007-01-10 - 主分类号： H04L1/00 文献下载
摘要：一种校正信道质量标示的装置，包括：两个信道估计和路径选择器，每个信道估计和路径选择器输出一组路径响应数据；求模电路，接收路径响应数据；平方器，与求模电路相连，接收来自求模电路的数据；两个求和电路，每个求和电路连接一组平方器，接收来自平方器的数据；除法装置，其输入端与所述两个求和电路输出端相连；信道质量标示数据库，接收来自除法装置的数据，并输出信道质量标示。
校正信道质量标示装置

[发明专利]一种配电作业现场安全预警电路-CN201911055998.4有效
发明人：于跃;汪帆;谭恒兵;常大泳;李雄;崔鹏;孙优;赵晓静;梁慧超;赵亮;李强 -专利权人：国网江苏省电力有限公司东海县供电分公司
申请日： 2019-10-31 - 公布日： 2021-10-15 - 主分类号： G08B21/02 文献下载
摘要：本发明的一种配电作业现场安全预警电路，所述场强过限预警电路通过电场传感器检测的电场强度经高压触发电路判别是否达到过限阈值80％，达到时，经可控放大电路放大，放大倍数由积分电路计算出的电场强度变化的幅度控制，之后进入人体感应电流计算电路，通过除法运算电路对电场强度和人体阻抗进行除法运算，计算出作用人体的感应电流，所述安全报警触发电路将接的收感应电流用作可控触发电路的电源，电场强度变化的幅度控制单结晶体管T1
一种配电作业现场安全预警电路

[发明专利]一种激活函数的硬件实现装置和方法-CN202010893482.3在审
发明人：李丽;蒋林;傅玉祥;陈辉;何书专;李剑斌;陈健 -专利权人：南京宁麒智能计算芯片研究院有限公司
申请日： 2020-08-31 - 公布日： 2020-10-30 - 主分类号： G06N3/04 文献下载
摘要：针对现有技术中存在的传统方法硬件实现激活函数时很难平衡高性能与硬件资源的问题，包括e指数计算模块和CORDIC除法模块，输入信号在e指数计算模块通过以2为底的小型指数查找表及移位、加法运算计算出e指数e本发明的加法器基于进位保留加法，实现形如“I1+I2‑I3”的计算功能；CORDIC除法模块基于DDA0002657695930000011.JPG" imgContent="drawing" imgFormat="JPEG" orientation="portrait" inline="no" />的除法函数结果本发明电路结构简洁、无复杂控制逻辑，电路布局布线方便，计算精度高，计算时支持任意输入范围的sigmoid和tanh激活函数计算，解决传统硬件实现方法无法平衡性能与硬件资源的问题。
一种激活函数硬件实现装置方法

[发明专利]用于执行乘法的混合固定逻辑-CN202210739649.X在审
发明人： T·罗斯;S·埃利奥特 -专利权人：想象技术有限公司
申请日： 2022-06-28 - 公布日： 2022-12-30 - 主分类号： G06F7/52 文献下载
摘要：所述固定逻辑电路，其被配置为执行乘法运算a*x，其中a是整数常量，x是在0至2m‑1范围内的整数变量，并且m是正整数，该固定逻辑电路包括：除法逻辑，其被配置为确定以下除法运算的结果的预定数量的一个或多个最高有效位imgFormat="JPEG" orientation="portrait" inline="yes" />乘法逻辑，其被配置为确定乘法运算a*x的结果的预定数量的一个或多个最低有效位；以及输出逻辑，其被配置为将除法运算的结果的预定数量的一个或多个最高有效位与乘法运算的结果的预定数量的一个或多个最低有效位组合
用于执行乘法混合固定逻辑

[发明专利]一种基于基尼相关的信号检测电路及方法-CN201410455266.5有效
发明人：徐维超;马如豹;林宝洪;章云 -专利权人：广东工业大学
申请日： 2014-09-09 - 公布日： 2017-05-10 - 主分类号： H04B17/20 文献下载
摘要：本发明涉及一种基于基尼相关的信号检测电路及方法，该电路包括两个比较器阵列、一个减法器阵列、两个乘法器阵列，两个加法器树，一个除法器以及一个寄存器；比较器、减法器阵列分别为一个n × n的矩阵（n为信号长度），矩阵上的每一个元素分别作比较运算和减法运算；乘法器阵列为n2个2输入的乘法器；加法器树为一个n2个输入的加法器；除法器完成2输入除法运算；寄存器寄存相关运算的结果。
一种基于相关信号检测电路方法

[发明专利]基于可逆逻辑的除法器-CN201010018377.1有效
发明人：倪丽惠;管致锦;景为平;孙玲;陶涛;施振佺 -专利权人：南通大学
申请日： 2010-01-15 - 公布日： 2010-06-16 - 主分类号： G06F7/535 文献下载
摘要：本发明涉及一种基于可逆逻辑的除法器，包括：包括两个可逆左移寄存器，其中一个是(n+2)输入/输出可逆左移寄存器Reg_1，另一个是n输入/输出可逆左移寄存器Reg_2；两个可逆复用器，其中一个是(n+1本发明所述的除法器适用于对除数与被除数都为正整数的例子。由于本发明对除法器电路中的主要器件进行了基于可逆逻辑门的电路设计，避免了系统中因逻辑信息位的丢失产生的能量损失，减少了系统能耗。
基于可逆逻辑法器

[实用新型]具有过载保护功能的PDU-CN202122491606.8有效
发明人：张哲恺;张子向 -专利权人：河南锐之信电子技术有限公司
申请日： 2021-10-16 - 公布日： 2022-02-18 - 主分类号： H01R13/66 文献下载
摘要：本实用新型具有过载保护功能的PDU，过载预判电路将检测的PDU电流经转换为电压后，一路进入减法器，另一路经采样保持，采样保持后信号一路进入减法器，另一路进入除法器，减法器减法运算输出差值信号，进入除法器，除法器计算出电流增量的变化率后输出，将检测的PDU电压经LC滤波加到乘法器U2，运算放大器转换为电压后信号进入乘法器U2，乘法器U2计算出PDU功率后输出，过载触发电路采用电流增量的变化率信号、采样保持后信号触发晶闸管
具有过载保护功能 pdu

[发明专利]用纯组合电路实现除法计算的电路-CN201110424923.6无效
发明人：王吉健 -专利权人：上海华虹集成电路有限责任公司
申请日： 2011-12-16 - 公布日： 2013-06-19 - 主分类号： G06F7/535 文献下载
摘要：本发明公开了一种用纯组合电路实现除法计算的电路，把a/b，先分解为a×1/b。本发明在实现除法算法时，能够降低所要求的时钟频率。
组合电路实现除法计算