专利名称
主分类
A 农业
B 作业;运输
C 化学;冶金
D 纺织;造纸
E 固定建筑物
F 机械工程、照明、加热
G 物理
H 电学
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公布日期
2023-10-24 公布专利
2023-10-20 公布专利
2023-10-17 公布专利
2023-10-13 公布专利
2023-10-10 公布专利
2023-10-03 公布专利
2023-09-29 公布专利
2023-09-26 公布专利
2023-09-22 公布专利
2023-09-19 公布专利
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专利权人
国家电网公司
华为技术有限公司
浙江大学
中兴通讯股份有限公司
三星电子株式会社
中国石油化工股份有限公司
清华大学
鸿海精密工业股份有限公司
松下电器产业株式会社
上海交通大学
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  • [实用新型]汽车自动防雾装置-CN200320118128.5无效
  • 彭小毛 - 彭小毛
  • 2003-11-13 - 2005-05-04 - B60J1/20
  • 传感器与微处理器的输入端相连;微处理器的输出端通过继电器或输出电路连接汽车空调的除雾控制开关。温度传感器3通过线性化电路13与比较器电路或者减法电路14的输入端相连;湿度传感器1通过检测电路12与比较器电路或者减法电路14的输入端相连;温度传感器2、3分别通过线性化电路后连接除法电路的输入端,除法电路的输出端与乘法电路的输入端相连,湿度传感器1经检测电路与乘法电路的输入端相连。乘法电路的输出端通过继电器或输出电路连接除雾控制开关。它有利于行车安全。
  • 汽车自动装置
  • [发明专利]正交频分复用解调装置-CN200780001709.1无效
  • 西川知希 - 松下电器产业株式会社
  • 2007-05-21 - 2009-02-04 - H04J11/00
  • 本发明提供一种正交频分复用解调装置,其设有对正交频分复用信号进行快速傅里叶变换的FFT电路(100)、从快速傅里叶变换后的信号抽取SP(分散导频)信号的电路(101)、对所抽出的SP信号附加正负符号的电路(400)、暂时存储附加了正负符号的SP信号和信息传输信号的存储器(300)、对附加了符号的SP信号执行复数方式的时间轴插补和频率轴插补的载波插补电路(103)、用所插补的数据对信息传输信号进行复数除法运算的复数除法运算电路
  • 正交频分复用解调装置
  • [发明专利]一种除法运算方法及装置-CN201010584087.3有效
  • 赵兴朋 - 青岛海信信芯科技有限公司
  • 2010-12-13 - 2011-05-18 - G06F7/52
  • 本发明涉及一种利用数制表示且应用在半导体器件的非线性组合数字除法计算方法以及实现这种运算方法的除法装置,更具体地,本发明涉及一种除法运算方法及采用该方法的运算装置。本发明的除法运算方法采用“移位减”的方法,并通过将移位以及减法同时在一个周期内执行达到减少整个除法运算方法的运算周期,优化整个除法运算算法的目的,同时本发明还提供了一种采用上述除法运算方法的除法装置。通过采用上述的技术方案,本发明提供了一种运算速度快,运算效率高,并且计算周期得到优化的除法运算方法,以及一种采用上述除法运算方法的除法运算装置。
  • 一种除法运算方法装置
  • [发明专利]可编程增益电路-CN200880113762.5在审
  • 简·保罗·范德瓦格特 - 高通股份有限公司
  • 2008-10-30 - 2010-09-22 - H03G1/00
  • 本发明描述一种适合于可编程增益放大器的可编程增益电路。在一个设计中,所述可编程增益电路包含串联耦合的多个衰减电路。每一衰减电路在第一模式或第二模式中操作,在所述第一模式中衰减输入信号,且在所述第二模式中传递所述输入信号。所述多个衰减电路可提供相同或不同的衰减量。所述多个衰减电路可包含二进制解码的衰减电路及/或温度计解码的衰减电路。在一个设计中,每一衰减电路包含除法电路及至少一个开关。所述开关选择所述第一模式或所述第二模式。所述除法电路在所述第一模式中衰减输入信号且在所述第二模式中传递所述输入信号。所述可编程增益电路针对所有增益设定可具有预定输入阻抗及预定输出阻抗。
  • 可编程增益电路
  • [发明专利]均值池化累加电路、装置以及方法-CN202010006439.0在审
  • 郑旭标 - 珠海亿智电子科技有限公司
  • 2020-01-03 - 2020-05-22 - G06N3/063
  • 本发明公开一种均值池化累加电路、装置以及方法,均值池化累加电路包括双端口缓存、写控制电路、读控制电路、MUX、加法电路、减法电路、输出控制电路以及累加缓存器,该均值池化累加电路用于均值池化装置当中;一种均值池化方法包括以下步骤将输入特征数据进行BLK分块;内部缓存中定义两个缓存阵列,按照乒乓操作的存储策略将第一维度输出累加结果存储于其中一个缓存阵列中;读取所述缓存阵列中第一维度的累加结果,进行第二维度的累加操作;第二维度累加结果输出到均值除法电路,按SRAM查表的方式进行除法运算。本发明的有益效果是:二维方向的累加能够按照同样的一维的累加电路进行第二个维度的运算,使得累加电路具备通用性。
  • 均值累加电路装置以及方法
  • [发明专利]视频信号噪声减少设备和方法-CN00118861.5无效
  • 笠原美沙 - 松下电器产业株式会社
  • 2000-06-16 - 2003-11-19 - H04N5/21
  • 用于从视频信号输出中心和周围象素数据、计算它们的差、依据差值和阈值检测与中心象素数据高度相关的一部分周围象素数据、对其进行计数、选择性地输出其一部分差值、依据计数结果获得差值之和、依据计数结果产生2n的除法系数、把和除以除法系数、把除法结果加到中心象素数据产生输出视频信号。加权电路依据预定优先级加权上述每个差值,从中获得和。还揭示了相应方法和存储该方法的相应记录媒体。
  • 视频信号噪声减少设备方法
  • [发明专利]分数除法器系统及方法-CN200510080995.8有效
  • M·刘易斯 - 因芬尼昂技术股份公司
  • 2005-06-30 - 2006-01-18 - G04F8/02
  • 本发明系有关一种减少唤醒时低功率定时器计时误差之分数除法器系统(100),该分数除法器系统(100)系包含可操作产生具频率Fc之输出信号对参考时钟频率FLP有下列关系之一分数除法器装置(102):(见公式)其中PDIV系为该分数除法器装置(102)之周期,M为除法比率之整数部分,而N为除法比率之分数部分大小。该分数除法器系统(100)亦包含被连接至该分数除法器装置(102)可从低功率模式开始唤醒之一高速晶体振荡器装置(104)。该分数除法器系统亦包括被连接至该高速晶体振荡器装置(104)之一高速时钟除法器装置(106)。
  • 分数法器系统方法
  • [发明专利]使用采样时间至数字转换器的倍频延迟锁定环路-CN201710477077.1有效
  • 王海松;O·布尔格 - 马维尔亚洲私人有限公司
  • 2017-06-21 - 2022-04-19 - H03L7/081
  • 倍频延迟锁定环路电路包括延迟链和反馈环路,延迟链包括串联连接的多个可变延迟电路并且具有延迟链输出,反馈环路包括用于获得数字控制信号的电路系统,该数字控制信号表示延迟链输出中的相位偏移的幅度和符号,以用于控制可变延迟电路中的可变延迟电路中的延迟用于获得数字控制信号的电路系统包括被配置为对输入之间的时间延迟进行操作以生成数字控制信号的采样时间至数字转换器(STDC)。STDC用从延迟链输出和反馈除法器的输出获得的信号之间的第一差,减去从延迟链输出和反馈除法器的输出获得的信号之间的第二差,以提供差值,并且该差值指示延迟链输出中的输出偏移的符号和幅度。
  • 使用采样时间数字转换器倍频延迟锁定环路
  • [发明专利]带功率因数校正的LED驱动电路及驱动器-CN201610574899.7在审
  • 陈银铭 - 湖州绿明微电子有限公司
  • 2016-07-19 - 2016-10-26 - H05B33/08
  • 本发明提供一种带功率因数校正的LED驱动电路及驱动器。本发明的带功率因数校正的LED驱动电路包括第一子电路、第二子电路和第三子电路;第一子电路给LED阵列供电,包括二极管、电感、开关管和电流感应电阻;第二子电路控制开关管开关,包括比较器、逻辑控制单元和驱动器;第三子电路包括除法器和峰值检测器,峰值检测器检测输入电源峰值电压,除法器去除输入电源中的峰值电压产生参考电压,比较器由参考电压确定电流感应电阻的电流,使电流不随输入电源峰值电压变化。本发明LED驱动电路解决了现有技术不能在全电压范围内恒流驱动问题,实现在不同输入电压下流经LED平均电流恒定,即输入电源电压峰值变化时流经LED平均电流恒定。
  • 功率因数校正led驱动电路驱动器

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