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[发明专利]锁存电路和包括其的半导体存储器件-CN202110035307.5在审
发明人：李桢埈 -专利权人：爱思开海力士有限公司
申请日： 2021-01-12 - 公布日： 2021-12-03 - 主分类号： G11C29/00 文献下载
摘要：本公开提供一种锁存电路和包括其的半导体存储器件。一种锁存电路包括：多个锁存器组，每个锁存器组包括使能锁存器和多个地址锁存器；以及多个锁存宽度调整电路，其分别对应于多个锁存器组，其中，在多个锁存器组的每个中，对应的锁存宽度调整电路设置在对应的锁存器组的使能锁存器和与该使能锁存器相邻的地址锁存器之间，并且在启动操作结束时，根据对应的锁存器组是否被使用来将使能锁存器耦接到相邻的地址锁存器。
电路包括半导体存储器件

[实用新型]一种通用型现场总线控制器-CN201922436866.8有效
发明人：单文盛;王晟磊 -专利权人：湖南师范大学
申请日： 2019-12-30 - 公布日： 2020-07-10 - 主分类号： G05B19/042 文献下载
摘要：一种通用型现场总线控制器，接口单元与中央控制模块的I/O口连接，第一锁存器、第二锁存器、第三锁存器、第四锁存器、第五锁存器、第六锁存器、第七锁存器分别与中央控制模块的同一组I/O口连接，本实施例中，第一锁存器、第二锁存器、第三锁存器、第四锁存器、第五锁存器、第六锁存器、第七锁存器分别与中央控制模块的I/O口连接，拨码开关与第一锁存器连接，信号灯接口与第二锁存器和第三锁存器连接，温度传感器与第四锁存器和第五锁存器连接，RAM单元与第六锁存器连接，RS‑485单元与第七锁存器连接，电源单元用于供电。本实用新型采用单片机配合锁存器结构，简化了整个产品结构，使产品能够小型化，且性能稳定，信号传输稳定。
一种通用型现场总线控制器

[发明专利]保持触发器-CN201010528756.5有效
发明人：汲世安;沈学聪;李芷岩;李云汉 -专利权人：台湾积体电路制造股份有限公司
申请日： 2010-11-01 - 公布日： 2011-10-12 - 主分类号： H03K3/012 文献下载
摘要：主从保持触发器包括：主锁存器，用于锁存输入数据信号并基于输入时钟信号输出锁存的主锁存器数据信号；从锁存器，与主锁存器的输出端相连，并用于基于输入时钟信号输出锁存的从锁存器数据信号；以及保持锁存器，嵌入主锁存器和从锁存器之一中
保持触发器

[发明专利]增加锁存器提高OLED面板伽马电压稳定时间的方法-CN202010255959.5有效
发明人：李咏柱;翁文发 -专利权人：广东晟合微电子有限公司
申请日： 2020-04-02 - 公布日： 2021-07-06 - 主分类号： G09G3/3225 文献下载
摘要：本发明涉及一种增加锁存器提高OLED面板伽马电压稳定时间的方法，所述OLED面板的驱动芯片包括锁存器、伽马电压块、解码器和通道放大器，特别的，所述锁存器包括PCLK锁存器、SLATCH锁存器和TLATCH锁存器，所述TLATCH锁存器在SLATCH锁存器当前激活到SLATCH锁存器下一次激活的范围内激活，所述TLATCH锁存器激活后使得伽马电压块和通道放大器正常工作。PCLK锁存器为第一层锁存器，SLATCH锁存器为第二层锁存器，TLATCH锁存器为第三层锁存器。本发明增加了TLATCH锁存器，伽玛稳定时间和通道放大器的设置时间均能得到有效的加长。
增加锁存器提高 oled 面板电压稳定时间方法

[发明专利]用于高运算速度的累加器-CN202210836192.4在审
发明人：李性柱 -专利权人：爱思开海力士有限公司
申请日： 2022-07-15 - 公布日： 2023-06-06 - 主分类号： G06F7/501 文献下载
摘要：一种累加器包括：输入锁存电路，第一输入锁存器，其能够锁存和输出输入数据；第二输入锁存器，其能够锁存和输出奇数锁存数据；以及第三输入锁存器，其能够锁存和输出偶数锁存数据。累加器还包括累加电路，其被配置为将输入数据和从输入锁存电路输出的奇数锁存数据相加以输出奇数累加数据，并且被配置为将输入数据和偶数锁存数据相加以输出偶数累加数据。累加器还包括输出锁存电路，输出锁存电路包括能够锁存从累加电路输出的奇数累加数据并输出奇数锁存数据的第一输出锁存器，并且输出锁存电路包括能够锁存从累加电路输出的偶数累加数据并输出偶数锁存数据的第二输出锁存器
用于运算速度累加器

[发明专利]反馈锁存器电路-CN201680033403.3有效
发明人：叶棋;段政宇;S·J·迪兰;A·达塔 -专利权人：高通股份有限公司
申请日： 2016-03-31 - 公布日： 2018-12-04 - 主分类号： G06F1/04 文献下载
摘要：一种MOS器件包括第一锁存器，第一锁存器被配置有一个锁存器反馈F并且被配置为接收锁存器输入I和锁存器时钟C。第一锁存器被配置为输出Q，其中输出Q是CF、IF和的函数，并且锁存器反馈F是输出Q的函数。第一锁存器可以包括串联堆叠的第一晶体管集合，其中第一晶体管集合包括至少五个晶体管。该MOS器件可以进一步包括耦合到第一锁存器的第二锁存器。第二锁存器可以被配置为在扫描模式中作为锁存器并且在功能模式中作为脉冲锁存器。在扫描模式期间，第一锁存器可以操作为主锁存器并且第二锁存器可以操作为从锁存器。
反馈锁存器电路

[发明专利]触发器电路-CN201510352984.4有效
发明人：刘祈麟;谢尚志;鲁立忠;吴长余 -专利权人：台湾积体电路制造股份有限公司
申请日： 2015-06-24 - 公布日： 2019-03-22 - 主分类号： H03K3/012 文献下载
摘要：一种触发器电路，包括第一锁存器、第二锁存器和触发级。第一锁存器被配置为基于第一锁存器输入信号和时钟信号设置第一锁存器输出信号。第二锁存器被配置为基于第二锁存器输入信号和时钟信号设置第二锁存器输出信号。触发级被配置为基于第一锁存器输出信号生成第二锁存器输入信号。触发级被配置为基于第一锁存器输出信号和第二锁存器输出信号使第二锁存器输入信号具有不同的电压摆幅。
触发器电路

[实用新型]一种数字信号输出模块-CN201922447003.0有效
发明人：单文盛;王晟磊 -专利权人：湖南师范大学
申请日： 2019-12-30 - 公布日： 2020-07-10 - 主分类号： H03K19/018 文献下载
摘要：本申请涉及信号传输领域，尤其涉及一种数字信号输出模块，包括输入接口、第一锁存器、第二锁存器、第三锁存器、第四锁存器、输出接口、电源输入部分以及32组光耦单元，第一锁存器、第二锁存器、第三锁存器以及第四锁存器的输入端连接在输入接口上，第一锁存器、第二锁存器、第三锁存器以及第四锁存器的输入端连接在输入接口上，第一锁存器、第二锁存器、第三锁存器以及第四锁存器的输出端分别与8组光耦单元连接，32组光耦单元的输出端分别与输出接口连接，电源输入部分用于供电本申请采用锁存器配合光耦以及三极管的电路设计方式，可最大程度上减小传输中电压波动，降低传输错误的产生。
一种数字信号输出模块

[发明专利]显示驱动装置和驱动显示系统的方法-CN202211480894.X在审
发明人：郑炳浩;金星河 -专利权人： LX半导体科技有限公司
申请日： 2022-11-24 - 公布日： 2023-07-07 - 主分类号： G09G3/20 文献下载
摘要：根据本公开的显示驱动装置能够在图像数据改变时针对每种颜色在不同时间改变图像数据，所述显示驱动装置包括：由采样锁存器组成的第一阵列，采样锁存器被配置为锁存每个通道的n位图像数据；由保持锁存器组成的第二阵列，保持锁存器被配置为在针对每个锁存器组确定的锁存定时锁存被锁存在所述采样锁存器中的图像数据；信号生成电路，其被配置为生成锁存使能信号，该锁存使能信号使得所述保持锁存器在针对每个锁存器组确定的锁存定时执行锁存操作；以及包括电平移位器的第三阵列，电平移位器被配置为移位从所述保持锁存器输出的图像数据的电压电平。
显示驱动装置系统方法

[发明专利]一种角度位置传感器测量装置-CN202211403790.9在审
发明人：杜宏斌;王鹏;沈剑飞 -专利权人：北京青云航空仪表有限公司
申请日： 2022-11-10 - 公布日： 2023-04-07 - 主分类号： G01D18/00 文献下载
摘要：本发明公开了一种角度位置传感器测量装置，包括光栅编码器、四倍频电路、计数器、晶振、CPU、锁存器、电机减速器组件、角度位置传感器，其特征在于，还包括分频电路和计数器锁存控制电路，锁存器的锁存控制端接收计数器锁存控制电路的计数器锁存输出信号LOCKOUT，CPU输出的计数锁存输入信号LOCKIN接往计数器锁存控制电路，由计数器锁存控制电路对锁存器进行锁存控制，CPU输出清计数器外部锁存状态信号LOCKCLE；晶振与分频电路连接，分频后的时钟信号CLKIN接往计数锁存控制电路；锁存器通过数据总线接往CPU，角度位置传感器输出外部锁存信号EDGEIN接往CPU，CPU输出电机控制输出信号控制电机减速器组件正转或反转。
一种角度位置传感器测量装置

[发明专利]用于处理串行数据流的装置-CN201680032517.6有效
发明人： T·S·穆克吉 -专利权人：德克萨斯仪器股份有限公司
申请日： 2016-06-06 - 公布日： 2021-06-01 - 主分类号： H04L25/03 文献下载
摘要：在描述的示例中，判定反馈均衡器(DFE)(100)包括第一求和节点(112)、第一同步锁存器(114)、第二同步锁存器(116)、第一反馈锁存器(118)和第一反馈移位寄存器(120)。第一同步锁存器(114)从第一求和节点(112)接收数据。第二同步锁存器(116)和第一反馈锁存器(118)从第一同步锁存器(114)接收数据。第一反馈移位寄存器(120)耦接到第二同步锁存器(116)或第一反馈锁存器(118)的输出端。第一反馈移位寄存器(120)包括顺序耦接的移位锁存器(122‑128)。移位锁存器中的第一移位锁存器(122)锁存从第二同步锁存器(116)或第一反馈锁存器(118)接收的数据并将数据提供给第一求和节点(112)。
用于处理串行数据流装置

[发明专利]具有全扫描能力的寄存器-CN201180050743.4无效
发明人：哈里·M·拉奥;杨赛森;陈南 -专利权人：高通股份有限公司
申请日： 2011-09-21 - 公布日： 2013-06-26 - 主分类号： G11C29/32 文献下载
摘要：第一锁存器和第二锁存器的扫描测试将给定扫描值耦合到所述第一锁存器的输入以将所述第一锁存器切换到对应于所述扫描值的状态，将所述扫描值从所述第一锁存器去耦以将所述第一锁存器锁定于所述状态处，在所述第一锁存器锁定于所述状态处时将所述第一锁存器的输出耦合到所述第二锁存器的输入以将所述第二锁存器切换到所述状态，且将所述第一锁存器的所述输出从所述第二锁存器的所述输入去耦以将所述第二锁存器锁定于所述状态处。
具有扫描能力寄存器

[发明专利]用于存储器应用的锁存电路-CN201910310926.3在审
发明人：安迪·旺坤·陈;特瑞沙·路易斯·麦克劳林;富兰克·大卫·弗里德里克;理查德·斯洛博德尼克;庄耀功 -专利权人： ARM有限公司
申请日： 2019-04-17 - 公布日： 2019-10-29 - 主分类号： G11C7/10 文献下载
摘要：本文描述的各种实施方式涉及具有第一锁存电路的集成电路，所述第一锁存电路具有锁存多个输入数据信号的多个第一锁存器。集成电路可以包括第二锁存电路，第二锁存电路具有单个第二锁存器，单个第二锁存器接收来自多个第一锁存器的锁存的多个输入数据信号，并且基于锁存的多个输入数据信号输出单个锁存数据信号。集成电路可以包括耦合在第一锁存电路和第二锁存电路之间的中间逻辑电路。中间逻辑电路可以从第一锁存电路接收多个输入数据信号并且将其组合成单个数据信号，所述单个数据信号被提供给第二锁存电路的单个第二锁存器，以作为单个锁存数据信号输出。
锁存电路锁存器锁存集成电路锁存数据信号数据信号存储器应用信号输出耦合合成输出

[发明专利]一种可连续写入的铁电存储器及其写入方法-CN202110599488.4在审
发明人：徐勤媛;唐原 -专利权人：无锡拍字节科技有限公司
申请日： 2021-05-31 - 公布日： 2021-08-10 - 主分类号： G11C7/10 文献下载
摘要：本发明公开一种铁电存储器，包括第一数据锁存器、第二数据锁存器以及锁存器选择单元。其中，第一数据锁存器以及第二数据锁存器用于接收待写入的数据，锁存器选择单元则根据计数单元的输出，交替使能第一数据锁存器以及第二数据锁存器，以锁存接收的数据，并在状态机地址增加完成后，将锁存的数据写入指定地址其中，计数单元、锁存器选择单元以及数据接收均通过D触发器实现。
一种连续写入存储器及其方法

[发明专利]具有主锁存器和从锁存器的触发器电路-CN202011173069.6在审
发明人：洪显星 -专利权人：台湾积体电路制造股份有限公司
申请日： 2020-10-28 - 公布日： 2021-05-14 - 主分类号： H03K3/037 文献下载
摘要：本文中描述用于具有主锁存器和从锁存器的的触发器电路。触发器电路包含主锁存器，主锁存器配置成锁存输入数据信号且基于主时钟信号而输出数据锁存信号。电路还包含从锁存器，从锁存器耦接到主锁存器且配置成基于从锁存器时钟信号和数据锁存信号而产生输出数据信号。此外，电路包含耦接到主锁存器和从锁存器的偏斜时钟电路。
具有主锁存器锁存器触发器电路

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