专利名称
主分类
A 农业
B 作业;运输
C 化学;冶金
D 纺织;造纸
E 固定建筑物
F 机械工程、照明、加热
G 物理
H 电学
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公布日期
2023-10-24 公布专利
2023-10-20 公布专利
2023-10-17 公布专利
2023-10-13 公布专利
2023-10-10 公布专利
2023-10-03 公布专利
2023-09-29 公布专利
2023-09-26 公布专利
2023-09-22 公布专利
2023-09-19 公布专利
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专利权人
国家电网公司
华为技术有限公司
浙江大学
中兴通讯股份有限公司
三星电子株式会社
中国石油化工股份有限公司
清华大学
鸿海精密工业股份有限公司
松下电器产业株式会社
上海交通大学
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  • [发明专利]具有未图案化的蚀刻停止的MOTFT-CN201480062664.9在审
  • 俞钢;谢泉隆;于尔根·穆佐尔夫;法特·弗恩格;肖田 - 希百特股份有限公司
  • 2014-11-12 - 2016-08-10 - H01L21/36
  • 一种制造高迁移率半导体金属氧化物薄膜晶体管的方法,包括以下步骤:沉积半导体金属氧化物材料、在所述MO材料上沉积蚀刻停止材料的覆盖层、以及在所述蚀刻停止材料的覆盖层上图案化/金属,所述图案化包括:将所述/金属蚀刻为/极端子,所述/极端子被设置为在所述半导体金属氧化物中限定沟道区域;至少在所述/极端子之下,所述蚀刻停止材料在垂直于所述覆盖层的平面的方向上导电,以提供所述/极端子中的每一个与所述半导体金属氧化物沟道材料之间的电接触。所述蚀刻停止材料还具有化学鲁棒性,以在蚀刻工艺期间保护所述半导体金属氧化物沟道材料
  • 具有图案蚀刻停止motft
  • [发明专利]阵列基板、阵列基板的制造方法及显示装置-CN201510171291.5有效
  • 刘威;姜春生 - 京东方科技集团股份有限公司
  • 2015-04-10 - 2017-11-28 - H01L27/32
  • 该方法包括在衬底基板上依次形成栅极金属图案和栅极绝缘;在衬底基板上形成由预设金属制成的金属图案,金属图案包括,预设金属至少包括铜;在衬底基板上依次形成氮化硅和氧化硅,组成钝化;在钝化上,的间隙上方形成沟道,氧化硅上的沟道宽度小于氮化硅上的沟道宽度,且大于或等于的间隙距离;在金属图案上形成与氮化硅不接触的氧化物沟道图案。本发明解决了Cu金属被氧化的程度较高,且阵列基板的显示特性较差的问题,实现了降低Cu金属被氧化的程度,提高阵列基板显示特性的效果,用于显示装置。
  • 阵列制造方法显示装置
  • [发明专利]多栅器件及其形成方法-CN202110602005.1在审
  • 乔治奥斯·韦理安尼堤斯;布兰丁·迪里耶 - 台湾积体电路制造股份有限公司
  • 2021-05-31 - 2021-09-14 - H01L27/088
  • 一种示例性器件包括布置在衬底上方的沟道、第一外延/部件和第二外延/部件。该沟道布置在第一外延/部件与第二外延/部件之间。金属栅极布置在第一外延/部件与第二外延/部件之间。该金属栅极布置在沟道的至少两个侧上方并与其物理接触。/接触件布置在第一外延/部件上方。掺杂晶体半导体,例如镓掺杂晶体锗,布置在第一外延/部件与/接触件之间。该掺杂晶体半导体布置在第一外延/部件的至少两个侧上方并与其物理接触。在一些实施例中,该掺杂晶体半导体具有小于约1x10‑9Ω‑cm2的接触电阻率。
  • 器件及其形成方法
  • [发明专利]底栅型TFT基板的制作方法-CN201710454064.2有效
  • 何敏博 - 深圳市华星光电技术有限公司
  • 2017-06-15 - 2019-12-24 - H01L27/12
  • 本发明提供一种底栅型TFT基板的制作方法,在栅极金属上形成第一蚀刻阻挡,在金属上形成第二蚀刻阻挡,然后在栅极金属上方及金属上方分别形成过孔时,先采用第一蚀刻气体蚀刻到第一蚀刻阻挡、及第二蚀刻阻挡上,对应在栅极金属上方及金属上方分别形成第一初级过孔及第二初级过孔,再采用第二蚀刻气体同时对第一初级过孔下方第一蚀刻阻挡、及第二初级过孔下方的第二蚀刻阻挡进行蚀刻,由于第一蚀刻阻挡与第二蚀刻阻挡为相同的材料及厚度,因此可同时被刻穿,从而同步在栅极金属上方形成第一过孔、在金属上方形成第二过孔,避免金属被严重过刻而影响接触电阻和线路连接。
  • 底栅型tft制作方法
  • [发明专利]半导体器件及其制造方法-CN201710979479.1有效
  • 李振铭;杨复凯;王美匀 - 台湾积体电路制造股份有限公司
  • 2017-10-19 - 2021-09-03 - H01L21/336
  • 在制造半导体器件的方法中,在下面的结构上方形成间介电(ILD)。下面的结构包括栅极结构(每个均具有金属栅极和设置在金属栅极上方的覆盖绝缘)、设置在两个邻近的栅极结构之间的/外延以及覆盖/外延的蚀刻停止(ESL)。通过蚀刻在ILD中形成开口。在开口中形成介电填充。通过使用湿蚀刻,去除设置在/外延之上的ILD。去除设置在/外延上的ESL,从而至少部分地暴露/外延。在暴露的/外延上方形成导电材料。本发明的实施例还涉及半导体器件。
  • 半导体器件及其制造方法
  • [发明专利]一种氧化物半导体薄膜晶体管-CN201410456678.0在审
  • 司红康;金一琪 - 六安市华海电子器材科技有限公司
  • 2014-09-10 - 2014-12-03 - H01L29/786
  • 本发明涉及一种氧化物半导体薄膜晶体管,在所述金属电极与所述区域接触的区域引入氢浓度分布。在所述金属电极与所述区域界面处,以及所述金属电极与所述区域的界面处引入的氢浓度最高,并且在远离界面处的方向上引入的氢浓度逐渐变小。进一步的,在靠近所述沟道区域的所述区域部分没有覆盖所述金属电极,且在所述金属电极远离所述区域的一端以及沟道区域内没有引入的氢浓度分布,本发明在不导致氧化物薄膜晶体管性能下降的情况下
  • 一种氧化物半导体薄膜晶体管
  • [发明专利]用于绝缘体上硅射频开关器件结构的制造方法-CN201510189304.1有效
  • 刘张李 - 上海华虹宏力半导体制造有限公司
  • 2015-04-17 - 2018-03-30 - H01L21/8238
  • 一种用于绝缘体上硅射频开关器件结构的制造方法,包括形成绝缘体上硅射频开关器件的基本结构,基本结构包括在有源中形成的区域、栅极区域和区域,其中在栅极区域上形成了栅极氧化和栅极多晶硅,有源上覆盖有介质,在介质上形成有通过通孔分别与区域和区域连接的金属布线和金属布线;沉积介质材料并对沉积的介质材料进行平坦化处理,以使得介质的厚度变大,其中介质材料完全覆盖金属布线和金属布线;在介质中刻蚀出位于金属布线和金属布线之间的凹槽;在凹槽中部分地填充介质材料,以便在凹槽中形成被介质材料包围的空隙。
  • 用于绝缘体射频开关器件结构制造方法
  • [发明专利]一种GaN HEMT器件的制备方法-CN202010393703.0在审
  • 蒋洋;于洪宇;汪青;范梦雅;何佳琦 - 南方科技大学
  • 2020-05-11 - 2020-08-18 - H01L29/778
  • 本发明实施例公开了一种GaN HEMT器件的制备方法,包括提供外延基底,外延基底包括衬底以及在衬底上依次层叠设置的沟道以及势垒;采用氧化刻蚀工艺图形化势垒,形成欧姆接触凹槽和欧姆接触凹槽;在欧姆接触凹槽内形成欧姆接触电极,同时在欧姆接触凹槽内形成欧姆接触电极;在势垒欧姆接触电极以及欧姆接触电极背离衬底一侧形成图形化的钝化,在钝化背离外延基底的一侧形成、栅极开孔并沉积金属电极,金属电极包括金属电极、金属电极和栅极金属电极。
  • 一种ganhemt器件制备方法
  • [发明专利]半导体元件及半导体元件的制造方法-CN201110301069.4无效
  • 内原士 - 株式会社东芝
  • 2011-08-31 - 2012-09-26 - H01L29/78
  • 本发明提供一种半导体元件,其具备:;选择性地设于内的漂移区域;选择性地设于漂移区域内的衬底区域;选择性地设于衬底区域内的区域;在区域或的至少一方的内部,选择性地设于区域或的至少一方的第一、第二金属;在与的表面大致平行的方向上,从区域的一部分贯通与区域的至少一部分邻接的衬底区域而到达漂移区域的一部分的沟槽状的栅电极;与第一金属连接的电极;以及与或第二金属连接的漏电极
  • 半导体元件制造方法
  • [发明专利]基于倒置工艺的射频功率管及其形成方法-CN201210331121.5有效
  • 吕宏鸣;肖柯;吴华强;钱鹤;伍晓明 - 清华大学
  • 2012-09-07 - 2013-01-09 - H01L21/336
  • 本发明公开了一种基于倒置工艺的射频功率管及其形成方法,该方法包括:提供衬底;形成过渡;形成连接线、连接线和栅极连接线;在过渡之上形成间介质间介质填充在连接线之间;在间介质之上形成金属接触金属接触与连接线相连;刻蚀金属接触以形成互相平行的N个、N个和2N-1个栅极,其中,按照-栅极--栅极的顺序依次相邻排列,N个连接线相连,N个连接线相连,2N-1个栅极与栅极连接线相连;形成栅极介质;以及形成石墨烯薄膜作为沟道。本发明的方法采用倒置工艺,易于实现、稳定可靠;本发明的器件具有倒置结构,漏接触小、栅控能力强。
  • 基于倒置工艺射频功率管及其形成方法

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