专利名称
主分类
A 农业
B 作业;运输
C 化学;冶金
D 纺织;造纸
E 固定建筑物
F 机械工程、照明、加热
G 物理
H 电学
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公布日期
2023-10-24 公布专利
2023-10-20 公布专利
2023-10-17 公布专利
2023-10-13 公布专利
2023-10-10 公布专利
2023-10-03 公布专利
2023-09-29 公布专利
2023-09-26 公布专利
2023-09-22 公布专利
2023-09-19 公布专利
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专利权人
国家电网公司
华为技术有限公司
浙江大学
中兴通讯股份有限公司
三星电子株式会社
中国石油化工股份有限公司
清华大学
鸿海精密工业股份有限公司
松下电器产业株式会社
上海交通大学
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  • [发明专利]一种深度图轮廓预测的并行实现方法-CN201911288512.1有效
  • 谢晓燕;张西红;王昱;朱筠;蒋林 - 西安邮电大学
  • 2019-12-12 - 2023-05-30 - H04N19/597
  • 本发明提供一种深度图轮廓预测的并行实现方法,通过构建基于邻接互连的4×4二维处理元阵列并行结构,完成三维高效视频编码中深度图轮廓预测的并行处理,包括:读取纹理像素值和深度像素值到所述并行结构的所述处理元中,并行地进行深度图编码块和纹理图参考块的4×4、8×8和16×16的纹理均值、二值映射矩阵、恒定分区过程和SAD代价计算。本发明实施例提供的用于深度图轮廓预测的并行实现方法,通过构建并行结构,采用不同的处理单元对不同大小编码块的轮廓预测并行处理,减少了深度图轮廓预测的时间,有效的提升了深度图轮廓预测编码的效率。
  • 一种深度轮廓预测并行实现方法
  • [发明专利]一种基于自适应控制电路的积相关算法实现系统-CN201510753421.6在审
  • 王可;李岩;纪策;刘慧婕 - 天津津航计算技术研究所
  • 2015-11-06 - 2016-01-06 - G06F7/523
  • 本发明公开了一种基于自适应控制电路的积相关算法实现系统,包括:自适应控制电路、数据并行化拆分处理模块、算法功能单元、加法器和输出控制电路,自适应控制电路连接数据并行化拆分处理模块、加法器和输出控制电路,算法功能单元和加法器连接输出控制电路。本发明随着图像尺寸条件的变化,控制电路可以自适应的将图像分成适宜计算的多个子部分,利用算法功能单元分别计算各个子部分的乘加值,求和取得要计算的乘累加项的值,根据计算一个图像匹配所需的算法功能单元的数目,相对应的并行路数相应减少,直至最少为一路,充分利用FPGA内部资源,实现最大化的算法并行,提高协处理器运算性能。
  • 一种基于自适应控制电路相关算法实现系统
  • [发明专利]大规模图像数据处理系统及方法-CN201811631613.X有效
  • 于双铭;李鸿龙;吴南健 - 中国科学院半导体研究所
  • 2018-12-28 - 2020-10-23 - G06T1/20
  • 本发明公开了一种大规模图像数据处理系统及方法,该系统包括:高速视觉芯片核心处理模块,用于对输入的图像数据进行层次化多级并行的深度学习算法处理,包括:处理核心模块和处理块阵列,该处理块阵列包含M×N个连接可配置的处理块,M、N均为正整数,每个处理块包含微处理单元阵列;其中,处理核心模块用于整个处理块阵列的连接配置、运行控制、以及状态监控,同时能实现全局级图像数据处理处理块阵列中的各个处理块用于多种不同分辨率图像的并行处理;微处理单元阵列包含P个微处理单元,P为正整数,用于实现像素级数据的并行处理
  • 大规模图像数据处理系统方法
  • [发明专利]支持定浮点可重构的长度可配置的向量最大/最小值网络-CN201110415155.8有效
  • 王东琳;汪涛;尹磊祖;谢少林 - 中国科学院自动化研究所
  • 2011-12-13 - 2012-06-27 - G06F7/02
  • 本发明公开了一种支持定浮点可重构的长度可配置的向量最大/最小值网络,包括:并行浮点数据预处理单元,用于对接收的512位向量数据A的格式进行分析,并针对不同的数据格式分别进行处理,将处理后得到的浮点数据输出给可重构比较器网络,将处理后得到的各种标志位输出给结果选择单元;Mask寄存器,用于控制参与最大/最小值的数据;可重构比较器网络,用于将接收自并行浮点数据预处理单元的浮点数据以及接收自Mask寄存器的值作为输入,对向量数据依次进行比较,将得到的最大/值结果输出给结果选择单元;以及结果选择单元,用于接收可重构比较器网络的输出,根据接收自并行浮点数据预处理单元的各种标志位输出得到最终的向量最大/最小值结果。
  • 支持浮点可重构长度配置向量最大最小值网络
  • [发明专利]光子信息处理芯片-CN202010653113.7有效
  • 周炆杰;刘晓海 - 欧梯恩智能科技(苏州)有限公司
  • 2020-07-08 - 2021-01-01 - G06E1/00
  • 本发明公开光子信息处理芯片,包括并行扩束单元,用于将输入光子信号按不同波长间隔分成多束光子信号,以实现并行化的信息处理;权重设置单元,用于将所述并行扩束单元后的每一束不同波长间隔的光子束的强度值或相位值分别进行不同等级的权重值设置;交叉运算单元,用于将所述权重设置单元之后已被设置为不同权重值的光子束按照不同的控制电压值进行重新分配传播通道;光电接收阵列,用于将经过所述交叉运算单元重新分配传播通道之后的每一束不同波长间隔的光子束分别通过光电转换成多路电压信号阵列由此,利用本申请的光子信息处理芯片在信息处理容量大幅度提高,信息处理时间大幅度减少,信息处理能耗大幅度降低。
  • 光子信息处理芯片
  • [发明专利]一种图像处理装置-CN202010631900.1在审
  • 刘洋;高军军;文湘鄂;宋磊;贾惠柱 - 北京博雅慧视智能技术研究院有限公司
  • 2020-07-03 - 2020-11-27 - G06T1/20
  • 本申请提供一种图像处理装置,包括:图像数据写入模块,用于接收图像数据;数据处理控制模块,用于将图像数据输出至图像处理模块,并配置图像处理模块的图像处理参数;图像处理模块,包括并行运行的多个图像处理单元,每个图像处理单元,用于根据图像处理参数执行图像处理操作,获得图像处理结果数据。本申请图像处理单元为能实现图像处理功能的硬件实体(电路),且多个图像处理单元能够并行运行。因此,图像处理装置能够根据图像处理任务的实际要求配置相应的图像处理单元,从而相较于采用软件程序实现图像处理的方式,能够同时处理海量的图像数据,且在图像处理的速度、效率以及稳定性上更加优越。
  • 一种图像处理装置
  • [发明专利]一种芯片和一种芯片并行测试的方法-CN201010501240.1有效
  • 苏志强;舒清明;朱一明 - 北京兆易创新科技有限公司
  • 2010-09-30 - 2012-05-09 - G11C19/28
  • 本发明提供了一种芯片和一种芯片平行测试的方法,其中的芯片具体包括:多个并口;接口转换单元,包括多个接口,其中,所述接口与所述多个并口相连,且所述接口与测试机台的探针一一对应相连,包括:串行接收模块,用于串行接收来自所述测试机台的测试数据;及并行输入模块,用于在接收完毕后,将所述测试数据并行输入至所述多个并口;处理单元,用于针对所述多个并口的测试数据,处理得到相应的处理数据;及并转串输出单元,用于将所述多个并口的处理数据,通过并转串的方法输入至所述接口转换单元;所述接口转换单元还包括:串行输出模块,用于将所述处理数据,串行输出至所述测试机台。本发明用以提高芯片的并行测试速度,降低测试成本。
  • 一种芯片并行测试方法
  • [发明专利]车速控制装置-CN201811087327.1有效
  • 渡边义德;大町忠嗣 - 丰田自动车株式会社
  • 2018-09-18 - 2022-03-01 - B60W30/14
  • 本发明提供了一种车速控制装置,其包括并行车辆检测传感器和电子控制单元,该电子控制单元配置成执行:(i)巡航控制;(ii)并行车辆检测处理;(iii)盲区避开控制,该盲区避开控制用于在检测到并行车辆时将本车辆的速度控制成使得使本车辆移动至并行车辆的盲区后面的位置;(iv)盲区离开判断处理,该盲区离开判断处理用于判断本车辆是否可以通过根据巡航条件行驶而移动至盲区前面的位置;以及(v)避开取消处理,该避开取消处理用于在由盲区离开判断处理判定本车辆可以移动至盲区前面的位置时使由巡航控制对速度的控制优先于由盲区避开控制对速度的控制
  • 车速控制装置

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