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[发明专利]一种分频器电路及频率合成器-CN202210139588.3有效
发明人：何力;杨奕 -专利权人：山东兆通微电子有限公司
申请日： 2022-02-16 - 公布日： 2022-06-14 - 主分类号： H03K23/00 文献下载
摘要：本发明涉及集成电路领域，公开了一种分频器电路及频率合成器，包括相位偏移单元、整数分频器及相位控制单元，相位控制单元的输入端输入参数i，在输出时钟信号的每个周期内相位控制单元均会输出i次脉冲，然后相位偏移单元输出第i个偏移时钟信号，i每增加1时整数分频器的输入时钟信号的相位就延迟，整数分频器的输出时钟信号就要延迟个初始时钟信号的周期，最终分频器电路的分频比为681576DEST_PATH_IMAGE003.JPG" imgContent="drawing" imgFormat="JPEG" orientation="portrait" inline="yes" />，分频比的变化步径为
一种分频器电路频率合成器

[发明专利]半整数步长分频器和包括半整数步长分频器的分频器-CN202211140273.7在审
发明人：李闻界;管逸 -专利权人：上海韬润半导体有限公司
申请日： 2022-09-20 - 公布日： 2022-11-22 - 主分类号： H03K23/68 文献下载
摘要：本发明涉及一种半整数步长分频器和包括所述半整数步长分频器的分频器。按照本发明一个方面的半整数步长分频器包括：逻辑处理单元，其配置成响应于时钟信号的上升沿和下降沿而操作以生成输出信号，其中所述输出信号的最小步长为所述时钟信号的周期的一半并且所述输出信号的输出电平以预定逻辑生成；以及数据延迟单元，其配置成接收所述输出信号，并且由所述时钟信号的上升沿触发而存储所述输出信号以及由所述时钟信号的下降沿触发而将所述输出信号反馈至所述逻辑处理单元。
整数步长分频器包括

[实用新型]一种音频分频器-CN200920155364.1无效
发明人：王卫东 -专利权人：王卫东
申请日： 2009-05-15 - 公布日： 2010-08-04 - 主分类号： H04R1/00 文献下载
摘要：本实用新型公开了一种音频分频器，其特征在于：该音频分频器包括分频器本体和与分频器本体固定连接的分频器连接线，分频器本体上设有分插孔，作为优选，该分频器本体为星形，分插孔设于星形的凸角上，作为优选，该分频器本体上设有该实用新型音频分频器的有益效果在于：分频器的分插孔起到很好的分频作用，当分频器连接线连接到MP3、电脑等音频信号输出端时，分插孔可连接多个耳塞插头，实现一台机子多人同时使用，大大增强了实用性。
一种音频分频器

[实用新型]一种北斗卫星信号和DTMB的共模天线-CN202221337897.3有效
发明人：夏召祥;李秀荣 -专利权人：德州众昌电子有限公司
申请日： 2022-05-31 - 公布日： 2022-09-06 - 主分类号： H01Q5/20 文献下载
摘要：本实用新型属于信号接收天线技术领域，特别涉及一种北斗卫星信号和DTMB的共模天线，包括接收天线单元、分频器以及北斗信号输出端和DTMB信号输出端，所述接收天线单元连接分频器，所述分频器与北斗信号输出端和
一种北斗卫星信号 dtmb 天线

[发明专利]一种50%占空比的2-7预分频器-CN202310167814.3在审
发明人：李元勋;王茗璐;李勃彦 -专利权人：电子科技大学
申请日： 2023-02-27 - 公布日： 2023-05-16 - 主分类号： H03K23/66 文献下载
摘要：本发明涉及分频器集成电路技术领域，具体为一种50％占空比的2‑7预分频器。本发明包含一个带分频比扩展位的2/3分频单元，一个附加2分频逻辑模块，一个附加扩展传输路径模块和一个奇数整数占空比校正逻辑模块。本发明首先根据分频比在2/3分频单元进行除2/除3操作，再将其输出信号输入附加2分频逻辑中，当分频比大于3时，附加扩展传输路径模块工作，当分频比为奇数时，占空比校正模块会对输入信号进行占空比校正。相比现有技术，本发明电路结构简单，分频比覆盖率广、噪声贡献低以及输出占空比接近50％，可以应用于多模可编程分频器中。
一种 50 分频器

[发明专利]基于延时锁定环路的1.5分频器-CN202110864348.5在审
发明人：钟英权;李承哲 -专利权人：集益威半导体（上海）有限公司
申请日： 2021-07-29 - 公布日： 2023-02-03 - 主分类号： H03L7/18 文献下载
摘要：本申请涉及集成电路技术领域，公开了一种基于延时锁定环路的1.5分频器，包括：除1.5分频器和延时锁定环路，所述延时锁定环路包括压控延时单元、鉴相器、低通滤波器和误差放大器。所述除1.5分频器根据一对正相和反相时钟信号输出占空比为1/3，分频比为1.5的分频信号到所述鉴相器和所述压控延时单元，所述压控延时单元将所述分频信号延时一定时间输出到所述鉴相器。所述鉴相器对所述分频信号和延时的分频信号进行逻辑运算形成占空比为1/2的分频信号并转换为一对差分信号输出。所述一对差分信号依次经过所述低通滤波器和所述误差放大器输出到所述压控延时单元。
基于延时锁定环路 1.5 分频器

[发明专利]传送装置-CN200710139823.2有效
发明人：海贺孝司;须釜幸一;近沢勉;片柳幸男;矢岛研一;阿部秀朗;萱山隆二;塩田昌宏 -专利权人：富士通株式会社
申请日： 2007-08-01 - 公布日： 2008-04-09 - 主分类号： H04J3/06 文献下载
摘要：在该传送装置中使用中央处理单元的总线来使单元之间的定时信号同步，从而限制了配线规模变大。基准信号产生器产生基准信号。基准信号接收器被安装在设置为活动单元或备用单元的单元上并接收所述基准信号。定时信号产生器借助分频器/计数器对所接收的基准信号进行分频以产生定时信号。计数保持器保持分频器/计数器的计数值。总线将所述单元和中央处理单元连接起来。计数接收器通过该总线从活动单元的计数保持器接收计数值。计数更新器将分频器/计数器的计数值更新为计数接收器接收到的计数值。
传送装置

[实用新型]一种新型的插针式耳机-CN201921997208.X有效
发明人：王双云 -专利权人：王双云
申请日： 2019-11-19 - 公布日： 2020-07-14 - 主分类号： H04R1/10 文献下载
摘要：一种新型的插针式耳机，它涉及电子产品技术领域；高音输入插针和低音输入插针上分别设有插针卡槽，高音输入插针与第一前置分频器电连接，第一前置分频器与第一LC分频电路电连接，第一LC分频电路与超高音动铁单元和高音动铁单元电连接；所述的低音输入插针与第二前置分频器电连接，第二前置分频器与第二LC分频电路电连接，第二LC分频电路与中低音动铁单元和低音动圈单元电连接。
一种新型插针式耳机

[发明专利]具有改进的2/3分频级的宽范围无故障地可切换时钟分频器-CN201710707712.0在审
发明人：布里安·G·德罗斯特 -专利权人：硅谷实验室公司
申请日： 2017-08-17 - 公布日： 2018-03-06 - 主分类号： H03K23/66 文献下载
摘要：本发明公开了一种分频器，其包括2/3分频器级，所述2/3分频器级可以被关闭而不需要切换以延长分频器的分频范围，同时也减少了分频器输出的杂噪影响，并保留了时序裕度以无故障地更新分频比。2/3分频器级响应于被解除有效的输入使能信号，以及响应于被有效的模数输入信号以保持在禁用状态，其中分频器级确保在分频器级中的存储元件输出保持不变,从而无须切换。分频器还使用保持使能的最下游级的输出来选择分频器的分频比的更新时钟。
具有改进分频范围故障切换时钟分频器

[发明专利]一种多频阵列天线的馈电电路、设备及方法-CN201910936207.2在审
发明人：肖振宁 -专利权人：锐捷网络股份有限公司
申请日： 2019-09-29 - 公布日： 2019-12-31 - 主分类号： H01Q21/00 文献下载
摘要：该电路包括多个天线阵元和与多个天线阵元一一对应连接的多个分频器单元；分频器单元用于通过馈电导线获取相应天线阵元接收的具有多个频率的多频射频信号；将对应的天线阵元接收的多频射频信号按不同频率分成多个单频射频信号；与多个频率一一对应的多个合路器单元，每个合路器单元分别与多个分频器单元连接，用于将多个分频器单元中相同频率的单频射频信号合路后，传输至对应接收该单频射频信号的收发机。
分频器单元射频信号天线阵元单频多频合路器单元馈电电路阵列天线射频信号合路馈电导线馈电结构收发机电路传输申请

[发明专利]音频处理电路、音频模组及电子设备-CN201910483359.1在审
发明人：蒋燚;陈岩 -专利权人： OPPO广东移动通信有限公司
申请日： 2019-06-04 - 公布日： 2019-08-23 - 主分类号： H04R3/00 文献下载
摘要：本申请公开了一种音频处理电路，包括：振荡器、信号处理单元、音频转换单元、时钟分频器；振荡器、信号处理单元以及音频转换单元依次连接；信号处理单元用于对接收到的音频数据进行数字信号处理，得到第一音频信号，并将该第一音频信号传输至音频转换单元；时钟分频器的输入端与振荡器连接，时钟分频器的输出端与音频转换单元连接；振荡器用于产生主时钟信号，时钟分频器用于根据该主时钟信号产生目标时钟频率，并将该目标时钟频率提供给音频转换单元；音频转换单元至少包括采样率转换单元和数模转换器，该采样率转换单元用于将第一音频信号的采样率转换为目标时钟频率，得到第二音频信号，该数模转换器用于对第二音频信号进行数模转换并输出。
音频转换单元时钟分频器音频信号振荡器目标时钟频率信号处理单元采样率转换音频处理电路主时钟信号数字信号处理音频信号传输数模转换器单元和数电子设备模转换器数模转换依次连接音频数据输出端输入端模组输出申请

[发明专利]三模预分频器的设计方法和应用-CN202110978353.9在审
发明人：万海军;宋文星;张跃玲 -专利权人：苏州聚元微电子股份有限公司
申请日： 2021-08-24 - 公布日： 2021-12-31 - 主分类号： H03L7/18 文献下载
摘要：本发明公开了三模预分频器(triple‑modulus prescaler)的设计方法和应用，属于高速模拟和射频芯片的设计技术领域，该设计方法是在双模预分频器的基础上，通过增加预分频器的模数，以此来降低整体锁相环(PLL)环路分频器(loopdivider)连续分频比的下限；其次，该种设计方法产生的三模预分频器在环路分频器和高速锁相环频率综合器中均可应用；本发明将双模预分频器拓展到多模预分频器，在维持双模分频高速度优点的同时，有效地降低了整体环路分频器连续分频比的下限。
三模预分频器设计方法应用

[发明专利]单相时钟分频器电路和锁相环电路-CN201710370989.9在审
发明人：薛盘斗 -专利权人：中芯国际集成电路制造(上海)有限公司;中芯国际集成电路制造(北京)有限公司
申请日： 2017-05-23 - 公布日： 2018-12-07 - 主分类号： H03K23/66 文献下载
摘要：一种单相时钟分频器电路和锁相环电路，所述单相时钟分频器电路包括：第一触发器和第二触发器和分频控制单元；第一触发器和第二触发器互为前级输出单元；所述第二触发器的输出时钟信号作为所述单相时钟分频器电路的输出端；所述分频控制单元，包括第七NMOS管和第八NMOS管；所述第七NMOS管的栅端与所述第一触发器的反相输出时钟信号耦接；所述第七NMOS管的源端与所述第八NMOS管的漏端耦接；所述第七NMOS管的漏端与所述第二触发器耦接上述的方案，可以简化单相时钟分频器电路的结构，并降低功耗。
分频器电路单相时钟耦接第二触发器第一触发器输出时钟信号锁相环电路分频漏端源端栅端降低功耗控制信号输出单元输出端地线反相前级

[发明专利]一种叶片振动测量键相基准信号产生装置及方法-CN202211010945.2在审
发明人：牛广越;刘美茹;郭沛铉;支烽耀;钟志才;肖潇;焦江昆;段发阶 -专利权人：天津大学;中国航发四川燃气涡轮研究院
申请日： 2022-08-23 - 公布日： 2022-11-22 - 主分类号： G01H17/00 文献下载
摘要：本发明公开一种叶片振动测量键相基准信号产生装置及方法，信号产生装置包括控制器和依次相连的转速测量传感器、驱动及调理模块、电平转换模块、锁相倍频单元和小数分频单元，所述锁相倍频单元包括首尾依次相连的鉴相器、环路滤波器、压控振荡器和分频器；所述控制器与电平转换模块、小数分频单元和分频器连接；本发明利用了锁相技术的合成频率稳定度高、相位噪声水平低、频率建立时间短的优势，通过鉴相器的相位比较和分频器的信号反馈
一种叶片振动测量基准信号产生装置方法

[实用新型]一种叶片振动测量键相基准信号产生装置-CN202222237445.4有效
发明人：牛广越;郭沛铉;刘美茹;支烽耀;钟志才;肖潇;焦江昆;段发阶 -专利权人：天津大学;中国航发四川燃气涡轮研究院
申请日： 2022-08-23 - 公布日： 2022-12-02 - 主分类号： G01H17/00 文献下载
摘要：本实用新型公开一种叶片振动测量键相基准信号产生装置，包括控制器和依次相连的转速测量传感器、驱动及调理模块、电平转换模块、锁相倍频单元和小数分频单元，所述锁相倍频单元包括首尾依次相连的鉴相器、环路滤波器、压控振荡器和分频器；所述控制器与电平转换模块、小数分频单元和分频器连接；本实用新型利用了锁相技术的合成频率稳定度高、相位噪声水平低、频率建立时间短的优势，通过鉴相器的相位比较和分频器的信号反馈，能抑制原始的测试转速信号与产生的键相基准信号之间的相位误差
一种叶片振动测量基准信号产生装置