[发明专利]半导体器件及其制造方法在审

专利信息
申请号: 201910447934.2 申请日: 2019-05-27
公开(公告)号: CN110190058A 公开(公告)日: 2019-08-30
发明(设计)人: 薛广杰;曹开玮;李赟 申请(专利权)人: 武汉新芯集成电路制造有限公司
主分类号: H01L27/11521 分类号: H01L27/11521;H01L27/11517
代理公司: 上海思微知识产权代理事务所(普通合伙) 31237 代理人: 屈蘅
地址: 430205 湖北*** 国省代码: 湖北;42
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摘要: 发明提供了一种半导体器件及其制造方法,所述半导体器件的制造方法包括:提供一具有外围区和存储区的衬底,且所述外围区和存储区上均形成有至少一个栅极结构;形成侧墙于所述栅极结构的侧壁上;至少去除所述存储区上的所述栅极结构的侧壁上的部分厚度的所述侧墙,以使得相邻的所述栅极结构之间的所述侧墙之间的间距增大;以及,形成层间介质层于所述衬底上,所述层间介质层覆盖所述栅极结构和所述侧墙。本发明的技术方案使得相邻的栅极结构之间的侧墙之间的深宽比降低,进而使得相邻的栅极结构之间的侧墙之间的层间介质层中的空洞的数量减少和尺寸减小,从而使得产品良率得到提高。
搜索关键词: 栅极结构 侧墙 半导体器件 层间介质层 外围区 侧壁 衬底 制造 产品良率 尺寸减小 间距增大 数量减少 介质层 深宽比 去除 空洞 覆盖
【主权项】:
1.一种半导体器件的制造方法,其特征在于,包括:提供一具有外围区和存储区的衬底,且所述外围区和存储区上均形成有至少一个栅极结构;形成轻掺杂区于所述栅极结构两侧的所述衬底中,且所述轻掺杂区部分位于所述栅极结构的下方;形成侧墙于所述栅极结构的侧壁上;至少去除所述存储区上的所述栅极结构的侧壁上的部分厚度的所述侧墙,以使得相邻的所述栅极结构之间的所述侧墙之间的间距增大;以所述栅极结构和去除所述部分厚度的所述侧墙为掩膜,形成源极和漏极于所述存储区的所述栅极结构两侧的所述衬底中,且所述存储区的相邻的所述栅极结构共用所述源极或所述漏极,所述轻掺杂区分别与所述源极和所述漏极部分重叠;以及,形成层间介质层于所述衬底上,所述层间介质层覆盖所述栅极结构和所述侧墙。
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