[发明专利]基于标准CMOS工艺的单层多晶结构EEPROM在审
申请号: | 201811456480.7 | 申请日: | 2018-11-30 |
公开(公告)号: | CN109473430A | 公开(公告)日: | 2019-03-15 |
发明(设计)人: | 齐敏;孙泉;宋培滢 | 申请(专利权)人: | 江苏集萃微纳自动化系统与装备技术研究所有限公司 |
主分类号: | H01L27/112 | 分类号: | H01L27/112 |
代理公司: | 苏州市中南伟业知识产权代理事务所(普通合伙) 32257 | 代理人: | 徐洋洋 |
地址: | 215100 江苏省苏州市相*** | 国省代码: | 江苏;32 |
权利要求书: | 查看更多 | 说明书: | 查看更多 |
摘要: | 本发明公开了一种单层多晶结构EEPROM,包括P型硅基材、均设置在P型硅基材的第一N型阱和第二N型阱,以及耦合电容管和PMOS晶体管;耦合电容管包括第一浮栅、耦合电容端和第一栅氧化层,耦合电容端和第一栅氧化层均设置在第一N型阱上,第一浮栅设置在第一栅氧化层上;PMOS晶体管包括第二浮栅、均设置在第二N型阱上的P+源极掺杂区、P+漏极掺杂区、N+衬底掺杂区和第二栅氧化层,第二浮栅设置在第二栅氧化层上;第二浮栅通过浮栅导电连接第一浮栅。本发明的单层多晶结构EEPROM,通过改进EEPROM的结构,使之能够承受擦除时的操作电压,与此同时能够基于标准CMOS工艺生产,而不仅仅只局限于某些特定工艺,改善单层多晶结构EEPROM的兼容性,利于降低制造成本。 | ||
搜索关键词: | 浮栅 栅氧化层 多晶结构 耦合电容 单层 标准CMOS工艺 基材 漏极掺杂区 源极掺杂区 操作电压 导电连接 制造成本 掺杂区 兼容性 擦除 衬底 局限 改进 生产 | ||
【主权项】:
1.一种基于标准CMOS工艺的单层多晶结构EEPROM,其特征在于:包括,P型硅基材;第一N型阱,其设置在所述P型硅基材上;第二N型阱,其设置在所述P型硅基材上;耦合电容管,其包括第一浮栅、耦合电容端和第一栅氧化层,所述耦合电容端和第一栅氧化层均设置在所述第一N型阱上,所述第一浮栅设置在所述第一栅氧化层上;PMOS晶体管,其用作所述EEPROM的隧道管和读出管;其包括第二浮栅、P+源极掺杂区、P+漏极掺杂区、N+衬底掺杂区和第二栅氧化层;所述P+源极掺杂区、P+漏极掺杂区、N+衬底掺杂区和第二栅氧化层均设置在所述第二N型阱上,所述第二浮栅设置在第二栅氧化层上;所述第二浮栅通过浮栅导电连接所述第一浮栅。
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H01 基本电气元件
H01L 半导体器件;其他类目中不包括的电固体器件
H01L27-00 由在一个共用衬底内或其上形成的多个半导体或其他固态组件组成的器件
H01L27-01 .只包括有在一公共绝缘衬底上形成的无源薄膜或厚膜元件的器件
H01L27-02 .包括有专门适用于整流、振荡、放大或切换的半导体组件并且至少有一个电位跃变势垒或者表面势垒的;包括至少有一个跃变势垒或者表面势垒的无源集成电路单元的
H01L27-14 . 包括有对红外辐射、光、较短波长的电磁辐射或者微粒子辐射并且专门适用于把这样的辐射能转换为电能的,或适用于通过这样的辐射控制电能的半导体组件的
H01L27-15 .包括专门适用于光发射并且包括至少有一个电位跃变势垒或者表面势垒的半导体组件
H01L27-16 .包括含有或不含有不同材料结点的热电元件的;包括有热磁组件的
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