[发明专利]半导体存储装置以及存储系统有效
| 申请号： | 201810906810.1 | 申请日： | 2018-08-10 |
| 公开（公告）号： | CN110517717B | 公开（公告）日： | 2023-04-28 |
| 发明（设计）人： | 佐藤淳一;菅原昭雄 | 申请（专利权）人： | 铠侠股份有限公司 |
| 主分类号： | G11C16/10 | 分类号： | G11C16/10;G11C16/26 |
| 代理公司： | 永新专利商标代理有限公司 72002 | 代理人： | 房永峰 |
| 地址： | 日本*** | 国省代码： | 暂无信息 |
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| 摘要： | 实施方式提供在暂时中断编程动作来进行读出动作的序列中能够使性能提高的半导体存储装置以及存储系统。实施方式的半导体存储装置包括第1面以及第2面、与第1面对应设置的第1读出放大器、第1锁存电路以及第2锁存电路、与第2面对应设置的第2读出放大器、第3锁存电路以及第4锁存电路、和控制电路24。控制电路24连续从外部接收编程指令以及读出指令，将第1锁存电路的读出数据与第2锁存电路的编程数据交换，将第2锁存电路的读出数据向外部输出，在从外部接收到转送指令的情况下，将第1锁存电路的编程数据向第2锁存电路转送。 | ||
| 搜索关键词： | 半导体 存储 装置 以及 存储系统 | ||
【主权项】：
1.一种半导体存储装置，其中，具备：/n第1面以及第2面，分别包括多个存储单体；/n第1读出放大器，从上述第1面读出数据；/n第1锁存电路，能够保持由上述第1读出放大器读出的读出数据；/n第2锁存电路，能够保持从上述第1锁存电路转送的读出数据，并能够保持从外部输入的编程数据；/n第2读出放大器，从上述第2面读出数据；/n第3锁存电路，能够保持由上述第2读出放大器读出的读出数据；/n第4锁存电路，能够保持从上述第3锁存电路转送的读出数据，并能够保持从外部输入的编程数据；以及/n控制电路，控制编程动作以及读出动作，/n上述控制电路连续从外部接收第1编程指令以及读出指令，/n在上述第2锁存电路保持了与上述第1编程指令一同被输入的第1编程数据，上述第1锁存电路保持了响应于上述读出指令而读出的第1读出数据的状态下，将上述第1锁存电路的上述第1读出数据与上述第2锁存电路的上述第1编程数据交换，/n将上述第2锁存电路的上述第1读出数据向外部输出，/n在从外部接收到转送指令的情况下，将上述第1锁存电路的上述第1编程数据向上述第2锁存电路转送。/n
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