[发明专利]一种半导体器件及其制造方法在审

专利信息
申请号: 201810778082.0 申请日: 2018-07-16
公开(公告)号: CN110729245A 公开(公告)日: 2020-01-24
发明(设计)人: 周飞 申请(专利权)人: 中芯国际集成电路制造(上海)有限公司;中芯国际集成电路制造(北京)有限公司
主分类号: H01L21/8238 分类号: H01L21/8238;H01L27/092
代理公司: 11336 北京市磐华律师事务所 代理人: 董巍;高伟
地址: 201203 *** 国省代码: 上海;31
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摘要: 发明提供一种半导体器件及其制造方法,所述方法包括:提供半导体衬底,所述半导体衬底包括第一区域和第二区域,第一区域和第二区域的半导体衬底上分别形成有第一鳍片和第二鳍片,第一鳍片和第二鳍片包括交替堆叠的Si层和SiGe层;形成横跨第一鳍片的第一伪栅极以及横跨第二鳍片的第二伪栅极;在第一伪栅极两侧形成第一沟槽,在第二伪栅极两侧形成第二沟槽;去除第一沟槽的侧壁所暴露的部分SiGe层,以形成第一凹槽,去除第二沟槽的侧壁所暴露的部分SiGe层,以形成第二凹槽;形成填充第一凹槽的第一侧壁;在第一沟槽中形成第一应力层。本发明提供的半导体器件及其制造方法,能够减小栅极与应力层之间的寄生电容,并提高半导体器件的性能。
搜索关键词: 鳍片 伪栅极 半导体器件 衬底 半导体 第二区域 第一区域 应力层 侧壁 去除 横跨 第一侧壁 寄生电容 交替堆叠 暴露 减小 填充 制造
【主权项】:
1.一种半导体器件的制造方法,其特征在于,所述方法包括:/n提供半导体衬底,所述半导体衬底包括第一区域和第二区域,所述第一区域和所述第二区域的所述半导体衬底上分别形成有第一鳍片和第二鳍片,所述第一鳍片和所述第二鳍片包括交替堆叠的Si层和SiGe层;/n形成横跨所述第一鳍片的第一伪栅极以及横跨所述第二鳍片的第二伪栅极;/n在所述第一伪栅极两侧的所述第一鳍片中形成第一沟槽,以及在所述第二伪栅极两侧的所述第二鳍片中形成第二沟槽;/n去除所述第一沟槽的侧壁所暴露的部分SiGe层,以形成第一凹槽,以及去除所述第二沟槽的侧壁所暴露的部分SiGe层,以形成第二凹槽;/n形成填充所述第一凹槽的第一侧壁;/n在所述第一沟槽中形成第一应力层。/n
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