[发明专利]用于神经网络的运算装置、芯片、设备及相关方法在审
申请号: | 201780013391.2 | 申请日: | 2017-11-30 |
公开(公告)号: | CN108701015A | 公开(公告)日: | 2018-10-23 |
发明(设计)人: | 韩峰;李鹏;谷骞 | 申请(专利权)人: | 深圳市大疆创新科技有限公司 |
主分类号: | G06F7/52 | 分类号: | G06F7/52;G06N3/04 |
代理公司: | 北京龙双利达知识产权代理有限公司 11329 | 代理人: | 王龙华;毛威 |
地址: | 518057 广东省深圳市南山区高*** | 国省代码: | 广东;44 |
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摘要: | 提供一种用于神经网络的运算装置、芯片与设备,所述运算装置包括:控制单元与乘累加单元组,该乘累加单元组包括滤波器寄存器与多个计算单元,该滤波器寄存器与该多个计算单元连接;该控制单元用于,生成控制信息,并向该计算单元发送该控制信息;该滤波器寄存器用于,缓存待进行乘累加运算的滤波器权重值;该计算单元用于,缓存待进行乘累加运算的输入特征值,根据接收的该控制信息对该滤波器权重值与该输入特征值进行乘累加运算。通过一个控制单元控制所有的计算单元,可以降低控制单元的设计复杂度;通过多个计算单元共用一个滤波器寄存器,可以减少所需的缓存大小。 | ||
搜索关键词: | 计算单元 滤波器寄存器 缓存 乘累加运算 运算装置 乘累加单元 滤波器权重 控制信息 神经网络 芯片 设计复杂度 生成控制 发送 | ||
【主权项】:
1.一种用于神经网络的运算装置,其特征在于,包括:控制单元与乘累加单元组,所述乘累加单元组包括滤波器寄存器与多个计算单元,所述滤波器寄存器与所述多个计算单元连接;所述控制单元用于,生成控制信息,并向所述计算单元发送所述控制信息;所述滤波器寄存器用于,缓存待进行乘累加运算的滤波器权重值;所述计算单元用于,缓存待进行乘累加运算的输入特征值,根据接收的所述控制信息对所述滤波器权重值与所述输入特征值进行乘累加运算。
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- 闫鑫;杨靓;冯春阳;周泉;高向强 - 中国航天科技集团公司第九研究院第七七一研究所
- 2014-10-14 - 2015-03-11 - G06F7/52
- 本发明提供了一种利用定点乘法器进行级联乘累加运算的装置和方法,将所述32位有符号定点乘法器内部划分为4个17位有符号定点乘法器,通过译码单元产生的使能信号控制17位有符号定点乘法器输入操作数,32位有符号定点乘法器能够执行定乘法计算和级联乘累加中乘法运算部分;将所述32位有符号定点乘法器与匹配乘累加单元按照一定规则组织成阵列形式,能够很好地实现级联乘累加运算。本发明提高了灵活性,节约了硬件资源,而且能够很好地实现大量数据的并行和流水计算,获得更好的实时性能和资源利用率。
- 一种乘除法器-201420548842.6
- 严伟;杨维;张文荣;陆健;王成;王鹏;沈骅 - 上海晟矽微电子股份有限公司;北京大学软件与微电子学院无锡产学研合作教育基地
- 2014-09-23 - 2015-02-04 - G06F7/52
- 本实用新型公开一种乘除法器,用于实现任意位数无符号或有符号数除法运算和任意位数的无符号乘法运算,该乘除法器包括:一数据预处理器,该数据预处理器与一第一、第二操作数、一乘除法运算选择信号以及一除法模式选择信号连接,根据该一乘除法运算选择信号以及一除法模式选择信号对该第一、第二操作数进行处理;一迭代运算单元用于根据该乘除法运算选择信号,进行余数补零及除数移位,或者进行乘数移位及被乘数扩展;一除法运算单元,用于生成一两位商和一余数;一乘法运算单元,用于生成一乘积结果;一运算控制计数器,用于控制该迭代运算单元的运算位数;一结果寄存器,用于存放该商、余数和/或乘积结果。
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