[发明专利]一种三维存储器及其平坦化方法有效
申请号: | 201710771687.2 | 申请日: | 2017-08-31 |
公开(公告)号: | CN107578996B | 公开(公告)日: | 2019-02-22 |
发明(设计)人: | 周成;赵治国;袁彬;龚睿;唐兆云;夏志良;霍宗亮 | 申请(专利权)人: | 长江存储科技有限责任公司 |
主分类号: | H01L21/306 | 分类号: | H01L21/306;H01L27/11551;H01L27/11578 |
代理公司: | 北京集佳知识产权代理有限公司 11227 | 代理人: | 李婷婷;王宝筠 |
地址: | 430074 湖北省武汉市东湖*** | 国省代码: | 湖北;42 |
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摘要: | 本申请涉及一种三维存储器及其平坦化方法,在平坦化步骤之前,通过氧化层厚度控制,以及在空旷区域和外围区域增加设置与核心区域的第一阻挡层齐平的第二阻挡层,由于阻挡层的去除速度要比氧化层的去除速度慢,因此,一方面,阻挡层可以保护核心区域的叠层结构,避免现有技术中由于过量研磨造成的影响,提高三维存储器整体工艺均匀性,提高良率;另一方面,阻挡层能够对外围区域和空旷区域进行保护,避免出现凹陷。同时,由于器件的核心区域、空旷区域和外围区域的大部分均被阻挡层保护,只有外围区域和空旷区域的交界区域以及台阶区域的凸起被平坦化,从而使得平坦化时间大大缩短,提高了器件制作效率。 | ||
搜索关键词: | 一种 三维 存储器 及其 平坦 方法 | ||
【主权项】:
1.一种三维存储器平坦化方法,其特征在于,应用于三维存储器的制作,所述三维存储器包括衬底,所述衬底分为核心区域和包围所述核心区域的外围区域,以及位于所述外围区域和所述核心区域之间,沿所述外围区域指向所述核心区域方向依次设置的空旷区域和台阶区域;所述台阶区域衬底上形成有台阶结构;所述核心区域衬底上形成有包括第一子叠层和第二子叠层交叉层叠的叠层结构,且所述叠层结构背离所述衬底的表面为第一阻挡层;所述三维存储器平坦化方法包括:在所述衬底的外围区域、空旷区域、台阶区域和核心区域沉积氧化层,使所述空旷区域的氧化层背离所述衬底的表面与所述第一阻挡层朝向所述衬底的表面齐平;去除部分所述外围区域的氧化层,使所述外围区域的去除部分氧化层后背离所述衬底的表面与所述空旷区域的氧化层背离所述衬底的表面齐平;在所述衬底的外围区域、空旷区域、台阶区域和核心区域上的氧化层上形成第二阻挡层;去除所述核心区域的第二阻挡层以及所述核心区域的氧化层;进行第一次平坦化,使所述外围区域、所述空旷区域、所述台阶区域和所述核心区域的表面齐平至所述空旷区域的第二阻挡层背离所述衬底的表面;去除所述外围区域的第二阻挡层、所述空旷区域的第二阻挡层和所述核心区域的第一阻挡层;进行第二次平坦化,使所述外围区域、所述台阶区域和所述核心区域的表面齐平所述空旷区域氧化层背离所述衬底的表面。
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H01 基本电气元件
H01L 半导体器件;其他类目中不包括的电固体器件
H01L21-00 专门适用于制造或处理半导体或固体器件或其部件的方法或设备
H01L21-02 .半导体器件或其部件的制造或处理
H01L21-64 .非专门适用于包含在H01L 31/00至H01L 51/00各组的单个器件所使用的除半导体器件之外的固体器件或其部件的制造或处理
H01L21-66 .在制造或处理过程中的测试或测量
H01L21-67 .专门适用于在制造或处理过程中处理半导体或电固体器件的装置;专门适合于在半导体或电固体器件或部件的制造或处理过程中处理晶片的装置
H01L21-70 .由在一共用基片内或其上形成的多个固态组件或集成电路组成的器件或其部件的制造或处理;集成电路器件或其特殊部件的制造
H01L 半导体器件;其他类目中不包括的电固体器件
H01L21-00 专门适用于制造或处理半导体或固体器件或其部件的方法或设备
H01L21-02 .半导体器件或其部件的制造或处理
H01L21-64 .非专门适用于包含在H01L 31/00至H01L 51/00各组的单个器件所使用的除半导体器件之外的固体器件或其部件的制造或处理
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H01L21-67 .专门适用于在制造或处理过程中处理半导体或电固体器件的装置;专门适合于在半导体或电固体器件或部件的制造或处理过程中处理晶片的装置
H01L21-70 .由在一共用基片内或其上形成的多个固态组件或集成电路组成的器件或其部件的制造或处理;集成电路器件或其特殊部件的制造