[发明专利]一种存储单元的制作方法有效
申请号: | 201611065246.2 | 申请日: | 2016-11-28 |
公开(公告)号: | CN106783865B | 公开(公告)日: | 2019-02-15 |
发明(设计)人: | 罗清威;周俊 | 申请(专利权)人: | 武汉新芯集成电路制造有限公司 |
主分类号: | H01L27/11517 | 分类号: | H01L27/11517;H01L27/11521;H01L27/11551;H01L27/115 |
代理公司: | 上海申新律师事务所 31272 | 代理人: | 俞涤炯 |
地址: | 430205 湖北*** | 国省代码: | 湖北;42 |
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摘要: | 本发明提供一种存储单元的制作方法,属于半导体制造技术领域,包括:提供一定义有栅极预制备区及源漏预制备区的半导体衬底并于半导体衬底表面依次形成一浮栅隧穿氧化层、一浮栅多晶硅层以及一浮栅二氧化硅层;于栅极预制备区上方的浮栅二氧化硅层形成一第一凹槽;去除浮栅二氧化硅层,且于栅极预制备区上方的浮栅多晶硅层形成一第二凹槽;在浮栅多晶硅层上方沉积一ONO层;于ONO层表面形成一控制栅层;去除源漏预制备区上方的控制栅层、ONO层以及浮栅多晶硅层;于源漏预制备区实施离子注入工艺后进行退火处理以形成源漏极。本发明的有益效果:提高浮栅与控制栅的接触面积,提高浮栅与控制栅的耦合率,从而提高存储单元的写入和擦除效率。 | ||
搜索关键词: | 一种 存储 单元 制作方法 | ||
【主权项】:
1.一种存储单元的制作方法,其特征在于,所述方法包括:步骤S1、提供一定义有栅极预制备区及源漏预制备区的半导体衬底,并于所述半导体衬底表面依次形成一浮栅隧穿氧化层、一浮栅多晶硅层以及一浮栅二氧化硅层;步骤S2、于所述栅极预制备区上方的所述浮栅二氧化硅层形成一第一凹槽;步骤S3、去除所述浮栅二氧化硅层,且于所述栅极预制备区上方的所述浮栅多晶硅层形成一第二凹槽;步骤S4、在所述浮栅多晶硅层上方沉积一ONO层,使所述ONO层覆盖所述浮栅多晶硅层表面以及所述第二凹槽的槽壁及槽底;步骤S5、于所述ONO层表面形成一控制栅层,并使所述控制栅层填充所述第二凹槽;步骤S6、去除所述源漏预制备区上方的所述控制栅层、所述ONO层以及所述浮栅多晶硅层;步骤S7、于所述源漏预制备区实施离子注入工艺后进行退火处理以形成源漏极。
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H01 基本电气元件
H01L 半导体器件;其他类目中不包括的电固体器件
H01L27-00 由在一个共用衬底内或其上形成的多个半导体或其他固态组件组成的器件
H01L27-01 .只包括有在一公共绝缘衬底上形成的无源薄膜或厚膜元件的器件
H01L27-02 .包括有专门适用于整流、振荡、放大或切换的半导体组件并且至少有一个电位跃变势垒或者表面势垒的;包括至少有一个跃变势垒或者表面势垒的无源集成电路单元的
H01L27-14 . 包括有对红外辐射、光、较短波长的电磁辐射或者微粒子辐射并且专门适用于把这样的辐射能转换为电能的,或适用于通过这样的辐射控制电能的半导体组件的
H01L27-15 .包括专门适用于光发射并且包括至少有一个电位跃变势垒或者表面势垒的半导体组件
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