[发明专利]闪存器件的制造方法有效
申请号: | 201610264764.0 | 申请日: | 2016-04-26 |
公开(公告)号: | CN105679713B | 公开(公告)日: | 2018-07-27 |
发明(设计)人: | 徐涛;曹子贵;王卉;陈宏 | 申请(专利权)人: | 上海华虹宏力半导体制造有限公司 |
主分类号: | H01L27/11521 | 分类号: | H01L27/11521;H01L29/788;H01L29/423 |
代理公司: | 北京集佳知识产权代理有限公司 11227 | 代理人: | 高静;吴敏 |
地址: | 201203 上海市浦东*** | 国省代码: | 上海;31 |
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摘要: | 一种闪存器件的制造方法,包括:图形化硬掩膜层形成贯穿所述硬掩膜层厚度的开口;采用第一刻蚀工艺刻蚀去除位于所述开口下方的第一厚度的浮栅层,其中,依据进行所述第一刻蚀工艺前位于开口下方的浮栅层的初始厚度,确定所述第一刻蚀工艺的刻蚀时长,使得所述第一刻蚀工艺完成后的浮栅层的厚度为固定值;在进行所述第一刻蚀工艺之后,采用第二刻蚀工艺刻蚀去除第二厚度的浮栅层,且还刻蚀去除位于硬掩膜层下方的部分浮栅层,在所述硬掩膜层下方形成浮栅尖端区域,其中,所述第二刻蚀工艺的刻蚀时长为固定时长。本发明提高了形成的浮栅尖端形貌稳定性,使得制造的闪存器件良率得到改善。 | ||
搜索关键词: | 闪存 器件 制造 方法 | ||
【主权项】:
1.一种闪存器件的制造方法,其特征在于,所述制造方法以lot为单位或者以wafer为单位进行,包括:提供基底、位于基底上的耦合氧化层、以及位于所述耦合氧化层上的浮栅层;在所述浮栅层上形成硬掩膜层;图形化所述硬掩膜层形成贯穿所述硬掩膜层厚度的开口;采用第一刻蚀工艺刻蚀去除位于所述开口下方的第一厚度的浮栅层,其中,依据进行所述第一刻蚀工艺前位于开口下方的浮栅层的初始厚度,确定所述第一刻蚀工艺的刻蚀时长,使得第一刻蚀工艺完成后位于所述开口下方的浮栅层的厚度为固定值,且在第一刻蚀工艺完成后,各lot中的开口下方的浮栅层的厚度相等,或者,各wafer中的开口下方的浮栅层的厚度相等;在进行所述第一刻蚀工艺之后,采用第二刻蚀工艺刻蚀去除第二厚度的浮栅层,且还刻蚀去除位于硬掩膜层下方的部分浮栅层,在所述浮栅层内形成浮栅尖端区域,其中,所述第二刻蚀工艺的刻蚀时长为固定时长;刻蚀去除所述硬掩膜层,露出所述浮栅层;刻蚀所述露出的浮栅层直至露出耦合氧化层,在所述浮栅尖端区域所在的位置形成浮栅尖端。
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H01 基本电气元件
H01L 半导体器件;其他类目中不包括的电固体器件
H01L27-00 由在一个共用衬底内或其上形成的多个半导体或其他固态组件组成的器件
H01L27-01 .只包括有在一公共绝缘衬底上形成的无源薄膜或厚膜元件的器件
H01L27-02 .包括有专门适用于整流、振荡、放大或切换的半导体组件并且至少有一个电位跃变势垒或者表面势垒的;包括至少有一个跃变势垒或者表面势垒的无源集成电路单元的
H01L27-14 . 包括有对红外辐射、光、较短波长的电磁辐射或者微粒子辐射并且专门适用于把这样的辐射能转换为电能的,或适用于通过这样的辐射控制电能的半导体组件的
H01L27-15 .包括专门适用于光发射并且包括至少有一个电位跃变势垒或者表面势垒的半导体组件
H01L27-16 .包括含有或不含有不同材料结点的热电元件的;包括有热磁组件的
H01L 半导体器件;其他类目中不包括的电固体器件
H01L27-00 由在一个共用衬底内或其上形成的多个半导体或其他固态组件组成的器件
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