[发明专利]MOSFET及其制造方法有效
| 申请号： | 201110178387.6 | 申请日： | 2011-06-29 |
| 公开（公告）号： | CN102856201A | 公开（公告）日： | 2013-01-02 |
| 发明（设计）人： | 朱慧珑;梁擎擎;尹海洲;骆志炯 | 申请（专利权）人： | 中国科学院微电子研究所 |
| 主分类号： | H01L21/336 | 分类号： | H01L21/336;H01L21/28;H01L29/78;H01L29/06;H01L29/423 |
| 代理公司： | 中科专利商标代理有限责任公司 11021 | 代理人： | 王波波 |
| 地址： | 100029 *** | 国省代码： | 北京;11 |
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| 摘要： | 本申请提供了一种MOSFET及其制造方法，该MOSFET包括：半导体衬底；半导体衬底上的第一绝缘埋层；在第一绝缘埋层上的第一半导体层中形成的背栅；第一半导体层上的第二绝缘埋层；在第二绝缘埋层上的第二半导体层中形成的源/漏区；第二半导体层上的栅极；以及源/漏区、栅极和背栅的电连接，其中，背栅仅位于源/漏区中的一个及沟道区下方，而没有位于源/漏区中的另一个下方，所述电连接包括背栅和源/漏区中的所述一个的公共的导电通道。该MOSFET利用非对称的背栅改善了抑制短沟道效应的效果，并且利用公共的导电通道减小了芯片占用面积。 | ||
| 搜索关键词： | mosfet 及其 制造 方法 | ||
【主权项】：
一种MOSFET的制造方法，包括：提供SOI晶片，从下至上依次包括半导体衬底、第一绝缘埋层、第一半导体层、第二绝缘埋层和第二半导体层；在第一半导体层中形成背栅；在第二半导体层中形成源/漏区；在第二半导体层上形成栅极；以及提供源/漏区、栅极和背栅的电连接，其中，背栅仅位于源/漏区中的一个及沟道区下方，而没有位于源/漏区中的另一个下方，并且提供电连接包括提供背栅和源/漏区中的所述一个的公共的导电通道。
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H01 基本电气元件
H01L 半导体器件；其他类目中不包括的电固体器件
H01L21-00 专门适用于制造或处理半导体或固体器件或其部件的方法或设备
H01L21-02 .半导体器件或其部件的制造或处理
H01L21-64 .非专门适用于包含在H01L 31/00至H01L 51/00各组的单个器件所使用的除半导体器件之外的固体器件或其部件的制造或处理
H01L21-66 .在制造或处理过程中的测试或测量
H01L21-67 .专门适用于在制造或处理过程中处理半导体或电固体器件的装置；专门适合于在半导体或电固体器件或部件的制造或处理过程中处理晶片的装置
H01L21-70 .由在一共用基片内或其上形成的多个固态组件或集成电路组成的器件或其部件的制造或处理；集成电路器件或其特殊部件的制造
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