[发明专利]三维存储器及其制备方法有效
申请号: | 202110658911.3 | 申请日: | 2021-06-15 |
公开(公告)号: | CN113410250B | 公开(公告)日: | 2022-09-02 |
发明(设计)人: | 赵婷婷;张坤;周文犀 | 申请(专利权)人: | 长江存储科技有限责任公司 |
主分类号: | H01L27/1157 | 分类号: | H01L27/1157;H01L27/11582 |
代理公司: | 北京英思普睿知识产权代理有限公司 16018 | 代理人: | 刘莹;聂国斌 |
地址: | 430000 湖北省武*** | 国省代码: | 湖北;42 |
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摘要: | |||
搜索关键词: | 三维 存储器 及其 制备 方法 | ||
1.一种三维存储器的制备方法,其特征在于,所述方法包括:
在衬底上形成包括交替堆叠的电介质层和牺牲层的叠层结构;
形成贯穿所述叠层结构并延伸至所述衬底的栅线缝隙;
对所述栅线缝隙进行填充,以形成填充层;
去除位于所述栅线缝隙顶部的填充层,以形成沟槽;以及
在所述叠层结构远离所述衬底的一侧以及所述沟槽中沉积保护层,其中所述保护层的材料为绝缘材料。
2.根据权利要求1所述的方法,其特征在于,对所述栅线缝隙进行填充,以形成填充层之前还包括:
在所述栅线缝隙内壁上形成阻隔层。
3.根据权利要求1所述的方法,其特征在于,在所述叠层结构远离所述衬底的一侧以及所述沟槽中沉积保护层之后还包括:
对所述保护层进行平坦化处理。
4.根据权利要求1所述的方法,其特征在于,在所述叠层结构远离所述衬底的一侧以及所述沟槽中沉积保护层之后还包括:
对所述叠层结构进行热处理。
5.根据权利要求1所述的方法,其特征在于,对所述栅线缝隙进行填充,以形成填充层之前还包括:
经由所述栅线缝隙将所述牺牲层置换为栅极层。
6.根据权利要求5所述的方法,其特征在于,经由所述栅线缝隙将所述牺牲层置换为栅极层包括:
经由所述栅线缝隙去除所述牺牲层,以形成牺牲间隙;
在所述栅线缝隙侧壁以及所述牺牲间隙内壁上形成绝缘层;
在所述牺牲间隙内填充导电材料,以形成所述栅极层。
7.根据权利要求6所述的方法,其特征在于,在所述栅线缝隙侧壁以及所述牺牲间隙内壁上形成绝缘层包括:
在所述栅线缝隙侧壁以及所述牺牲间隙内壁上依次形成阻挡层和粘合层;以及
去除所述栅线缝隙侧壁上的所述粘合层。
8.根据权利要求1所述的方法,其特征在于,形成贯穿所述叠层结构并延伸至所述衬底的栅线缝隙之前,所述方法还包括:
形成贯穿所述叠层结构并延伸至所述衬底的沟道孔;以及
在所述沟道孔的内壁上依次形成功能层和沟道层,并在所述沟道孔内填充绝缘材料,以形成沟道结构。
9.一种三维存储器,其特征在于,包括:
衬底;
叠层结构,位于所述衬底上,包括交替堆叠的电介质层和栅极层;
贯穿所述叠层结构的栅线缝隙,所述栅线缝隙内的底部设置有填充层;以及
保护层,位于所述叠层结构远离所述衬底的一侧上并填充所述栅线缝隙的剩余部分,并且至少覆盖部分所述叠层结构,其中所述保护层的材料为绝缘材料。
10.根据权利要求9所述的三维存储器,其特征在于,所述栅极层包括位于芯部的导电层以及依次至少部分围绕所述导电层的粘合层和阻挡层。
11.根据权利要求9所述的三维存储器,其特征在于,还包括:
沟道结构,贯穿所述叠层结构并与所述衬底接触,包括绝缘芯部以及依次围绕所述绝缘芯部的沟道层和功能层。
12.一种存储系统,包括控制器和如权利要求9至11中任意一项所述的三维存储器,控制器耦合至所述三维存储器,并控制所述三维存储器存储数据。
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H01L 半导体器件;其他类目中不包括的电固体器件
H01L27-00 由在一个共用衬底内或其上形成的多个半导体或其他固态组件组成的器件
H01L27-01 .只包括有在一公共绝缘衬底上形成的无源薄膜或厚膜元件的器件
H01L27-02 .包括有专门适用于整流、振荡、放大或切换的半导体组件并且至少有一个电位跃变势垒或者表面势垒的;包括至少有一个跃变势垒或者表面势垒的无源集成电路单元的
H01L27-14 . 包括有对红外辐射、光、较短波长的电磁辐射或者微粒子辐射并且专门适用于把这样的辐射能转换为电能的,或适用于通过这样的辐射控制电能的半导体组件的
H01L27-15 .包括专门适用于光发射并且包括至少有一个电位跃变势垒或者表面势垒的半导体组件
H01L27-16 .包括含有或不含有不同材料结点的热电元件的;包括有热磁组件的