[发明专利]半导体功率器件的制造方法及半导体功率器件在审
申请号: | 201911194101.6 | 申请日: | 2019-11-28 |
公开(公告)号: | CN112864019A | 公开(公告)日: | 2021-05-28 |
发明(设计)人: | 龚轶;毛振东;刘伟;袁愿林;王鑫 | 申请(专利权)人: | 苏州东微半导体股份有限公司 |
主分类号: | H01L21/336 | 分类号: | H01L21/336;H01L21/28;H01L29/423;H01L29/78 |
代理公司: | 北京品源专利代理有限公司 11332 | 代理人: | 孟金喆 |
地址: | 215123 江苏省苏州市苏州工业园区*** | 国省代码: | 江苏;32 |
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摘要: | |||
搜索关键词: | 半导体 功率 器件 制造 方法 | ||
1.半导体功率器件的制造方法,其特征在于,包括:
提供一半导体衬底;
在所述半导体衬底上形成硬掩膜层,并在所述硬掩膜层中形成开口;
以所述硬掩膜层为掩膜对所述半导体衬底进行刻蚀,在所述半导体衬底内形成第一沟槽,所述第一沟槽的宽度大于所述硬掩膜层中的开口的宽度;
在所述第一沟槽的表面形成栅氧化层;
淀积第一层多晶硅并以所述硬掩膜层为掩膜对所述第一层多晶硅进行回刻,在所述第一沟槽的侧壁处形成栅极;
以所述硬掩膜层为掩膜对所述栅氧化层和所述半导体衬底进行刻蚀,在所述半导体衬底内形成第二沟槽,所述第二沟槽位于所述第一沟槽下方;
淀积一层氮化硅并回刻,在所述第一沟槽和所述第二沟槽内形成氮化硅侧墙;
以所述硬掩膜层和所述氮化硅侧墙为掩膜对所述半导体衬底进行刻蚀,在所述半导体衬底内形成第三沟槽,所述第三沟槽位于所述第二沟槽下方;
进行热氧化,在所述第三沟槽的表面形成第一场氧化层;
淀积形成第二场氧化层,所述第二氧化层和所述第一氧化层共同构成半导体功率器件的场氧化层;
淀积第二层多晶硅并回刻,在所述第三沟槽、第二沟槽和第一沟槽内形成屏蔽栅。
2.如权利要求1所述的半导体功率器件的制造方法,其特征在于,在形成所述第一场氧化层后,先刻蚀掉所述氮化硅侧墙,再淀积形成所述第二场氧化层。
3.如权利要求1所述的半导体功率器件的制造方法,其特征在于,在刻蚀形成所述第三沟槽时,通过增加横向的刻蚀,使得第三沟槽的宽度大于所述第二沟槽的宽度。
4.如权利要求1所述的半导体功率器件的制造方法制造的半导体功率器件,其特征在于,包括:
n型漏区;
位于所述n型漏区之上的n型漂移区;
凹陷在所述n漂移区中的栅沟槽,所述栅沟槽自上而下包括栅沟槽上部、栅沟槽中部和栅沟槽下部三部分;
位于所述n型漂移区内且位于所述栅沟槽上部的两侧的p型体区;
位于所述p型体区内的n型源区;
位于所述栅沟槽上部的侧壁处的栅极,所述栅极通过栅氧化层与所述p型体区隔离;
位于所述栅沟槽下部内的屏蔽栅,所述屏蔽栅自下而上延伸至所述栅沟槽上部内,所述屏蔽栅通过场氧化层与所述n型漂移区和所述栅极隔离。
5.如权利要求4所述的半导体功率器件,其特征在于,所述栅沟槽上部的宽度大于所述栅沟槽中部的宽度。
6.如权利要求4所述的半导体功率器件,其特征在于,所述栅沟槽下部的宽度大于所述栅沟槽中部的宽度。
7.如权利要求4所述的半导体功率器件,其特征在于,所述栅沟槽下部内的场氧化层的厚度大于所述栅沟槽上部和所述栅沟槽中部内的场氧化层的厚度。
8.如权利要求4所述的半导体功率器件,其特征在于,还包括位于所述栅沟槽上部和所述栅沟槽中部内的氮化硅侧墙,所述氮化硅侧墙在所述栅沟槽上部内将所述场氧化层于所述栅极隔离,所述氮化硅侧墙在所述栅沟槽中部内将所述场氧化层与所述n型漂移区隔离。
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H01L 半导体器件;其他类目中不包括的电固体器件
H01L21-00 专门适用于制造或处理半导体或固体器件或其部件的方法或设备
H01L21-02 .半导体器件或其部件的制造或处理
H01L21-64 .非专门适用于包含在H01L 31/00至H01L 51/00各组的单个器件所使用的除半导体器件之外的固体器件或其部件的制造或处理
H01L21-66 .在制造或处理过程中的测试或测量
H01L21-67 .专门适用于在制造或处理过程中处理半导体或电固体器件的装置;专门适合于在半导体或电固体器件或部件的制造或处理过程中处理晶片的装置
H01L21-70 .由在一共用基片内或其上形成的多个固态组件或集成电路组成的器件或其部件的制造或处理;集成电路器件或其特殊部件的制造