[发明专利]编程效率增强的一次性可编程存储器件及其制造方法在审
| 申请号: | 201910111476.5 | 申请日: | 2019-02-12 |
| 公开(公告)号: | CN110190060A | 公开(公告)日: | 2019-08-30 |
| 发明(设计)人: | 崔光一 | 申请(专利权)人: | 爱思开海力士系统集成电路有限公司 |
| 主分类号: | H01L27/11524 | 分类号: | H01L27/11524;H01L27/11529;H01L27/11531 |
| 代理公司: | 北京弘权知识产权代理事务所(普通合伙) 11363 | 代理人: | 许伟群;郭放 |
| 地址: | 韩国忠*** | 国省代码: | 韩国;KR |
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| 摘要: | |||
| 搜索关键词: | 沟道区 存储晶体管 浮置栅极 结区 一次性可编程存储器件 选择晶体管 编程效率 多个单位 重叠区域 源极区 沟道 选择栅极结构 一次性可编程 串联耦接 存储器件 单位单元 交叉点处 漏极区 位线 字线 制造 申请 | ||
1.一种一次性可编程OTP存储器件,包括多个单位单元,所述多个单位单元分别位于分别设置在多个行中的字线与分别设置在多个列中的位线的交叉点处,其中,所述多个单位单元中的每一个单位单元包括:
选择晶体管,其包括通过第一沟道区将彼此分开的漏极区和公共结区,以及设置在所述第一沟道区之上的选择栅极结构;以及
存储晶体管,其包括通过第二沟道区将彼此分开的源极区和公共结区,以及设置在所述第二沟道区之上的浮置栅极结构,
其中,所述漏极区耦接到所述位线中的任何一个位线,
其中,所述源极区耦接到公共源极线,以及
其中,所述源极区和所述浮置栅极结构之间的重叠区域在所述存储晶体管的沟道长度方向上的长度小于所述公共结区和所述浮置栅极结构之间的重叠区域在所述存储晶体管的沟道长度方向上的长度。
2.根据权利要求1所述的OTP存储器件,其中,所述选择晶体管和所述存储晶体管包括P沟道MOS晶体管结构。
3.根据权利要求1所述的OTP存储器件,其中,所述漏极区和所述公共结区包括P型杂质浓度,所述P型杂质浓度高于所述源极区的P型杂质浓度。
4.根据权利要求3所述的OTP存储器件,还包括N型阱区,所述N型阱区包围所述漏极区、所述公共结区和所述源极区所有的底表面和侧表面。
5.根据权利要求1所述的OTP存储器件,其中,所述公共结区和所述源极区中的每一个包括单结结构。
6.根据权利要求1所述的OTP存储器件,其中,所述源极区的结深度小于所述公共结区的结深度。
7.根据权利要求1所述的OTP存储器件,
其中,所述选择栅极结构包括设置在所述第一沟道区之上的第一栅极绝缘层和设置在所述第一栅极绝缘层之上并耦接到所述字线中的一个字线的选择栅极电极;以及
其中,所述浮置栅极结构包括设置在所述第二沟道区之上的第二栅极绝缘层和设置在所述第二栅极绝缘层之上的浮置栅极。
8.根据权利要求7所述的OTP存储器件,
其中,所述选择晶体管和所述存储晶体管包括P沟道MOS晶体管结构;以及
其中,如果所述字线中的一个字线和所述公共源极线被接地并且正编程电压被施加至所述位线中的一个位线,则所述OTP存储器件执行从所述多个单位单元中选中的一个单位单元的编程操作。
9.根据权利要求7所述的OTP存储器件,
其中,所述选择晶体管和所述存储晶体管包括P沟道MOS晶体管结构;以及
其中,如果所述字线中的一个字线和所述公共源极线被接地并且正读取电压被施加至所述位线中的一个位线,则所述OTP存储器件执行从所述多个单位单元中选中的一个单位单元的读取操作。
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H01L 半导体器件;其他类目中不包括的电固体器件
H01L27-00 由在一个共用衬底内或其上形成的多个半导体或其他固态组件组成的器件
H01L27-01 .只包括有在一公共绝缘衬底上形成的无源薄膜或厚膜元件的器件
H01L27-02 .包括有专门适用于整流、振荡、放大或切换的半导体组件并且至少有一个电位跃变势垒或者表面势垒的;包括至少有一个跃变势垒或者表面势垒的无源集成电路单元的
H01L27-14 . 包括有对红外辐射、光、较短波长的电磁辐射或者微粒子辐射并且专门适用于把这样的辐射能转换为电能的,或适用于通过这样的辐射控制电能的半导体组件的
H01L27-15 .包括专门适用于光发射并且包括至少有一个电位跃变势垒或者表面势垒的半导体组件
H01L27-16 .包括含有或不含有不同材料结点的热电元件的;包括有热磁组件的





