[发明专利]一种非易失性3D NAND存储器的侧墙栅电极及其制备方法有效
申请号: | 201910001801.2 | 申请日: | 2019-01-02 |
公开(公告)号: | CN109830432B | 公开(公告)日: | 2020-11-24 |
发明(设计)人: | 缪向水;杨哲;童浩 | 申请(专利权)人: | 华中科技大学 |
主分类号: | H01L21/28 | 分类号: | H01L21/28;H01L27/11524;H01L27/1157 |
代理公司: | 华中科技大学专利中心 42201 | 代理人: | 曹葆青;李智 |
地址: | 430074 湖北*** | 国省代码: | 湖北;42 |
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摘要: | |||
搜索关键词: | 一种 非易失性 nand 存储器 侧墙栅 电极 及其 制备 方法 | ||
1.一种非易失性3D NAND存储器的侧墙栅电极的制备方法,其特征在于,包括下述步骤:
(1)制备栅电极阵列
(1.1)在已经制备好字线和位线的衬底(100)上放置多孔氧化铝模板(200),所述多孔氧化铝模板(200)的栅与所述字线对准;
(1.2)在所述多孔氧化铝模板(200)内通过电化学沉积形成n个栅电极侧墙,依次为第一栅电极侧墙(110b)、第二栅电极侧墙(111b)、……第n栅电极侧墙(11(n-1)b);所述第一栅电极侧墙(110b)、第二栅电极侧墙(111b)……第i栅电极侧墙(11(i-1)b)……以及第n栅电极侧墙(11(n-1)b)依次成阶梯状,高度由低到高;
其中i=3、4、……n;n为字线的数目,n为正整数;
(1.3)通过氢氧化钠溶液腐蚀去除所述多孔氧化铝模板(200);
(2)制备与所述第一栅电极侧墙(110b)连接的第一控制栅层(110a)
(2.1)在所述栅电极阵列上沉积绝缘层(300)至覆盖住第n栅电极侧墙(11(n-1)b),通过CMP平整所述绝缘层(300)的上表面;
(2.2)与第一条字线WL0对准进行一次光刻和刻蚀,直至裸露出第一栅电极侧墙(110b);
(2.3)在所述裸露的第一栅电极侧墙(110b)的表面沉积与第一栅电极侧墙(110b)相同的导电材料,形成与衬底(100)表面平行且与第一栅电极侧墙(110b)相连的第一控制栅层(110a);
(3)制备非易失性3D NAND存储器的侧墙栅电极
重复上述步骤,在第i层控制栅层制备完成后沉积绝缘材料至完全覆盖第n栅电极侧墙(11(n-1)b),与第i+1条字线WL(i)对准进行一次光刻和刻蚀,并在裸露第i+1栅电极侧墙(11(i)b)的上表面沉积相同的导电材料形成与之连接的第i控制栅层(11(i)a),形成了所述非易失性3D NAND存储器的侧墙栅电极。
2.如权利要求1所述的制备方法,其特征在于,第n控制栅层的制备中不用采用光刻,进行选择性刻蚀,裸露出第n栅电极侧墙,并沉积与第n栅电极侧墙相同的导电材料形成第n控制栅层。
3.如权利要求1所述的制备方法,其特征在于,所述多孔氧化铝模板的孔径为5nm~100nm,孔间距为10nm~500nm,孔深大于100nm。
4.如权利要求1所述的制备方法,其特征在于,所述绝缘材料为二氧化硅、氮化硅或氮氧化硅。
5.如权利要求1所述的制备方法,其特征在于,所述导电材料包括一种或多种导体或半导体材料。
6.一种采用权利要求1至5中任一项所述的制备方法形成的非易失性3D NAND存储器的栅电极,其特征在于,包括n个阶梯状排列的栅电极侧墙,每个栅电极为侧墙结构,所述侧墙栅电极的上表面用于连接栅层,下表面用于连接字线。
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H01L 半导体器件;其他类目中不包括的电固体器件
H01L21-00 专门适用于制造或处理半导体或固体器件或其部件的方法或设备
H01L21-02 .半导体器件或其部件的制造或处理
H01L21-64 .非专门适用于包含在H01L 31/00至H01L 51/00各组的单个器件所使用的除半导体器件之外的固体器件或其部件的制造或处理
H01L21-66 .在制造或处理过程中的测试或测量
H01L21-67 .专门适用于在制造或处理过程中处理半导体或电固体器件的装置;专门适合于在半导体或电固体器件或部件的制造或处理过程中处理晶片的装置
H01L21-70 .由在一共用基片内或其上形成的多个固态组件或集成电路组成的器件或其部件的制造或处理;集成电路器件或其特殊部件的制造