[发明专利]一种肖特基器件及其制备方法有效

专利信息
申请号: 201210151837.7 申请日: 2012-05-06
公开(公告)号: CN103383969B 公开(公告)日: 2017-04-26
发明(设计)人: 朱江 申请(专利权)人: 朱江
主分类号: H01L29/872 分类号: H01L29/872;H01L21/329
代理公司: 暂无信息 代理人: 暂无信息
地址: 113200 辽*** 国省代码: 辽宁;21
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摘要:
搜索关键词: 一种 肖特基 器件 及其 制备 方法
【说明书】:

技术领域

发明涉及到一种肖特基器件,本发明还涉及一种肖特基器件的制备方法。

背景技术

功率半导体器件被大量使用在电源管理和电源应用上,特别涉及到肖特基结的半导体器件已成为器件发展的重要趋势,肖特基器件具有正向开启电压低开启关断速度快等优点。

肖特基二极管可以通过多种不同的布局技术制造,最常用的为平面布局,传统的平面肖特基二极管具有较为复杂的制造工艺,需要三次光刻腐蚀工艺完成器件的生产制造。

发明内容

本发明针对上述问题提出,提供一种肖特基器件及其制备方法。

一种肖特基器件,其特征在于:包括:衬底层,为半导体材料;漂移层,为第一传导类型的半导体材料,位于衬底层之上;沟槽结构,沟槽位于器件边缘漂移层中,沟槽内壁表面有绝缘材料,临靠沟槽底部区域设置有第二传导类型半导体材料;肖特基势垒结,位于沟槽终端结构包裹的漂移层表面。一种肖特基器件的制备方法,其特征在于:包括如下步骤:在衬底层上通过外延生产形成第一传导类型的半导体材料层;在表面形成第一钝化层,在待形成沟槽区域表面去除第一钝化层;进行刻蚀半导体材料,形成沟槽;注入杂质,进行退火工艺;腐蚀去除器件表面第一钝化层;在器件表面淀积金属,进行烧结形成肖特基势垒结。

本发明的半导体器件具有沟槽结构的终端,简化了器件的制造流程,并且将结终端延伸结构引入到沟槽结构中,使得器件具有良好反向阻断特性。

附图说明

图1为本发明的一种肖特基器件剖面示意图;

其中,

1、衬底层;

2、二氧化硅;

3、第一导电半导体材料;

4、第二导电半导体材料;

5、肖特基势垒结;

10、上表面金属层;

11、下表面金属层。

具体实施方式

实施例1

图1为本发明的一种肖特基器件剖面图,下面结合图1详细说明本发明的半导体装置。

一种肖特基器件,包括:衬底层1,为N导电类型半导体硅材料,磷原子的掺杂浓度为1E19/CM3,在衬底层1下表面,通过下表面金属层11引出电极;第一导电半导体材料3,位于衬底层1之上,为N传导类型的半导体硅材料,磷原子的掺杂浓度为1E16/CM3;第二导电半导体材料4,位于沟槽底部,为P传导类型的半导体硅材料;肖特基势垒结5,位于第一导电半导体材料3的表面,为半导体硅材料与势垒金属形成的硅化物;二氧化硅2,位于沟槽内壁;器件上表面附有上表面金属层10,为器件引出另一电极。

其制作工艺包括如下步骤:

第一步,在衬底层1表面外延形成第一导电半导体材料层3;

第二步,表面淀积氮化硅,进行光刻腐蚀工艺,半导体材料表面去除部分氮化硅;

第三步,干法刻蚀,去除部分裸露半导体硅材料形成沟槽;

第四步,注入硼杂质,进行退火氧化工艺,形成第二导电半导体材料4;

第五步,腐蚀去除氮化硅;

第六步,在半导体材料表面淀积势垒金属,进行烧结形成肖特基势垒结5,然后在表面淀积金属形成上表面金属层10;

第七步,进行背面金属化工艺,在背面形成下表面金属层11,器件结构如图1所示。

通过上述实例阐述了本发明,同时也可以采用其它实例实现本发明,本发明不局限于上述具体实例,因此本发明由所附权利要求范围限定。

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