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[实用新型]远近光切换电路-CN202222224090.5有效
发明人：徐婷婷 -专利权人：常州星宇车灯股份有限公司
申请日： 2022-08-24 - 公布日： 2022-12-20 - 主分类号： B60Q1/14 文献下载
摘要：本实用新型涉及锂电池技术领域，尤其涉及一种远近光切换电路，包括：远光灯、近光灯和逻辑电路，远光灯和近光灯串联，逻辑电路和远光灯并联，逻辑电路断开时，远光灯和近光灯均被点亮，逻辑电路导通时，近光灯点亮同时远光灯熄灭本实用新型的远近光切换电路，考虑到远光灯和近光灯的电流接近，通过采用不同类型的LED可以实现远光灯和近光灯的亮度不同，远近光灯采用一路驱动电路同时驱动，采用逻辑电路的通断实现远光灯的亮灭，大大降低了电路成本
远近切换电路

[发明专利]用于功能安全应用的封装互连的处理器和芯片集连续性测试-CN201910444487.5在审
发明人： M·李;B·C·奥福尤耶;E·尤伊;J·威尔科森 -专利权人：英特尔公司
申请日： 2019-05-27 - 公布日： 2020-01-03 - 主分类号： G06F11/07 文献下载
摘要：在实施例中，分压器逻辑电路分压参考电压。控制器逻辑电路比较来自分压器逻辑电路的节点的分压电压值和阈值电压值。分压器逻辑电路的第一端被耦合以用于接收参考电压，并且分压器逻辑电路的第二端耦合至非临界功能(NCTF)焊球。控制器逻辑电路响应于分压电压值和阈值电压值之间的失配生成错误信号。
分压器控制器逻辑电路分压电压阈值电压分压接收参考电压方法和装置连续性测试参考电压错误信号功能安全耦合第一端端耦合芯片集互连处理器焊球失配封装响应应用

[发明专利]一种片间高速互联的链路层设计方法和系统-CN201510200725.X有效
发明人：李仙辉;张明懿 -专利权人：福州瑞芯微电子股份有限公司
申请日： 2015-04-24 - 公布日： 2018-06-19 - 主分类号： H04L29/08 文献下载
摘要：本发明公开一种片间高速互联的链路层设计方法和系统，所述方法应用于片间高速互联的链路层系统，所述系统包括多个芯片，所述芯片包括链路层逻辑电路和PCS层逻辑电路；所述链路层逻辑电路包括数据校验模块，协议包通道管理模块，链路层传输模块；所述PCS层逻辑电路包括链路训练模块，PCS层传输模块，接口控制模块，数据编码模块，数据解码模块，数据加扰模块和数据解扰模块；所述链路层逻辑电路与PCS层逻辑电路连接。
链路层高速互联芯片接口控制模块数据编码模块数据加扰模块数据解码模块数据解扰模块数据校验模块通道管理模块链路层传输传输模块训练模块协议包链路传输

[发明专利]产生密码钥匙排程的装置及方法-CN200510059031.5有效
发明人： G·葛兰亨利;汤玛斯A·克里斯宾;提摩西A·伊里亚德;泰瑞帕德斯 -专利权人：威盛电子股份有限公司
申请日： 2005-03-24 - 公布日： 2005-08-17 - 主分类号： H04L9/08 文献下载
摘要：在一实施例中，提供一执行密码运算的装置，而此装置是包含：一密码指令电路，其用以产生一密码指令；一钥匙产生逻辑电路；及一执行逻辑电路。钥匙产生逻辑电路是操作耦合于密码指令电路，而此钥匙产生逻辑电路指示计算装置扩展密码钥匙成对应的钥匙排程。执行逻辑电路是耦合于钥匙产生逻辑电路，此执行逻辑电路扩展密码钥匙成对应的钥匙排程。
产生密码钥匙装置方法

[发明专利]交换卡切换信息的下发方法和交换卡热备份系统-CN201110165548.8有效
发明人：程鸿博;唐仁圣;王茂松 -专利权人：迈普通信技术股份有限公司
申请日： 2011-06-14 - 公布日： 2011-11-02 - 主分类号： H04L12/56 文献下载
摘要：本发明公开了一种交换卡切换信息的下发方法及交换卡热备份系统，在交换卡热备份系统的所有交换卡上设置逻辑电路单元并由该逻辑电路单元向所有线卡输出控制信号，所有线卡上也设置逻辑电路单元并由该逻辑电路单元实时监测交换卡输出的所述控制信号状态；在发生切换事件时包括：A、主控制卡向所有交换卡发送切换命令；B、交换卡在收到正确的切换命令后，变更本交换卡逻辑电路单元输出的控制信号状态；C、所述线卡逻辑电路单元监测到交换卡逻辑电路单元输出的控制信号状态改变后，以该控制信号状态的改变作为切换信息，按照预设的控制逻辑切换上连数据通道。
交换切换信息下发方法备份系统

[发明专利]一种考虑版图布局信息的组合逻辑电路的单粒子多瞬态软错误敏感性评估方法-CN201611000399.9有效
发明人：肖立伊;曹雪兵;李杰;张荣生 -专利权人：哈尔滨工业大学
申请日： 2016-11-14 - 公布日： 2019-08-23 - 主分类号： G06F17/50 文献下载
摘要：一种考虑版图布局信息的组合逻辑电路的单粒子多瞬态软错误敏感性评估方法，涉及组合逻辑电路的软错误敏感性评估技术，为了解决现有组合逻辑电路软错误评估方法无法有效的评估单粒子多瞬态的软错误敏感性的问题。并进行Geant4蒙特卡洛仿真；步骤二、生成“黄金”网表文件以及调用快速SPICE仿真工具进行仿真；步骤三、生成错误注入网表以及调用快速SPICE仿真工具进行仿真；步骤四、根据步骤二及步骤三得到的组合逻辑电路输出端的逻辑状态，得到组合逻辑电路的失效率，根据失效率评估组合逻辑电路的单粒子多瞬态软错误敏感性。本发明适用于评估组合逻辑电路的软错误敏感性。
一种考虑版图布局信息组合逻辑电路粒子瞬态错误敏感性评估方法

[发明专利]逻辑电路的信号处理方法和装置及存储介质和处理器-CN201710139790.5有效
发明人：索娟;杨柳;李雅洁;李志刚;马斌;王天军;孙若寒;刘信;李凯;顾楠;王涛 -专利权人：国网新疆电力公司信息通信公司;国家电网公司
申请日： 2017-03-08 - 公布日： 2021-01-15 - 主分类号： H03K19/20 文献下载
摘要：本发明公开了一种逻辑电路的信号处理方法和装置及存储介质和处理器。该方法包括：获取第一DNA分子和第二DNA分子，第一DNA分子用于表征逻辑电路的第一输入信号，第二DNA分子用于表征逻辑电路的第二输入信号；获取第三DNA分子和第四DNA分子，第三DNA分子用于表征逻辑电路的第一输入信号，第四DNA分子用于表征逻辑电路的第二输入信号；对第一DNA分子或第三DNA分子，第二DNA分子或第四DNA分子进行特异性识别处理，得到输出DNA分子，其中，输出DNA分子用于表征逻辑电路对第一输入信号和第二输入信号进行逻辑运算得到的输出信号通过本发明，丰富了基于DNA的逻辑电路的处理功能。
逻辑电路信号处理方法装置存储介质处理器

[发明专利]逻辑线路的线距/线宽布局设定方法-CN200610112132.9有效
发明人：谢祥毅 -专利权人：英业达股份有限公司
申请日： 2006-08-11 - 公布日： 2008-02-13 - 主分类号： G06F17/50 文献下载
摘要：本发明涉及一种逻辑线路的线距/线宽布局设定方法，应用一逻辑电路设定文件直接产生可汇入逻辑电路软件的布局设定，其方法包含下列步骤：通过字符串比较方式查找该逻辑电路设定文件中符合一编码规则的多个线路编码；自该逻辑电路设定文件中获取对应各该线路编码的多个线距/线宽设定；根据该逻辑电路设定文件、各该线路编码及对应各该线距/线宽设定，生成具有线距/线宽设定的一第一布局设定文件；以及加载一区域限定规则调整该布局设定文件中的线距/线宽设定以生成一第二布局设定文件，以汇入逻辑电路软件中。本发明可使使用者可迅速取得线路布局设定并使用于逻辑电路软件中，大幅降低前置作业时间，并减少设定值输入错误的情形发生。
逻辑线路布局设定方法

[发明专利]流水线方式零延时提取图像锐度信息的逻辑电路及提取方法-CN201711200081.X有效
发明人：张豪;刘彤 -专利权人：中国航空工业集团公司洛阳电光设备研究所
申请日： 2017-11-27 - 公布日： 2020-01-14 - 主分类号： H04N5/232 文献下载
摘要：本发明涉及一种流水线方式零延时提取图像锐度信息的逻辑电路及提取方法，采用现场可编程门阵列(FPGA)作为图像处理的硬件实现平台，将逻辑电路划分为：像素坐标解析逻辑电路、像素值行缓冲逻辑电路、图像锐度运算触发器逻辑电路、像素级锐度运算逻辑电路、图像级锐度累加逻辑电路等5部分。利用高清视频源上叠加的时序信号，实时重建图像像素的坐标索引值，用于后续的触发控制逻辑；通过多通道缓冲队列方式，将图像数据重新分组，使后续的处理流水线化。
流水线方式延时提取图像信息逻辑电路方法

[发明专利]逻辑电路的设计方法-CN201911305046.3有效
发明人：叶乐;王志轩;黄芊芊;王阳元;黄如 -专利权人：杭州未名信科科技有限公司;浙江省北大信息技术高等研究院
申请日： 2019-12-17 - 公布日： 2023-06-20 - 主分类号： H03K19/00 文献下载
摘要：本申请公开了一种逻辑电路的设计方法、装置及存储介质，方法包括：设计并生成初始的MOSFET‑TFET混合逻辑电路；所述MOSFET‑TFET混合逻辑电路包括若干逻辑门；在所述初始的MOSFET‑TFET混合逻辑电路的串联支路中，用MOSFET替换第一类TFET；所述第一类TFET直接接地或电源且不与所述逻辑门的输出端直接连接。本申请的逻辑电路的设计方法，通过用MOSFET替换初始逻辑电路的串联支路中的第一类TFET，克服了TFET在串联支路中造成的电流衰减过大的缺陷，第一类TFET即直接接地或电源且不与逻辑门的输出端直接连接的
逻辑电路设计方法

[发明专利]超密集垂直传输FET电路-CN201780011910.1有效
发明人： B·A·安德森;E·诺瓦克;A·M·楚 -专利权人：国际商业机器公司
申请日： 2017-01-23 - 公布日： 2021-07-30 - 主分类号： H01L29/78 文献下载
摘要：公开了逻辑电路或逻辑门，包括垂直传输场效应晶体管和一个或多个有源栅极，其中该逻辑电路的CPP的数量单独地等于有源栅极的数量。逻辑电路的组件可以存在于至少三个不同的垂直电路层，包括：包括穿过向该一个或多个栅极结构(7)提供输入电压的一个导电元件和提供该逻辑电路的输出电压的另一个导电元件的水平面的一个电路层级；以及包括穿过从场效应晶体管的N输出到P输出的导电桥的水平面的另一电路层级。这种逻辑电路可以包括1‑栅极反相器、2‑栅极反相器、NOR2逻辑门和NAND3逻辑门，以及其它复杂逻辑电路。
密集垂直传输 fet 电路

[发明专利]存储器装置中的自复位时钟缓冲器-CN200980134766.6有效
发明人：郑昌镐;陈南;陈志勤 -专利权人：高通股份有限公司
申请日： 2009-09-04 - 公布日： 2011-08-03 - 主分类号： G11C7/22 文献下载
摘要：本发明提供一种包括时钟缓冲器电路的存储器装置。所述时钟缓冲器电路包括交叉耦合逻辑电路。所述交叉耦合逻辑电路具有至少两个逻辑门，其中所述逻辑门中的至少一者的输出耦合到所述逻辑门中的至少一者的输入。所述交叉耦合逻辑电路耦合到用于接受时钟信号的输入。所述存储器装置还包括时钟驱动器，其可操作以从所述交叉耦合逻辑电路的所述输出产生时钟信号。从所述时钟信号到所述交叉耦合逻辑电路的反馈环路控制所述交叉耦合逻辑电路。包括三态反相器的缓冲器电路耦合到所述时钟信号，以维持所述时钟信号同时避免与时钟产生器的争用。所述存储器装置由芯片选择信号启用。
存储器装置中的复位时钟缓冲器

[发明专利]等离子体显示面板的驱动装置、驱动方法及等离子体显示装置-CN200880025113.X有效
发明人：仓贯正明;永木敏一;井上学;阪口知久;大平一雄 -专利权人：松下电器产业株式会社
申请日： 2008-07-18 - 公布日： 2010-06-23 - 主分类号： G09G3/28 文献下载
摘要：扫描IC包括开关电路以及逻辑电路。开关电路包括第一及第二晶体管、以及电平移位电路。向逻辑电路的输入端子，提供变化为逻辑“1”及逻辑“0”的第一及第二控制信号。逻辑电路基于所提供的第一及第二控制信号，向第一晶体管提供第三控制信号，向第二晶体管提供第四控制信号。检测电路与逻辑电路的输入端子连接。利用检测电路，检测扫描IC的异常。
等离子体显示面板驱动装置方法显示装置

[发明专利]逻辑器件及构建方法、逻辑器件库、逻辑器构建方法-CN201410051547.4在审
发明人：潘龙;秦卫东;李志学;徐晓光;咸辉;夏传龙;王蕴伟;崔亚丽 -专利权人：国网河南省电力公司鹤壁供电公司;珠海许继芝电网自动化有限公司
申请日： 2014-02-14 - 公布日： 2015-08-19 - 主分类号： G06F17/50 文献下载
摘要：本发明配电网领域，具体涉及逻辑器件及构建方法、逻辑器件库、逻辑器构建方法。该逻辑器件是对一个逻辑元件的功能的逻辑表达；逻辑元件包括以下任一种：基本逻辑元件、多个基本逻辑元件的逻辑组合。逻辑器件构建方法包括：确定需要逻辑表达的逻辑元件；根据逻辑元件的功能进行逻辑表达形成准逻辑器件；对准逻辑器件进行验证；如果准逻辑器件功能与逻辑元件功能相同，则准逻辑器件为对应逻辑元件的逻辑器件。逻辑器件库包括若干逻辑器件。逻辑器构建方法包括：确定逻辑电路图；根据逻辑电路图编制调用程序；根据调用程序调取逻辑器件库的逻辑器件，形成逻辑电路图组合表达；该逻辑电路图组合表达为逻辑器。本发明能够降低复杂逻辑电路设计成本。
逻辑器件构建方法

[发明专利]一种基于单极型晶体管的输出反馈逻辑电路及芯片-CN202010560677.6有效
发明人：徐煜明;陈荣盛;吴朝晖;李斌 -专利权人：华南理工大学
申请日： 2020-06-18 - 公布日： 2021-08-06 - 主分类号： H03K19/173 文献下载
摘要：本发明公开了一种基于单极型晶体管的输出反馈逻辑电路及芯片，其中输出反馈逻辑电路包括：第一晶体管的源极与下拉单元的第一端连接，且作为输出反馈逻辑电路的输出端，输入控制开关的第一端与输出控制开关的第一端之间的连接点与第一晶体管的栅极连接；输入控制开关的控制端连接至信号输入端，输入控制开关的第二端与输出反馈逻辑电路的输出端连接；输出控制开关的控制端与输出反馈逻辑电路的输出端连接；下拉单元的控制端连接至信号输入端，下拉单元的第一端与输出反馈逻辑电路的输出端连接本发明的输出反馈逻辑电路仅由单极型晶体管组成；该输出反馈逻辑电路与传统的设计相比，电路复杂度更低，可广泛应用于半导体集成电路领域。
一种基于单极晶体管输出反馈逻辑电路芯片