专利名称
主分类
A 农业
B 作业;运输
C 化学;冶金
D 纺织;造纸
E 固定建筑物
F 机械工程、照明、加热
G 物理
H 电学
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公布日期
2023-10-24 公布专利
2023-10-20 公布专利
2023-10-17 公布专利
2023-10-13 公布专利
2023-10-10 公布专利
2023-10-03 公布专利
2023-09-29 公布专利
2023-09-26 公布专利
2023-09-22 公布专利
2023-09-19 公布专利
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专利权人
国家电网公司
华为技术有限公司
浙江大学
中兴通讯股份有限公司
三星电子株式会社
中国石油化工股份有限公司
清华大学
鸿海精密工业股份有限公司
松下电器产业株式会社
上海交通大学
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  • [发明专利]空时编码发射方法和装置-CN200810168360.7有效
  • 王衍文;李岩;刘文豪 - 中兴通讯股份有限公司
  • 2008-10-28 - 2010-06-09 - H04L1/06
  • 本发明公开了一种空时编码发射方法和装置,上述方法包括:设置多个值矩阵,其中,根据信道编码速率设置多个值矩阵的个数,根据天线个数和多个值矩阵的个数设置各值矩阵的值向量的维数,并将各值矩阵设置为正交矩阵;根据多个值矩阵的个数对待发射数据进行编码,得到分集编码数据矩阵,并分别使用多个值矩阵对分集编码数据矩阵中将在预定时刻发送的多路分集编码数据进行加权运算,得到多个多路加权分集编码数据;对于多个多路加权分集编码数据中的每个多路加权分集编码数据
  • 编码发射方法装置
  • [发明专利]一种自适应波束形成方法及装置-CN200810101437.9有效
  • 张翼鹏;卢勤博;辛胜利;李金凤 - 中兴通讯股份有限公司
  • 2008-03-06 - 2009-09-09 - H04B7/04
  • 本发明公开了一种自适应波束形成值的方法,包括步骤:在接收多路采样信号后,根据所述多路采样信号得到空间协方差矩阵估计和多路采样信号的信噪比;根据所述信噪比获得对角加载量,并根据对角加载量对空间协方差矩阵估计进行对角加载;将训练序列进行调制以得到期望信号,并将所述多路采样信号与期望信号进行相关运算以得到相关向量;根据所述经过对角加载后的空间协方差矩阵估计和所述相关向量生成自适应波束形成值,并根据所述自适应波束形成值对多路采样信号进行加权求和以输出一路自适应波束信号
  • 一种自适应波束形成方法装置
  • [发明专利]一种基于单频信噪比归一化的GPS/BDS多路径实时抑制方法-CN202010050715.3有效
  • 潘树国;闻贺;高旺;赵庆;刘力玮 - 东南大学
  • 2020-01-17 - 2022-12-13 - G01S19/22
  • 本发明在常规基于高度角的随机模型基础上,提出了一种基于单频信噪比归一化的GPS/BDS多路径实时抑制方法,所提模型利用卫星高度角和信噪比对多路径误差进行检测,并对城市环境下的卫星进行降处理。具体来说,对于同一站点,首先在理想环境下针对不同类型的卫星采用不同的信噪比标定方法进行标定,在城市环境下受多路径影响的信噪比观测值会偏离标定值,利用这一特性完成对多路径误差的检测,根据偏离值对该卫星进行降处理以抑制多路径误差最后对卫星残差进行一致性检验,进一步削弱多路径误差对定位结果的影响。通过两组RTD定位实验验证了在城市环境下,本发明提出的方法可以实时抑制多路径误差,提高定位精度。
  • 一种基于单频信噪归一化gpsbds路径实时抑制方法
  • [发明专利]一种端到端多路径快速计算方法及装置-CN202110357775.4在审
  • 白泽刚 - 烽火通信科技股份有限公司
  • 2021-04-01 - 2021-08-10 - H04L12/707
  • 本申请公开了一种端到端多路径快速计算方法及装置,涉及通信技术领域,该多路径快速计算方法包括:设置用户需求信息,用户需求信息包括源宿节点和其他需求信息,其他需求信息包括最大节点跳数、必要节点、排除节点和链路信息并设置所选路由策略对应的权重系数;获取源宿节点之间满足其他需求信息的多个备选物理路径,分别计算所选路由策略对应每个备选物理路径的路径参数;根据所选路由策略及其权重系数和路径参数,并行计算每个备选物理路径的路径综合值,以路径综合值从小到大的排序,选择前若干条路径。本申请,通过对多条路径的路径综合值并行计算,可达到快速实现多路径计算的目的,进而实现快速路径创建。
  • 一种端到端多路径快速计算方法装置
  • [发明专利]一种基于FPGA的神经元硬件系统-CN202211588788.3在审
  • 钟雪燕;韩世东;刘斌涛;辛建芳;周静 - 南京铁道职业技术学院
  • 2022-12-09 - 2023-05-02 - G06N3/049
  • 本发明公开了一种基于FPGA的神经元硬件系统包括第一多路选择器、控制器和神经元实现电路;第一多路选择器的输入端分别连接取值有限信号、接地和接值地址信号,信号输出端连接神经元实现电路的取值有限信号输入端;控制器的时钟信号输入端分别连接时钟信号、复位信号和神经元实现电路的脉冲信号输出端,输出端连接神经元实现电路的复位信号输入端;神经元实现电路的值地址信号输入端分别连接值地址信号、时钟信号、值有限信号和脉冲输入信号,输出端分别连接神经元硬件系统的值输出端和神经元硬件系统的脉冲信号输出端。
  • 一种基于fpga神经元硬件系统

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