[发明专利]一种IGBT器件的制造方法及其器件在审
申请号: | 201610589984.0 | 申请日: | 2016-07-25 |
公开(公告)号: | CN105977157A | 公开(公告)日: | 2016-09-28 |
发明(设计)人: | 刘广海;叶武阳;宋宏德;邢文超;贾国 | 申请(专利权)人: | 吉林华微电子股份有限公司 |
主分类号: | H01L21/331 | 分类号: | H01L21/331;H01L29/739;H01L29/06 |
代理公司: | 北京超凡志成知识产权代理事务所(普通合伙) 11371 | 代理人: | 毕强 |
地址: | 132013 吉*** | 国省代码: | 吉林;22 |
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摘要: | 本发明涉及半导体器件技术领域,尤其涉及一种IGBT器件的制造方法及其器件。其中,方法包括利用外延技术,以P+衬底,依次外延出耐压漂移区、P型体区外延层以及N+源区外延层,形成基体;利用光刻及刻蚀技术,在基体上开设栅区沟槽和肖特基沟槽;在栅区沟槽内壁经热氧化形成栅氧化层,在栅氧化层的内壁,通过淀积、光刻、刻蚀形成栅电极;在栅电极外表面进行钝化层淀积,经光刻、刻蚀形成栅电极绝缘保护层;最后在肖特基沟槽的表面进行肖特基势垒金属淀积、退火,形成肖特基二极管;最终得到IGBT器件。本发明提供的IGBT器件的制造方法及其器件,省去了杂质掺杂及扩散工艺,增强了栅氧化层的可靠性。 | ||
搜索关键词: | 一种 igbt 器件 制造 方法 及其 | ||
【主权项】:
一种IGBT器件的制造方法,其特征在于,包括如下步骤:将一块重掺杂的P型宽禁带半导体材料作为衬底,即P+衬底,在其上表面进行N型外延形成耐压漂移区,然后在所述耐压漂移区的基础上再进行P型外延形成P型体区外延层,最后在所述P型体区外延层的基础上再进行N型重掺杂外延形成N+源区外延层;由所述耐压漂移区、所述P型体区外延层和所述N+源区外延层形成基体;在所述N+源区外延层的上表面淀积沟槽刻蚀掩蔽膜,形成第一掩膜层;并在所述第一掩膜层的表面进行光刻、刻蚀处理,进而在所述N+源区外延层的中间位置处形成栅区沟槽刻蚀窗口;在所述栅区沟槽刻蚀窗口的位置,对所述基体进行刻蚀,刻蚀到所述耐压漂移区的内部,形成栅区沟槽;在所述栅区沟槽的内壁,进行热氧化或淀积,形成栅氧化层;在所述栅氧化层的内侧,再进行淀积,并通过光刻、刻蚀形成栅电极;在所述栅电极的表面进行钝化层淀积,通过光刻、刻蚀形成栅电极绝缘保护层;在所述N+源区外延层的上表面淀积沟槽刻蚀掩蔽膜,形成第二掩膜层;并在所述第二掩膜层的表面进行光刻、刻蚀处理,进而在所述N+源区外延层的两侧边缘位置处形成肖特基沟槽刻蚀窗口;在所述肖特基沟槽刻蚀窗口的位置,对所述基体进行刻蚀,刻蚀到所述耐压漂移区的内部,形成肖特基沟槽,且所述肖特基沟槽的深度要大于所述栅区沟槽的深度,最终形成沟槽MOSFET;在所述肖特基沟槽的表面进行肖特基势垒金属淀积、退火,形成肖特基二极管;所述沟槽MOSFET与所述肖特基二极管共用金属电极。
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H01 基本电气元件
H01L 半导体器件;其他类目中不包括的电固体器件
H01L21-00 专门适用于制造或处理半导体或固体器件或其部件的方法或设备
H01L21-02 .半导体器件或其部件的制造或处理
H01L21-64 .非专门适用于包含在H01L 31/00至H01L 51/00各组的单个器件所使用的除半导体器件之外的固体器件或其部件的制造或处理
H01L21-66 .在制造或处理过程中的测试或测量
H01L21-67 .专门适用于在制造或处理过程中处理半导体或电固体器件的装置;专门适合于在半导体或电固体器件或部件的制造或处理过程中处理晶片的装置
H01L21-70 .由在一共用基片内或其上形成的多个固态组件或集成电路组成的器件或其部件的制造或处理;集成电路器件或其特殊部件的制造
H01L 半导体器件;其他类目中不包括的电固体器件
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H01L21-64 .非专门适用于包含在H01L 31/00至H01L 51/00各组的单个器件所使用的除半导体器件之外的固体器件或其部件的制造或处理
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H01L21-67 .专门适用于在制造或处理过程中处理半导体或电固体器件的装置;专门适合于在半导体或电固体器件或部件的制造或处理过程中处理晶片的装置
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