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[发明专利]一种FPGA嵌入式DSP的测试方法-CN202310218865.4在审
发明人：高丽江;朱辰;马建军;刘学刚;杨海钢 -专利权人：北京中科胜芯科技有限公司
申请日： 2023-03-08 - 公布日： 2023-05-30 - 主分类号： G06F30/30 文献下载
摘要：本发明涉及一种FPGA嵌入式DSP的测试方法，属于集成电路技术领域。该方法设置以FPGA的DSP实现的待测模块和以FPGA的CLB实现的向量产生模块、参考模型模块及结果检测比较模块；所述参考模块与待测模块具有相同的功能；以向量产生模块生成测试向量作为激励；根据结果检测比较模块的结果，判定DSP是否存在制造缺陷。本发明利用FPGA芯片的可编程特性，将其中一部分逻辑编程为测试辅助电路，用来完成FPGA的测试。
一种 fpga 嵌入式 dsp 测试方法

[发明专利]一种防电学振荡的微机械陀螺仪闭环驱动电路-CN201710147901.7有效
发明人：吴焕铭;杨海钢;尹韬 -专利权人：宁波大学;中国科学院电子学研究所
申请日： 2017-03-14 - 公布日： 2023-05-05 - 主分类号： G01C19/56 文献下载
摘要：本发明公开了一种防电学振荡的微机械陀螺仪闭环驱动电路，特点是：由陀螺仪传感器件、读出电路、比较器、锁相环、幅度调节电路与开关2构成闭环，负责驱动陀螺仪传感器件沿驱动轴振荡；幅度提取电路、幅度调节电路与读出电路、陀螺仪传感器件构成闭环，负责控制陀螺仪传感器件振荡幅度恒定；激励电路负责激励陀螺仪传感器件振荡，频率测量电路负责读出振荡信号频率值，电压预置电路负责将频率值转换成预置电压信号，并施加到锁相环中的压控振荡器上，预置压控振荡器的起振频率。本发明的闭环驱动电路的优点是：通过预置压控振荡器起振频率，利用锁相环的窄带滤波及频率追踪功能，有效避免电学振荡发生，并可用常压集成电路工艺实现。
一种电学振荡微机陀螺仪闭环驱动电路

[发明专利]一种正交偏置自消除的微机械陀螺仪-CN201611202728.8有效
发明人：吴焕铭;杨海钢;尹韬 -专利权人：宁波大学;中国科学院电子学研究所
申请日： 2016-12-23 - 公布日： 2023-04-28 - 主分类号： G01C25/00 文献下载
摘要：本发明公开了一种正交偏置自消除的微机械陀螺仪，由陀螺仪传感器件，闭环驱动电路，开环读出电路和正交偏置自消除闭环组成。其中，闭环驱动电路驱动传感器件沿驱动轴振动，开环读出电路将包含角速度的信号转变成电压信号，并通过解调、滤波、模数转换输出。正交偏置自消除闭环由可调相位解调信号产生电路、解调器、低通滤波器、数模转换器和比较判决电路组成。该闭环由比较判决电路寻找正交偏置输出的极值反馈调节解调信号相位，完成角速度输出信号中正交偏置分量的自动消除。与现有技术相比，本发明的优点在于在不增加陀螺仪传感器件机械设计复杂度的条件下，仅增加少量电路，实现正交偏置自动消除，有利于节省陀螺仪出厂校准的时间和人力成本。
一种正交偏置消除微机陀螺仪

[发明专利]可扩展可编程逻辑单元及可编程逻辑块结构-CN201910210318.5有效
发明人：高丽江;韦援丰;陈柱佳;卫博;蔡刚;魏育成;杨海钢 -专利权人：中科亿海微电子科技（苏州）有限公司;中国科学院电子学研究所
申请日： 2019-03-19 - 公布日： 2023-04-14 - 主分类号： G06F7/505 文献下载
摘要：一种可扩展可编程逻辑单元及可编程逻辑块结构。其中，可扩展可编程逻辑单元，包括：第二查找表，包含：第一查找表和算术逻辑单元(ALU)，其中第一查找表的两个输出连接至该ALU的输入；以及第二寄存器组，包含多组第二寄存器，分别与第二查找表的各个输出进行连接；其中，ALU具有算术运算和任意两输入函数功能。可编程逻辑块结构包括可扩展可编程逻辑单元以及细粒度可编程逻辑单元，通过二者的组合和级联，实现所需要的函数操作。该可扩展可编程逻辑单元能够实现两输入函数，避免了采用多输入查找表实现两输入函数的资源浪费以及性能降低的风险；不需要再通过互联资源额外连接至第三个k输入查找表，解决了逻辑级数较多和资源的浪费等问题。
扩展可编程逻辑单元结构

[发明专利]一种增量快照行情数据一致性判定的方法-CN202210081439.6有效
发明人：温士魁;杨海钢;贾一平;涂开辉 -专利权人：北京中科胜芯科技有限公司
申请日： 2022-01-24 - 公布日： 2023-03-24 - 主分类号： G06F16/11 文献下载
摘要：本发明涉及一种增量快照行情数据一致性判定的方法，属于数据处理技术领域。该方法执行如下步骤，1）接收行情数据；若其中的快照类型返回值为1，则将所述行情数据输出给DDR；若其中的快照类型返回值为2，则跳至步骤2）；2）根据所述行情数据中的操作符判断；3）读取DDR中相应证券代码的所有字段数值，依次判所述价格、所述申买量、所述总委托笔数与DDR中是否一致；若上述判断均一致，则直接将DDR中已有数据输出，若上述判断有不一致处，则对DDR中已有数据进行更新。本发明通过三个数值完成判断，即确定前后数据的一致性，其过程仅3个时钟周期。而三个数据的处理流程一致，仅需一套程序，即可实现解码，减少逻辑资源。
一种增量快照行情数据一致性判定方法

[发明专利]基于信号自动拉取的在线逻辑分析仪的实施方法-CN202011609667.3有效
发明人： 杨海钢 -专利权人：中国科学院空天信息创新研究院
申请日： 2020-12-28 - 公布日： 2023-01-13 - 主分类号： G01R31/3177 文献下载
摘要：一种基于信号自动拉取的在线逻辑分析仪的实施方法，包括以下步骤：打开逻辑分析仪，读入综合后的网表文件；所述逻辑分析仪自动统计所述网表文件中的所有内部信号；用户选择一条或多条网表的内部信号；所述逻辑分析仪自动为每一条内部信号添加一个网表端口，并将端口连接至对应的内部信号；用户为选中的某几条或全部信号设置端口约束，所述逻辑分析仪自动产生端口约束语句；所述逻辑分析仪自动产生新的网表文件和端口约束文件，并告知用户新的网表文件和端口约束文件所在的磁盘路径；用户找到新的网表文件和端口约束文件后，运行布局布线生成码流，将码流下载至开发板；用户通过示波器捕获和抓取芯片的实时信号。
基于信号自动在线逻辑分析实施方法

[发明专利]一种工艺迁移的方法-CN202211128111.1在审
发明人：刘学刚;高丽江;杨海钢 -专利权人：山东产研集成电路产业研究院有限公司
申请日： 2022-09-16 - 公布日： 2022-12-20 - 主分类号： G06F30/398 文献下载
摘要：本发明涉及一种工艺迁移的方法，属于集成芯片电路设计技术领域。该方法执行以下步骤：1）比较新旧工艺套件库，确认器件数量；2）记录电路原理图中各器件的坐标与参数值；3）以所述电路原理图中为基础，以新工艺套件库生成过渡工艺套件库；4）使用过渡工艺套件库替换就工艺套件库，完成工艺迁移。本发明可以解决不同工艺不同工厂之间的工艺迁移，可以兼容几乎所有的工艺迁移造成的pin脚断连或者pin脚错连,便于自动化解决所有关于工艺迁移的问题。
一种工艺迁移方法

[发明专利]一种具有初始化功能的寄存器-CN202211124349.7在审
发明人：高丽江;贾一平;杨海钢 -专利权人：北京中科胜芯科技有限公司
申请日： 2022-09-15 - 公布日： 2022-12-16 - 主分类号： G06F9/4401 文献下载
摘要：本发明涉及一种具有初始化功能的寄存器，属于集成电路技术领域。该寄存器包括其本体，所述寄存器靠近输出端的三态反相器输出端连接一个三态缓冲器的输出端；所述三态缓冲器的使能端接入初始化使能信号；所述三态缓冲器的数据输入端与一个配置存储器的输出端相连；所述配置存储器用于存储初始化所述寄存器的值。本发明可以通过控制配置存储器的存储的数值来决定寄存器的初始化值，灵活性高，同时实现了清零和置1的功能。
一种具有初始化功能寄存器

[发明专利]一种具有回读功能的寄存器-CN202211124370.7在审
发明人：高丽江;贾一平;杨海钢 -专利权人：北京中科胜芯科技有限公司
申请日： 2022-09-15 - 公布日： 2022-12-13 - 主分类号： G11C7/10 文献下载
摘要：本发明涉及一种具有回读功能的寄存器，属于集成电路技术领域。该寄存器的输入端到输出端依次为第一反相器、第二反相器和第三反相器；第二反相器的输入端和输出端分别连接两个或非门的一输出端，或非门的另一输出端均与第四反相器的输出端相连；与非门的输出端分别连接传输管mn1的栅极和传输管mn2的栅极，传输管mn1和传输管mn2的源极接低电平，传输管mn1的漏极、第五反相器的输入端、第六反相器的输出端及传输管m3的源极/漏极视为一点，传输管mn2的漏极、第五反相器的输出端、第六反相器的输入端及传输管m4的源极/漏极视为一点。本发明将寄存器的回读功能通过SRAM来实现，简化了寄存器回读所需的额外电路。
一种具有功能寄存器

[发明专利]一种用于评估FPGA芯片面积的方法-CN202211121191.8在审
发明人：高丽江;贾一平;杨海钢 -专利权人：北京中科胜芯科技有限公司
申请日： 2022-09-15 - 公布日： 2022-11-29 - 主分类号： G06F30/347 文献下载
摘要：本发明涉及一种用于评估FPGA芯片面积的方法，属于FPGA芯片设计技术领域。该方法执行以下步骤，1）确定当前设计中基本单元的版图高度；2）以步骤1）为约束条件，确定各基本单元的最小宽度；3）设定每增加一个finger后，所述基本单元的宽度增加值；4）根据步骤2）和步骤3）确定当前设计中各单元最终宽度值，并以向上取整的方式以w的整数倍表示，从而确定各单元的最小等效单元的面积，并根据各单元中最小等效单元个数得到各单元的总面积；5）计算面积占用率a，并进行评估；本发明可预估芯片面积，并通过占用率进行快速评估，本发明以基于固定单元高度的面积估计的方式对于FPGA进行面积估计。
一种用于评估 fpga 芯片面积方法

[发明专利]一种适用于Soc FPGA的片内总线系统安全传输装置-CN202111080310.5有效
发明人：舒毅;李文军;王佳薇;赵飞;贾一平;杨海钢 -专利权人：北京中科胜芯科技有限公司
申请日： 2021-09-15 - 公布日： 2022-09-02 - 主分类号： G06F21/60 文献下载
摘要：本发明涉及一种适用于Soc FPGA的片内总线系统安全传输装置，属于总线的安全传输技术领域。该传输装置包括主机端MOI和从机端SOI；所述主机端MOI包括第一认证与密钥控制单元、写数据加密单元、读数据解密单元、第一写数据同步缓存单元和第一读数据同步缓存单元；所述从机端SOI包括第二认证与密钥控制单元、写数据解密单元、读数据解密单元、第二写数据同步缓存单元和第二读数据同步缓存单元。本发明在最大限度上适配传统系统架构，并实现了具有安全性的传输通路的总线互联系统。
一种适用于 soc fpga 总线系统安全传输装置

[发明专利]一种基于多粒度查找表结构的可编程逻辑块-CN202111264797.2有效
发明人：王彦林;高丽江;刘学刚;秋小强;贾一平;杨海钢 -专利权人：山东芯慧微电子科技有限公司
申请日： 2021-10-28 - 公布日： 2022-08-09 - 主分类号： G06F15/78 文献下载
摘要：本发明公开了一种基于多粒度查找表结构的可编程逻辑块，可编程逻辑块的每个基本逻辑单元包含两个完全相同相互独立的PLML(Programmable Logic Module‑Logic)；每个PLML包括LUT模块、逻辑运算模块、触发器模块和多路选择器模块；每个PLML包含三种粒度的双输出LUT共4个(4‑LUT 2个、5‑LUT 1个、6‑LUT 1个)，4个加法器和4个触发器以及若干个多路选择器等资源；每个PLML通过内部同种或不同种资源组合，可以实现功能更强的LUT、加法器和MUX功能，且均能实现寄存输出。本发明所提出的结构与传统CLB结构相比，具有多种输入的查找表结构，可以根据功能需求映射到对应的LUT上，避免资源浪费。与自适应查找表相比，可以实现更多独立的功能函数，同时配置起来也比较简单，没有共享端口配置时的诸多限制条件。
一种基于粒度查找结构可编程逻辑

[发明专利]一种卷积神经网络加速器实现架构-CN201911076768.6有效
发明人：毛宁;黄志洪;杨海钢 -专利权人：北京中科胜芯科技有限公司
申请日： 2019-11-06 - 公布日： 2022-08-09 - 主分类号： G06N3/063 文献下载
摘要：本发明涉及一种卷积神经网络加速器实现架构，包括：用于存储权值数据的第一存储器、第二存储器、第三存储器和第四存储器；用于存储特征图数据的第六存储器、第八存储器和第十存储器，用于进行卷积运算的第五运算器、第七运算器、第九运算器和第十一运算器。本发明提供的卷积神经网络加速器实现架构；能够减少存储资源消耗；利用卷积神经网络内部输入特征图之间的并行性，输出特征图之间的并行性，实现并行度的灵活配置。
一种卷积神经网络加速器实现架构

[发明专利]具有双进位链结构的双输出查找表及可编程逻辑单元-CN201910148320.4有效
发明人：高丽江;韦援丰;陈柱佳;蔡刚;魏育成;杨海钢 -专利权人：中科亿海微电子科技（苏州）有限公司
申请日： 2019-03-07 - 公布日： 2022-06-24 - 主分类号： G06F8/30 文献下载
摘要：本发明公开了一种具有双进位链结构的双输出查找表及可编程逻辑单元，双输出查找表包括：F0、F1、F2、F3和F4，进位链的多路选择器mx1和mx2，3选1的多路选择器mx4，以及2选1的多路选择器mx3、mx5和mx6；通过在传统的双进位链结构查找表的基础上增加多路选择器mx4、mx5和mx6，mx5的输入端与多路选择器mx1和mx2的输入相同，mx5的控制端与mx6的输出相连，mx5的输出端连接至本级的数据输出，mx6的输入端分别与mx3的输出、输入c相连，mx4的第一输入端接d、第二输入端接mx3的输出、第三输入端接c。该双输出查找表能够实现将求得的本级进位通过本级BLE进行输出，提高了在算术模式下的资源利用率，并且能够实现普通模式下具有公共输入端的两个相同或不同的多输入函数。
具有进位链结输出查找可编程逻辑单元

[发明专利]具有进位链结构的双输出查找表及可编程逻辑单元-CN201910173707.5有效
发明人：高丽江;韦援丰;陈柱佳;蔡刚;魏育成;杨海钢 -专利权人：中科亿海微电子科技（苏州）有限公司
申请日： 2019-03-07 - 公布日： 2022-06-24 - 主分类号： G06F8/30 文献下载
摘要：本发明公开了一种具有进位链结构的双输出查找表及可编程逻辑单元，双输出查找表包括：F0、F1、F2、F3和F4，进位链的多路选择器mux，以及2选1的多路选择器mx2和mx3。F0、F1、F2、F3的输出均与F4的数据输入端相连，F4有两个控制端和一个数据输出端，其中，F4的一个控制端连接mx3的输出，另一个控制端接d/vdd/gnd，mx3的输入分别与mx2的输出、输入端d连接，mx3的控制端与配置SRAM相连，mx2的数据输入端分别与输入端c、cin相连，mx2的控制端与配置SRAM相连，mux的输入端连接F2和F3的输出，mux的控制端与mx2的输出相连，mux的输出端既连接至下一级的输入，又连接至本级的数据输出，提高了算术模式下的资源利用率，并且能够实现普通模式下具有公共输入端的两个多输入函数。
具有进位链结输出查找可编程逻辑单元

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