[发明专利]阵列基板及其制作方法在审
申请号: | 202010018793.5 | 申请日: | 2020-01-08 |
公开(公告)号: | CN111106063A | 公开(公告)日: | 2020-05-05 |
发明(设计)人: | 雍玮娜 | 申请(专利权)人: | TCL华星光电技术有限公司 |
主分类号: | H01L21/77 | 分类号: | H01L21/77;H01L27/12;G03F1/32 |
代理公司: | 深圳紫藤知识产权代理有限公司 44570 | 代理人: | 刁文魁 |
地址: | 518132 广东*** | 国省代码: | 广东;44 |
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摘要: | |||
搜索关键词: | 阵列 及其 制作方法 | ||
1.一种阵列基板的制作方法,其特征在于,包括以下步骤:
S10:提供衬底基板,所述衬底基板包括显示区和GOA区,在所述衬底基板上依次形成栅极、栅绝缘层、有源层以及源漏极金属层;
S20:在所述源漏极金属层上形成光刻胶层;
S30:采用掩膜板对所述光刻胶层进行曝光显影,以使对应所述显示区的第一薄膜晶体管沟道区域剩余所述光刻胶层的厚度等于对应所述GOA区的第二薄膜晶体管沟道区域剩余所述光刻胶层的厚度;
S40:对剩余所述光刻胶层进行灰化处理,完全去除对应位于所述显示区的所述第一薄膜晶体管沟道区域和对应位于所述GOA区的所述第二薄膜晶体管沟道区域的所述光刻胶层;以及
S50:对对应所述显示区和所述GOA区域的所述源漏极金属层进行刻蚀处理,以在所述显示区形成所述第一薄膜晶体管的源漏极和沟道区域,在所述GOA区形成所述第二薄膜晶体管的源漏极和沟道区域。
2.根据权利要求1所述的阵列基板的制作方法,其特征在于,位于所述显示区的所述第一薄膜晶体管的密度小于位于所述GOA区的所述第二薄膜晶体管的密度。
3.根据权利要求2所述的阵列基板的制作方法,其特征在于,所述光刻胶层为正性光刻胶层,所述掩膜板对应所述GOA区的透光率小于所述掩膜板对应所述显示区的透光率。
4.根据权利要求3所述的阵列基板的制作方法,其特征在于,所述掩膜板对应所述显示区的透光率为所述掩膜板对应所述GOA区的透光率的20%~60%。
5.根据权利要求4所述的阵列基板的制作方法,其特征在于,所述掩膜板对应所述显示区的厚度大于所述掩膜板对应所述GOA区的厚度。
6.根据权利要求2所述的阵列基板的制作方法,其特征在于,所述第一薄膜晶体管沟道区域的长度等于所述第二薄膜晶体管沟道区域的长度,每相邻两个所述第一薄膜晶体管之间的距离大于每相邻两个所述第二薄膜晶体管之间的距离。
7.根据权利要求2所述的阵列基板的制作方法,其特征在于,所述第一薄膜晶体管沟道区域的长度大于所述第二薄膜晶体管沟道区域的长度,每相邻两个所述第一薄膜晶体管之间的距离等于每相邻两个所述第二薄膜晶体管之间的距离。
8.根据权利要求1所述的制作方法,其特征在于,所述掩膜板为半色调掩膜板或灰阶掩膜板或两者的组合。
9.一种阵列基板,其特征在于,包括:
衬底基板,包括显示区和GOA区;
第一薄膜晶体管,设置于所述衬底基板上的所述显示区,所述第一薄膜晶体管包括第一栅极、所述栅绝缘层、所述有源层以及位于所述有源层上的源漏极和沟道区域;以及
第二薄膜晶体管,设置于所述衬底基板上的所述GOA区,所述第二薄膜晶体管包括位于第二栅极、所述栅绝缘层、所述有源层以及位于所述有源层上的源漏极和沟道区域;
其中,所述第一薄膜晶体管沟道区域在垂直于所述衬底基板上表面的方向的深度与所述第二薄膜晶体管沟道区域在垂直于所述衬底基板上表面的方向的深度相等。
10.根据权利要求9所述的阵列基板,其特征在于,位于所述显示区的所述第一薄膜晶体管的密度小于位于所述GOA区的所述第二薄膜晶体管的密度。
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H01L 半导体器件;其他类目中不包括的电固体器件
H01L21-00 专门适用于制造或处理半导体或固体器件或其部件的方法或设备
H01L21-02 .半导体器件或其部件的制造或处理
H01L21-64 .非专门适用于包含在H01L 31/00至H01L 51/00各组的单个器件所使用的除半导体器件之外的固体器件或其部件的制造或处理
H01L21-66 .在制造或处理过程中的测试或测量
H01L21-67 .专门适用于在制造或处理过程中处理半导体或电固体器件的装置;专门适合于在半导体或电固体器件或部件的制造或处理过程中处理晶片的装置
H01L21-70 .由在一共用基片内或其上形成的多个固态组件或集成电路组成的器件或其部件的制造或处理;集成电路器件或其特殊部件的制造