专利名称
主分类
A 农业
B 作业;运输
C 化学;冶金
D 纺织;造纸
E 固定建筑物
F 机械工程、照明、加热
G 物理
H 电学
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公布日期
2023-10-24 公布专利
2023-10-20 公布专利
2023-10-17 公布专利
2023-10-13 公布专利
2023-10-10 公布专利
2023-10-03 公布专利
2023-09-29 公布专利
2023-09-26 公布专利
2023-09-22 公布专利
2023-09-19 公布专利
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专利权人
国家电网公司
华为技术有限公司
浙江大学
中兴通讯股份有限公司
三星电子株式会社
中国石油化工股份有限公司
清华大学
鸿海精密工业股份有限公司
松下电器产业株式会社
上海交通大学
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  • [发明专利]快速哈达玛变换装置及方法-CN201010108911.8有效
  • 吴昊;郑波浪;王翊军 - 北京韦加航通科技有限责任公司
  • 2010-02-08 - 2010-11-24 - G06F17/14
  • 本发明公开了一种快速哈达玛变换装置及方法,该装置包括:控制信号产生单元,用于产生控制信号,并分别向各级运算单元输出相应的控制信号;多级运算单元,用于根据控制信号对输入信号进行蝶形计算,并输出快速哈达玛变换结果;其中,各级运算单元包括:第一移位寄存器,用于对输入信号进行延时,并输出延时后的输入信号;加减运算单元,用于接收未延时的输入信号和延时后的输入信号,将未延时的输入信号和延时后的输入信号进行加运算和减运算,获取加运算结果和减运算结果;第二移位寄存器,用于对减运算结果进行延时,并输出延时后的减运算结果;数据选择器,用于接收控制信号,并根据控制信号选择输出加运算结果、或延时后的减运算结果。
  • 快速哈达变换装置方法
  • [发明专利]处理器-CN98117664.X无效
  • 神保卓哉;大谷昭彦;荒木敏之 - 松下电器产业株式会社
  • 1998-09-01 - 2004-07-14 - G06F1/10
  • 一种处理器设置运算控制器、运算单元、存储器。运算控制器,接受来自时钟信号控制器的非选通时钟信号,发布用于指定运算单元中使用资源的参数信号,同时微控制器发布运算启动信号,请求信号被触发。对应于该请求信号,时钟信号控制器分别向运算单元及存储器提供选通信号运算控制器,判断运算单元提供的状态信号是否满足终了条件,在终了条件得到满足的情况下,将隔断请求信号。这样,停止向运算单元及存储器提供时钟信号
  • 处理器
  • [发明专利]空气流量计-CN201880020523.9有效
  • 松本昌大;中野洋;上之段晓 - 日立汽车系统株式会社
  • 2018-03-29 - 2020-12-18 - G01F1/00
  • 本发明提供一种可以高速地跟随输入信号的脉动状态的变化的空气流量计。本发明的空气流量计(1)具备:空气流量检测元件(3),其生成与作为测定对象的空气流量相关的输入信号(Qsen);以及运算部(2),其根据输入信号(Qsen)来进行用于生成与空气流量相应的输出信号(Qout)的运算运算部(2)具有:输出信号运算部(7),其对输出信号(Qout)进行包括比1大的乘方运算在内的运算;输入信号运算部(4),其对输入信号(Qsen)进行运算;减法部(5),其求出输出信号运算部(7)的运算结果与输入信号运算部(4)的运算结果的差分;以及积分器(6),其对减法部(5)求出的差分进行积分,输出信号(Qout)根据来自积分器(6)的输出而生成。
  • 空气流量计
  • [发明专利]一种奇偶校验电路及方法-CN202111404307.4在审
  • 胡志鹏;刘煜标 - 广东高标电子科技有限公司
  • 2021-11-24 - 2022-03-01 - H03M13/11
  • 奇偶校验电路包括状态设置模块、第一运算模块、移位模块、第二运算模块和第三运算模块;第一运算模块的第一输入端接入数据信号;状态设置模块用于输出状态信号至第一运算模块,第一运算模块用于对数据信号和移位模块输出的第一信号进行逻辑运算,对状态信号与第一信号进行逻辑运算,输出第二信号;移位模块用于将第二信号移位输出第一信号;第二运算模块用于将第一信号与控制信号进行逻辑运算,输出第三信号;第三运算模块用于对第三信号和第二信号进行逻辑运算,输出数据信号和奇偶校验位。本发明的奇偶校验电路可以输出原始的数据信号和奇偶校验位,并且无需微控制器,有利于降低成本。
  • 一种奇偶校验电路方法
  • [发明专利]运算核、计算芯片和加密货币矿机-CN202011322084.2在审
  • 范志军;薛可;许超;杨作兴 - 深圳比特微电子科技有限公司
  • 2020-11-23 - 2022-05-24 - G06F15/78
  • 本公开涉及运算核、计算芯片和加密货币矿机。一种运算核包括:输入模块,被配置为接收数据块;被配置为对数据块进行哈希运算运算模块,包括以流水线结构布置的多个运算级,使得基于数据块的数据信号沿着多个运算级依次传递;异步FIFO模块,设置在相邻的第一运算级和第二运算级之间,被配置为利用第一时钟信号接收从第一运算级输出的数据信号并且利用第二时钟信号将数据信号输出到第二运算级,第一运算级在第二运算级之前;第一时钟模块,被配置为向异步FIFO模块和第一运算级及其之前的运算级提供第一时钟信号;和第二时钟模块,被配置为向异步FIFO模块和第二运算级及其之后的运算级提供第二时钟信号,其中第一时钟信号与第二时钟信号的频率相同。
  • 运算计算芯片加密货币
  • [实用新型]运算核、计算芯片和加密货币矿机-CN202022725519.X有效
  • 范志军;薛可;许超;杨作兴 - 深圳比特微电子科技有限公司
  • 2020-11-23 - 2021-06-08 - G06F15/78
  • 本公开涉及运算核、计算芯片和加密货币矿机。一种运算核包括:输入模块,被配置为接收数据块;被配置为对数据块进行哈希运算运算模块,包括以流水线结构布置的多个运算级,使得基于数据块的数据信号沿着多个运算级依次传递;异步FIFO模块,设置在相邻的第一运算级和第二运算级之间,被配置为利用第一时钟信号接收从第一运算级输出的数据信号并且利用第二时钟信号将数据信号输出到第二运算级,第一运算级在第二运算级之前;第一时钟模块,被配置为向异步FIFO模块和第一运算级及其之前的运算级提供第一时钟信号;和第二时钟模块,被配置为向异步FIFO模块和第二运算级及其之后的运算级提供第二时钟信号,其中第一时钟信号与第二时钟信号的频率相同。
  • 运算计算芯片加密货币
  • [发明专利]信号处理设备-CN201510427593.4有效
  • 木全哲也;中嶋哲 - 株式会社电装
  • 2015-07-20 - 2019-03-01 - G06F11/07
  • 本发明公开了一种信号处理设备。该信号处理设备包括记录单元、运算单元、处理单元以及异常检测器。所述记录单元将配置数据记录于所述记录单元中。所述运算单元对输入信号执行算术和逻辑运算并且输出表示所述运算的结果的运算信号。所述运算单元具有由记录于所述记录单元中的所述配置数据限定的电路配置。所述处理单元获取从所述运算单元输出的所述运算信号,基于获取的运算信号产生输出信号并且输出产生的输出信号。所述异常检测器检测所述运算单元的所述电路配置的异常。此外,在所述信号处理设备中,所述处理单元被配置来在获取所述运算信号之后从所述异常检测器进一步获取异常检测结果并且依据所述异常检测结果输出所述输出信号
  • 信号处理设备
  • [发明专利]光或放射线摄像装置-CN200680055205.3无效
  • 足立晋 - 株式会社岛津制作所
  • 2006-07-27 - 2009-07-08 - H04N5/335
  • 本发明提供一种光或放射线摄像装置,其具有:从主信号减去第一偏置信号来计算第一运算值的第一运算部(50)、计算第二偏置信号和第一偏置信号的差分即第二运算值的第二运算部(51)、和修正部(52),所述修正部(52)使用和从该第一运算部(50)的运算中使用的第一偏置信号至主信号为止的期间等长的期间所对应的、通过第二运算部(51)运算的第二运算值,对通过第一运算部(50)运算的第一运算值进行修正。因此,第一运算值被进行的修正是除去由在自第一偏置信号至主信号为止的期间蓄积的电荷信号的漏泄导致的噪声成分。因此,可以使由X射线检测元件(11)蓄积的电荷信号的漏泄(漏泄电流)导致的画质劣化减轻,且可以防止摄像时间延长。
  • 放射线摄像装置
  • [发明专利]输入缓冲电路-CN201310127261.5无效
  • 金东奂;方诚晚 - 三星电机株式会社
  • 2013-04-12 - 2014-05-14 - H03K19/0175
  • 该输入缓冲电路包括:第一运算单元,对输入信号和第一信号执行NOR运算;第二运算单元,对输入信号和第二信号执行NAND运算;以及反相单元,使第一运算单元和第二运算单元的输出分别反相以生成第二信号和第一信号,其中第一运算单元和第二运算单元的确定输入信号为高电平或低电平的参考电平被设置为不同。
  • 输入缓冲电路
  • [发明专利]全数字锁相环中的数字环路滤波器-CN202110867962.7在审
  • 李锺硕;金永福;孙忠焕;吴锡载;贾艺株 - 硅工厂股份有限公司
  • 2021-07-29 - 2022-02-18 - H03L7/093
  • 数字环路滤波器可包括选择电路、第一运算电路、第一寄存器电路、第二运算电路以及第二寄存器电路,其中,选择电路配置为输出第一数据信号和第二数据信号中的一个作为有效数据,第一运算电路配置为通过将有效数据和第一寄存器信号相加或相减来输出第一运算信号;第一寄存器电路配置为寄存第一运算信号并输出第一运算信号作为第一寄存器信号;第二运算电路配置为通过将有效数据的至少一个比特的值和第一寄存器信号相加或相减来输出第二运算信号,第二寄存器电路配置为存储第二运算信号并输出该第二运算信号作为控制信号
  • 数字环中环路滤波器

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