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[发明专利]一种多通道LDPC码的复用译码器-CN201510688769.1有效
发明人：余佳;苏洪涛 -专利权人：深圳市统先科技股份有限公司
申请日： 2015-10-21 - 公布日： 2019-04-12 - 主分类号： H03M13/11 文献下载
摘要：本发明适用于纠错码技术领域，提供了一种多通道LDPC码的复用译码器，包括n个解交织器、LDPC译码器、n个FIFO、选通器、分路器、译码器状态机和通道号FIFO；n个解交织器分别与选通器、译码器状态机相连，将输入的数据进行解交织，并将解交织后的去交织数据从输入数据的时钟域转换到高频时钟域并输出到选通器；LDPC译码器分别与选通器、译码器状态机、分路器相连，分路器分别与LDPC译码器、译码器状态机、n个FIFO相连；LDPC译码器将去交织数据进行译码，并输出就绪信号给译码器状态机；译码器状态机分别与n个解交织器、通道号FIFO相连接，控制与通道号i对应的解交织器输出解交织后的数据，通过选通器发送给LDPC译码器进行译码所述的复用译码器能节约硬件资源。
一种通道 ldpc 译码器

[发明专利]一种降低闪存待机功耗的结构及其方法-CN201010198412.2有效
发明人：杨光军 -专利权人：上海宏力半导体制造有限公司
申请日： 2010-06-11 - 公布日： 2011-03-09 - 主分类号： G11C16/06 文献下载
摘要：本发明提供一种降低闪存待机功耗的结构，包括存储阵列、行译码器、列译码器和电压控制电路，所述列译码器与所述存储阵列通过位线相连，所述行译码器与所述存储阵列通过字线相连，其特征在于，所述电压控制电路与行译码器相连，用于降低所述行译码器的待机功耗；所述电压控制电路还与所述列译码器相连，用于降低所述列译码器的待机功耗。本发明在工艺制作完成后，通过电压控制电路提高行译码器启动单元的上拉单元的基底偏压，进而降低其阈值电压；电压控制电路提高列译码器启动单元的基底偏压，进而降低其阈值电压；降低所述行译码器和列译码器的待机功耗
一种降低闪存待机功耗结构及其方法

[实用新型]一种双核音频设备-CN201621157324.7有效
发明人：徐文波 -专利权人：徐文波
申请日： 2016-10-31 - 公布日： 2017-05-03 - 主分类号： H04R3/00 文献下载
摘要：本实用新型提供了一种双核音频设备，包括音频输入模块、第一编译码器、第二编译码器、第一外部设备连接模块、第二外部设备连接模块、音频输出模块以及控制模块；音频输入模块分别与第一编译码器、第二编译码器电性连接，第一外部设备连接模块与第一编译码器电性连接，第二外部设备连接模块与第二编译码器电性连接，第一编译码器与第二编译码器电性连接，音频输出模块分别与第一编译码器、第二编译码器电性连接；控制模块分别与音频输入模块、第一编译码器、第二编译码器、第一外部设备连接模块、第二外部设备连接模块电性连接。
一种音频设备

[发明专利]极化码的SC-BP混合译码方法及其可调式硬件架构-CN201811220289.2有效
发明人：张川;周啸峰;尤肖虎 -专利权人：东南大学
申请日： 2018-10-19 - 公布日： 2022-07-12 - 主分类号： H03M13/13 文献下载
摘要：本发明公开了一种极化码的SC‑BP混合译码方法及其可调式硬件架构，包括如下步骤：将输入的信道对数似然比，经过k阶SC译码器，得到BP译码器的输入对数似然比；将输入经过迭代后得到BP译码器的输出，其中k为混合译码器的分解因子，将输出编码后返回SC译码器，作为一组SC译码器的返回值，SC译码器根据该返回值，进行下一组译码操作。本发明将SC译码器算法和BP译码器算法整合成SC‑BP混合译码单元并且加入预计算技术，在SC编码反馈架构和混合译码的脉动架构的作用下，通过本发明的SC‑BP混合译码方法，使得译码的时延和性能可在SC和BP两种算法的效果之间做出取舍，使得译码器能够适应多种通信要求，具备极好的市场应用前景。
极化 sc bp 混合译码方法及其调式硬件架构

[发明专利]组合副本组混洗迭代译码器及生成该译码器的方法-CN200680002322.3无效
发明人：乔纳森·S.·耶迪蒂亚;马克P·C·福斯瑞尔;张军坦;王一歌 -专利权人：三菱电机株式会社;夏威夷大学
申请日： 2006-01-06 - 公布日： 2008-01-09 - 主分类号： H03M13/29 文献下载
摘要：一种用于生成组合副本组混洗迭代译码器的方法。首先，接收纠错码和用于纠错码的迭代译码器。根据所述迭代译码器，构造用于纠错码的多个组混洗子译码器。然后，把多个组混洗子译码器组合为组合副本组混洗迭代译码器。新的组合迭代译码器可应用于LDPC码以及到turbo码和turbo乘积码。
组合本组混洗迭代译码器生成方法

[发明专利]一种译码器的自适应迭代次数方法和系统-CN202211381881.7在审
发明人：张锦辉 -专利权人：成都新基讯通信技术有限公司
申请日： 2022-11-04 - 公布日： 2023-01-31 - 主分类号： H03M13/11 文献下载
摘要：本发明提供一种译码器的自适应迭代次数方法和系统，包括：启动自适应迭代功能；初始化译码器，设置译码器的迭代次数为最大迭代次数；统计滑窗内物理下行共享信道的平均MCS值以及平均信噪比；根据平均MCS值以及平均信噪比，调整译码器的迭代次数作为译码器的初始迭代次数；译码器对单元块进行译码，记录译码成功时所用的实际译码次数；计算滑窗内当前单元块译码成功时所用的实际译码次数以及之前单元块译码成功时所用的实际译码次数的平均译码次数；根据平均译码次数调整译码器当前的迭代次数，对下一个单元块进行译码。通过动态的调整LDPC译码器的最大迭代次数，从而减少不必要的译码迭代，降低UE的功耗，达到性能和功耗的平衡。
一种译码器自适应次数方法系统

[发明专利]一种极化码译码方法及装置、多级译码器、存储介质-CN201811458463.7有效
发明人：魏浩;郜杰;李杰 -专利权人：中兴通讯股份有限公司
申请日： 2018-11-30 - 公布日： 2023-07-21 - 主分类号： H03M13/13 文献下载
摘要：本发明实施例提供的极化码译码方法及装置、多级译码器、存储介质，将所接收到的比特序列输入至各级译码器的路径数从前级往后级依次递增的多级译码器，而从多级译码器的第一级译码器开始进行译码，对所确定的各候选路径所对应的候选码字进行FPC校验，在存在校验成功的候选码字时，选择PM值最小的候选路径所对应的候选码字作为译码结果，在不存在校验成功的候选码字时，将比特序列继续输入至当前译码器下一级的译码器进行译码。采用多级译码器进行译码，使得大部分译码在译码路径数较小的前级译码器即成功译码，可降低译码时延；将候选码字中的部分冻结比特配置为FPC比特，而对候选码字进行FPC校验，可保证系统的FAR性能。
一种极化译码方法装置多级译码器存储介质

[发明专利]维特比译码器和维特比译码方法-CN201110115506.3有效
发明人：高波;肖振宇;金德鹏;裴玉奎;葛宁;郭欣 -专利权人：索尼公司;清华大学
申请日： 2011-04-27 - 公布日： 2012-10-31 - 主分类号： H03M13/41 文献下载
摘要：本发明公开一种维特比译码器和维特比译码方法。所述维特比译码器包括：待译码数据管理器，用于将输入的待译码数据分配给多个维特比译码器单元；多个维特比译码器单元，每个维特比译码器单元用于对所分配的待译码数据独立地进行基于前向滑块方式的维特比译码，以得到所分配的待译码数据的译码数据，其中，每一个维特比译码器单元对应的待译码数据包括相继的同步块、译码块和回溯块；以及译码数据输出管理器，用于从所述多个维特比译码器单元接收相应的译码数据，并组合和输出译码数据。根据本发明的维特比译码器和维特比译码方法能够提供较高的译码速率和较高的硬件资源利用率。
译码器译码方法

[发明专利]低密度奇偶校验码的改进TURBO－译码消息传递算法-CN200580051692.1无效
发明人： A·G·叶菲莫夫;A·V·别洛戈洛维 -专利权人：英特尔公司
申请日： 2005-09-30 - 公布日： 2008-09-24 - 主分类号： H03M13/11 文献下载
摘要：提供用于对来自通信信道的信号进行译码以重构所发送信息的设备和方法。实施例可以包括对代码应用多个译码器，其中向译码器提供可靠性值，使得该译码器仅接收多个译码器中另一个译码器确定和提供的可靠性值。对代码应用多个译码器可以输出有效码字。
密度奇偶校验码改进 turbo 译码消息传递算法

[发明专利]一种基于移位型基图的超高吞吐率LDPC译码器-CN202211177837.4在审
发明人：沙金;李瀚文 -专利权人：南京大学
申请日： 2022-09-26 - 公布日： 2023-02-03 - 主分类号： H03M13/11 文献下载
摘要：本发明公开了一种属于信道编译码技术领域中的LDPC译码器。现代通信领域中部分场景下使用的LDPC译码器要求吞吐率高，但硬件资源消耗大，本发明设计了一种基于移位型基图的超高吞吐率LDPC译码器，译码器内部例化多个译码器，译码器核使用基于移位型基图的LDPC校验矩阵，采用按行分组的最小和译码算法进行译码。本发明的有效效果为：使用基于移位型基图的LDPC校验矩阵设计译码器架构，减小了按行分组译码器中读取和写回模块的硬件资源消耗，降低了译码器的面积，使单位面积获得的吞吐率得到有效提升，并通过多核并行译码的方式大幅提升译码吞吐率
一种基于移位型基图超高吞吐 ldpc 译码器

[发明专利]一种基于DWC的Turbo译码器容错方法-CN202110848207.4在审
发明人：高镇;魏晓慧;张玲玲;裴静;刘玥 -专利权人：天津大学
申请日： 2021-07-27 - 公布日： 2021-10-26 - 主分类号： H03M13/29 文献下载
摘要：本发明涉及一种基于DWC的Turbo译码器容错方法，包括以下步骤：两个Turbo译码器针对相同的译码输入同时进行译码，译码结束后每个Turbo译码器输出三个信息；比较两个Turbo译码器的译码输出序列C，如果两个译码输出序列完全相同，则认为两个Turbo译码器中均无故障发生；如果两个Turbo译码器的输出序列不完全相同，则判定其中一个译码器发生了故障，此时比较两个Turbo译码器最后一次迭代的LLR绝对值之和M，判定两个LLR绝对值之和中数值更大的一个来自于无故障Turbo译码器，将其对应的译码结果作为最终的译码输出；如果相同，则继续比较最后一次迭代译码的结果与之前迭代的结果是否相同的标志信息I。
一种基于 dwc turbo 译码器容错方法

[发明专利]信道译码器和译码方法-CN201310000912.4在审
发明人：严小平;李蒙 -专利权人：联想（北京）有限公司
申请日： 2013-01-04 - 公布日： 2014-07-09 - 主分类号： H03M13/29 文献下载
摘要：提供了信道译码器和译码方法。该信道译码器包含分量译码器，且分量译码器包括：逆向数据计算单元，用于接收逆向数据的输入，以计算第一分支转移概率以及第一状态度量值；以及，对数似然比计算单元，用于基于该逆向数据计算单元计算出的第一分支转移概率和第一状态度量值通过根据本发明实施例的信道译码器和译码方法，可以通过接收逆向数据并进行逆向数据的译码，来提高信道译码器中分量译码器的译码速度，从而增强信道译码器的整体性能。
信道译码器译码方法

[发明专利]部分响应最大可能性信道的维特比译码器-CN02130528.5有效
发明人：郭弘政;蔡明宪 -专利权人：联发科技股份有限公司
申请日： 2002-08-14 - 公布日： 2004-02-18 - 主分类号： H03M13/00 文献下载
摘要：一种部分响应最大可能性信道的维特比译码器，在光盘的部分响应最大可能性系统中具有一模拟/数字转换器，此模拟/数字转换器接收一模拟信号，并输出一数字信号至维特比译码器，此维特比译码器包括：一自适应电平维特比译码器、一信号电平对应规则系统、一接收信号延迟链、一硬译码器、及一多路转换器。其中，自适应电平维特比译码器与硬译码器同时接收模拟/数字转换器所输出的数字信号以进行译码，并由模式选择规则系统决定多路转换器是输出自适应电平维特比译码器的判定位或是硬译码器的判定位。
部分响应最大可能性信道译码器

[实用新型]电路功能检测装置及设备-CN202022914933.5有效
发明人：胡中武;王一超 -专利权人：上能电气股份有限公司
申请日： 2020-12-07 - 公布日： 2021-10-22 - 主分类号： G01R31/28 文献下载
摘要：本实用新型用于电子电路技术领域，提供一种电路功能检测装置及设备，装置包括多个模拟负载模块，译码器多个模拟负载模块用于与待检测电路的多个负载连接端一一对应连接，译码器模拟负载模块包括容性负载单元、继电器单元和继电器控制单元，译码器容性负载单元包括第一电容和第二电容，译码器第一电容的一端与译码器继电器单元的一侧端连接，另一端与负载电压端连接，译码器第二电容与译码器第一电容并联，译码器继电器单元的另一侧端与译码器负载连接端连接，译码器继电器控制单元与译码器继电器单元的控制端连接，用于控制译码器继电器单元的通断。
电路功能检测装置设备

[发明专利]处理输入比特流的方法与信号处理装置-CN201110158679.3有效
发明人：林建良;谢芳易 -专利权人：联发科技股份有限公司
申请日： 2011-06-14 - 公布日： 2011-12-28 - 主分类号： H04N7/24 文献下载
摘要：一种处理具有多个图帧的输入比特流的方法与信号处理装置，其中该方法包含以下步骤：由目前图帧的译码来得到指示数据；以及至少参照指示数据以及视频译码器的视频译码能力，来控制视频译码器译码或略过下一图帧。一种处理具有多个图帧的输入比特流的信号处理装置，包含：视频译码器、指示数据估测单元以及控制器。视频译码器用以译码目前图帧。指示数据估测单元用以自目前图帧的译码来得到指示数据。控制器用以至少参照指示数据以及视频译码器的视频译码能力，来控制视频译码器译码或略过下一图帧。本发明能够参照指示数据以及视频译码器的视频译码能力，来适应性控制视频译码器译码，获取更好的显示性能。
处理输入比特流方法信号装置