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[发明专利]双路输出频率可调独立硬件黄闪控制器-CN201510164881.5有效
发明人：何通;韩晶 -专利权人：江苏航天大为科技股份有限公司
申请日： 2015-04-08 - 公布日： 2017-04-19 - 主分类号： G08G1/07 文献下载
摘要：本发明涉及一种双路输出频率可调独立硬件黄闪控制器，其包括与市电连接的交流EMI滤波电路、AC‑DC电路、基准时钟信号发生电路、可调时钟分频电路、计数分配电路、触发反转电路、功率驱动电路；所述交流EMI滤波电路的输出端分别连接AC‑DC电路的输入端、基准时钟信号发生电路的输入端；基准时钟信号发生电路输出的时钟信号分别连接可调时钟分频电路、触发反转电路的时钟信号输入端；可调时钟分频电路的输出信号连接计数分配电路；触发反转电路包括两路独立的JK触发器电路，计数分配电路的输出信号分别连接两路JK触发器电路的触发信号输入端；触发反转电路的输出连接功率驱动电路。本发明是纯硬件电路搭建完成，可以提供两路单独的频率可调的信号输出。
输出频率可调独立硬件控制器

[发明专利]时钟信号选择电路、延时链电路和延时锁相环-CN202110619925.4在审
发明人：狄鑫娟;肖文勇 -专利权人：杭州雄迈集成电路技术股份有限公司
申请日： 2021-06-03 - 公布日： 2021-08-03 - 主分类号： H03L7/08 文献下载
摘要：本发明公开一种时钟信号选择电路，包含该时钟选择信号的延时链电路和延时锁相环，上述时钟信号选择电路包括负沿D触发器、第一低电平锁存器和选择单元，选择单元用于接收第一时钟信号和第二时钟信号，第二时钟信号为第一时钟信号的延时信号；负沿D触发器，其信号输入端与外部的控制电路相连，时钟控制端用于接收外部输入的触发信号，信号输出端与第一低电平锁存器的信号输入端相连；第一低电平锁存器的时钟控制端用于接收第二时钟信号，信号输出端与选择单元相连，以控制选择单元输出第一时钟信号或第二时钟信号。由负沿D触发器和第一低电平锁存器处理控制信号，以控制选择单元工作，避免选择单元在第二时钟信号为高电平输出该第二时钟信号，以避免毛刺的产生。
时钟信号选择电路延时锁相环

[实用新型]时钟信号选择电路、延时链电路和延时锁相环-CN202121239714.X有效
发明人：狄鑫娟;肖文勇 -专利权人：杭州雄迈集成电路技术股份有限公司
申请日： 2021-06-03 - 公布日： 2021-12-14 - 主分类号： H03L7/08 文献下载
摘要：本实用新型公开一种时钟信号选择电路，包含该时钟选择信号的延时链电路和延时锁相环，上述时钟信号选择电路包括负沿D触发器、第一低电平锁存器和选择单元，选择单元用于接收第一时钟信号和第二时钟信号，第二时钟信号为第一时钟信号的延时信号；负沿D触发器，其信号输入端与外部的控制电路相连，时钟控制端用于接收外部输入的触发信号，信号输出端与第一低电平锁存器的信号输入端相连；第一低电平锁存器的时钟控制端用于接收第二时钟信号，信号输出端与选择单元相连，以控制选择单元输出第一时钟信号或第二时钟信号。由负沿D触发器和第一低电平锁存器处理控制信号，以控制选择单元工作，避免选择单元在第二时钟信号为高电平输出该第二时钟信号，以避免毛刺的产生。
时钟信号选择电路延时锁相环

[发明专利]负压电荷泵-CN201710388092.9有效
发明人：李祖渠 -专利权人：上海华虹宏力半导体制造有限公司
申请日： 2017-05-27 - 公布日： 2019-06-11 - 主分类号： H02M3/07 文献下载
摘要：本发明公开了一种负压电荷泵，包括：分压电路，连接在电荷泵输出的负压和第一基准电压之间，输出分压作为反馈电压连接到第一运算放大器的第一输入端，第一运算放大器的第二输入端接地；第一运算放大器的输出端连接到第一NMOS管的栅极，第一NMOS管的源极接地，漏极输出时钟控制信号；时钟信号通过时钟控制电路输入到电荷泵的输入端，时钟控制信号输入到时钟控制电路调节时钟信号的幅度；时钟控制信号还连接到电荷泵；电流路径连接到电荷泵的第一输出端，电流路径的电流在负载电流较小时导通，通过电流路径的电流和负载电流的并联使时钟控制信号降低到能使时钟控制电路正确传输时钟信号的低电平的值。
压电

[发明专利]移位寄存器单元及其驱动方法、移位寄存器、显示装置-CN201410669868.0有效
发明人：嵇凤丽;玄明花;金泰逵 -专利权人：京东方科技集团股份有限公司;鄂尔多斯市源盛光电有限责任公司
申请日： 2014-11-20 - 公布日： 2017-08-01 - 主分类号： G09G3/3225 文献下载
摘要：本发明提供一种移位寄存器单元及其驱动方法、移位寄存器、显示装置，属于显示技术领域，其可解决现有的移位寄存器单元输出的信号不稳定的问题。本发明的移位寄存器单元，包括输入模块、上拉模块、输出控制模块和输出下拉模块；所述输入模块连接信号输入端、第一时钟信号输入端和低电平信号端；所述输出控制模块连接第二时钟信号输入端和高电平信号端；所述上拉模块连接高电平信号端；所述输出下拉模块连接第一时钟信号输入端、第二时钟信号输入端、高电平信号端和低电平信号端。
移位寄存器单元及其驱动方法显示装置

[实用新型]移位寄存器单元、移位寄存器、显示装置-CN201420703192.8有效
发明人：嵇凤丽;玄明花;金泰逵 -专利权人：京东方科技集团股份有限公司;鄂尔多斯市源盛光电有限责任公司
申请日： 2014-11-20 - 公布日： 2015-02-25 - 主分类号： G09G3/32 文献下载
摘要：本实用新型提供一种移位寄存器单元、移位寄存器、显示装置，属于显示技术领域，其可解决现有的移位寄存器单元输出的信号不稳定的问题。本实用新型的移位寄存器单元，包括输入模块、上拉模块、输出控制模块和输出下拉模块；所述输入模块连接信号输入端、第一时钟信号输入端和低电平信号端；所述输出控制模块连接第二时钟信号输入端和高电平信号端；所述上拉模块连接高电平信号端；所述输出下拉模块连接第一时钟信号输入端、第二时钟信号输入端、高电平信号端和低电平信号端。
移位寄存器单元显示装置

[发明专利]一种维持固定脉冲的时钟同步电路-CN201810027277.1在审
发明人：邹颖;丁国华;谭在超;罗寅 -专利权人：苏州锴威特半导体有限公司
申请日： 2018-01-11 - 公布日： 2018-05-01 - 主分类号： H03K5/135 文献下载
摘要：本发明涉及一种维持固定脉冲的时钟同步电路，包括外部时钟处理模块和振荡器模块，外部时钟处理模块包括施密特触发器、上升沿检测单元、外部时钟检测单元和第一RS触发器，施密特触发器、上升沿检测单元、外部时钟检测单元、第一RS触发器的输入端和输出端顺次连接，振荡器模块包括上升沿标识信号产生单元、下降沿标识信号产生单元和振荡信号产生单元，上升沿标识信号产生单元和下降沿标识信号产生单元的输出端连接振荡信号产生单元的输入端，上升沿标识信号产生单元的输入端和下降沿标识信号产生单元的输入端连接振荡信号产生单元的输出端。本电路保证时钟脉冲宽度不变，适用于开关电源电路。
一种维持固定脉冲时钟同步电路

[实用新型]一种维持固定脉冲的时钟同步电路-CN201820047388.4有效
发明人：邹颖;丁国华;谭在超;罗寅 -专利权人：苏州锴威特半导体有限公司
申请日： 2018-01-11 - 公布日： 2018-09-11 - 主分类号： H03K5/135 文献下载
摘要：本实用新型涉及一种维持固定脉冲的时钟同步电路，包括外部时钟处理模块和振荡器模块，外部时钟处理模块包括施密特触发器、上升沿检测单元、外部时钟检测单元和第一RS触发器，施密特触发器、上升沿检测单元、外部时钟检测单元、第一RS触发器的输入端和输出端顺次连接，振荡器模块包括上升沿标识信号产生单元、下降沿标识信号产生单元和振荡信号产生单元，上升沿标识信号产生单元和下降沿标识信号产生单元的输出端连接振荡信号产生单元的输入端，上升沿标识信号产生单元的输入端和下降沿标识信号产生单元的输入端连接振荡信号产生单元的输出端。本电路保证时钟脉冲宽度不变，适用于开关电源电路。
标识信号产生单元外部时钟振荡信号产生单元上升沿输入端下降沿上升沿检测单元施密特触发器时钟同步电路振荡器模块处理模块固定脉冲输出端开关电源电路本实用新型输出端连接输入端连接时钟脉冲顺次连接检测电路保证

[发明专利]移位寄存器单元及其驱动方法、面板驱动电路、显示装置-CN202310288617.7在审
发明人：吴鹏 -专利权人：合肥鑫晟光电科技有限公司;京东方科技集团股份有限公司
申请日： 2023-03-21 - 公布日： 2023-06-23 - 主分类号： G11C19/28 文献下载
摘要：该移位寄存器单元包括输入电路、输出电路和补偿电路。其中，输入电路能够基于输入信号端提供的输入信号，为上拉节点充电。输出电路能够基于上拉节点的电位，向输出信号端传输时钟信号端提供的时钟信号。补偿电路能够基于上拉节点的电位和时钟信号，控制输出信号端与输入信号端导通，以基于传输至输出信号端的时钟信号对输入信号端提供的输入信号进行补偿。如此，可以在上拉节点被输出电路中电容自举拉高的阶段，降低输入信号端与上拉节点之间的压差，即降低输入电路中晶体管的源漏电压差。进而，可以避免输入电路中的晶体管发生特性负漂。
移位寄存器单元及其驱动方法面板电路显示装置

[发明专利]具有多路选择器功能的混合相位锁存器-CN202210455773.3有效
发明人：范志军;田文博;孔维新;杨作兴;郭海丰 -专利权人：深圳比特微电子科技有限公司
申请日： 2022-04-28 - 公布日： 2023-01-24 - 主分类号： H03K3/037 文献下载
摘要：本公开涉及一种具有多路选择器功能的混合相位锁存器，包括：传输门，所述传输门的数据输入端被配置为接收第一数据信号，所述传输门的时钟输入端被配置为接收第一时钟信号；三态门，所述三态门的数据输入端被配置为接收第二数据信号，所述三态门的时钟输入端被配置为接收第二时钟信号；以及反相器，所述反相器的输入端连接到传输门的输出端和三态门的输出端，所述反相器的输出端提供混合相位锁存器的输出，其中，第一时钟信号和第二时钟信号使得传输门和三态门在不同的时间导通
具有选择器功能混合相位锁存器

[发明专利]一种高精度低回踢噪声的时钟再生延迟链-CN201910759880.3有效
发明人：朱樟明;张玮;马瑞;刘马良;王夏宇;胡进 -专利权人：西安电子科技大学
申请日： 2019-08-16 - 公布日： 2021-08-10 - 主分类号： G01S7/4865 文献下载
摘要：本发明公开了一种高精度低回踢噪声的时钟再生延迟链，包括：电压转换模块，连接电压输入端，用于将输入信号转换为第一电压信号和第二电压信号；延迟链模块，连接所述电压转换模块和时钟输入端，用于根据所述第一电压信号和所述第二电压信号控制时钟延迟时间得到第一时钟信号簇和第二时钟信号簇；时钟驱动模块，连接所述延迟链模块，用于接收并处理所述第一时钟信号簇和所述第二时钟信号簇，输出多相位时钟信号簇。本发明提供的时钟再生延迟链具有可干扰能力和时钟再生能力，可以适应高精度系统级的应用。
一种高精度低回噪声时钟再生延迟

[发明专利]一种毫米波模拟采样前端电路-CN201811558023.9有效
发明人：刘马良;曹旭;朱樟明;陈龙;杨凡 -专利权人：西安电子科技大学
申请日： 2018-12-19 - 公布日： 2020-07-17 - 主分类号： H03M1/08 文献下载
摘要：本发明涉及一种毫米波模拟采样前端电路，包括多相时钟产生模块、驱动模块、多通道采样保持模块、输入信号保护模块以及电压时间转换模块，其中，所述多相时钟产生模块用于产生单端多相时钟信号，并把所述单端多相时钟信号传输至所述驱动模块；所述驱动模块用于将所述单端多相时钟信号转化为差分多相时钟信号；所述输入信号保护模块用于接收输入信号并对所述采样前端电路进行静电保护；所述多通道采样保持模块用于根据所述差分多相时钟信号对所述输入信号进行交织采样，获取电压信号；所述电压时间转换模块用于将所述电压信号转换为时间信号，并输出。
一种毫米波模拟采样前端电路

[发明专利]负压电荷泵-CN201710579037.8有效
发明人：李祖渠;刘芳芳 -专利权人：上海华虹宏力半导体制造有限公司
申请日： 2017-07-17 - 公布日： 2019-08-13 - 主分类号： H02M3/07 文献下载
摘要：本发明公开了一种负压电荷泵，包括：分压电路，连接在电荷泵输出的负压和第一基准电压之间，输出分压作为反馈电压连接到第一运算放大器的第一输入端，第一运算放大器的第二输入端接地；第一运算放大器的输出端连接到第一NMOS管的栅极，第一NMOS管的源极接地，漏极输出时钟控制信号；时钟信号通过时钟控制电路输入到电荷泵的输入端，时钟控制信号输入到时钟控制电路调节时钟信号的幅度；第二比较器监控时钟控制信号的大小并在时钟控制信号大于第一偏置电压时使电流路径的导通到电荷泵的第一输出端，从而提高电荷泵的总负载电流使时钟控制信号降低到能使时钟控制电路正确传输时钟信号的低电平的值,本发明能提高电路稳定性。
压电

[发明专利]跨域启动方法及电子装置-CN201410102700.1有效
发明人：卡洛·马宗达 -专利权人：南亚科技股份有限公司
申请日： 2014-03-19 - 公布日： 2017-12-15 - 主分类号： H03L7/081 文献下载
摘要：本发明公开了一种跨域启动方法及电子装置，该方法用以将本地时钟信号提供至操作于延迟锁定回路域的逻辑电路装置。逻辑电路装置包含指令输入端及时钟输入端。跨域启动方法包含以下步骤在时钟域的第一指令信号被触发时，通过致能延迟锁定回路域中的时钟信号开始将本地时钟信号提供至逻辑电路装置的时钟输入端；以及将延迟锁定回路域的第二指令信号提供至逻辑电路装置的指令输入端相较于时钟域的第一指令信号，延迟锁定回路域的第二指令信号较晚被触发。
启动方法电子装置

[发明专利]移位寄存器及其驱动方法、栅极驱动电路及显示装置-CN202211485862.9在审
发明人：韩燕淋;但艺;李辉;张兴利;周欢;朱海鹏;梁鹏;郭建东 -专利权人：京东方科技集团股份有限公司;重庆京东方光电科技有限公司
申请日： 2022-11-24 - 公布日： 2023-03-21 - 主分类号： G09G3/20 文献下载
摘要：本公开提供了一种移位寄存器及其驱动方法、栅极驱动电路及显示装置，该移位寄存器包括：输入子电路、输出子电路以及节点复位子电路。输入子电路与输入端、第一时钟信号端以及上拉节点连接，用于在第一时钟信号以及输入信号均处于有效电平时，将输入信号写入上拉节点，以控制上拉节点的电平。输出子电路与上拉节点、第二时钟信号端以及输出端连接，用于在上拉节点的电平控制下，将第二时钟信号输出至输出端。节点复位子电路，与上拉节点以及第一复位端连接，用于响应于第一复位端接收到的复位信号，对上拉节点进行复位。其中，第一时钟信号与第二时钟信号的周期相同，且第一时钟信号的有效电平到达时间先于第二时钟信号的有效电平到达时间。
移位寄存器及其驱动方法栅极电路显示装置