专利名称
主分类
A 农业
B 作业;运输
C 化学;冶金
D 纺织;造纸
E 固定建筑物
F 机械工程、照明、加热
G 物理
H 电学
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公布日期
2023-10-24 公布专利
2023-10-20 公布专利
2023-10-17 公布专利
2023-10-13 公布专利
2023-10-10 公布专利
2023-10-03 公布专利
2023-09-29 公布专利
2023-09-26 公布专利
2023-09-22 公布专利
2023-09-19 公布专利
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专利权人
国家电网公司
华为技术有限公司
浙江大学
中兴通讯股份有限公司
三星电子株式会社
中国石油化工股份有限公司
清华大学
鸿海精密工业股份有限公司
松下电器产业株式会社
上海交通大学
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  • [发明专利]数字频率合成器的时钟选择系统-CN202311031943.6有效
  • 董照琦 - 沐曦集成电路(上海)有限公司
  • 2023-08-16 - 2023-10-27 - H03K5/135
  • 本发明涉及集成电路技术领域,尤其涉及一种数字频率合成器的时钟选择系统,包括相位时钟变换模块、时钟选择模块和数字频率合成器,时钟变换模块用于获取原始时钟,进行转换,生成第一时钟、第二时钟、第三时钟和第四时钟,并分别通过第一通路、第二通路、第三通路和第四通路传输给数字频率合成器;时钟选择模块用于基于目标组合时钟,确定时钟控制序列,基于时钟控制序列确定每一时钟周期对应的每一通路的时钟选择信号,并分别发送给第一通路、第二通路、第三通路和第四通路,控制开启和关闭;数字频率合成器基于输入的时钟进行组合,生成目标组合时钟。本发明能够准确高效地选择时钟,生成目标组合时钟。
  • 数字频率合成器时钟选择系统
  • [发明专利]定时信号产生器-CN202210445115.6在审
  • 刘宇轩;庄咏竣 - 立锜科技股份有限公司
  • 2022-04-22 - 2023-10-24 - H03K5/135
  • 一种定时信号产生器,包含第一电流源、第一开关、第二电流源、第二开关、第三开关、电容、定时信号合成器、及时间差提取器。第一电流源用以根据输入电压产生第一电流。第一开关包含控制端用以接收充电信号。第二电流源用以根据输入电压产生第二电流。第二开关包含控制端用以接收时差信号。第三开关包含控制端用以接收重置信号。电容耦接于充电端与接地端之间。信号合成器用以根据充电电压及参考电压产生定时信号。时间差提取器用以根据定时信号及时差定时信号产生时差信号。
  • 定时信号产生器
  • [发明专利]一种计时装置用控制装置及其控制方法-CN202311154907.9在审
  • 黄飞燕;赵星亮;汤志平 - 宝捷时计电子(深圳)有限公司
  • 2023-09-08 - 2023-10-13 - H03K5/135
  • 本发明涉及一种计时装置用控制装置及其控制方法。本发明属于电子设备时序控制技术领域。该计时装置用控制装置,该装置包括,石英晶振构成的皮尔斯振荡网络模块、数字信号转换模块、定时控制模块、检测控制模块、调节控制模块与输出模块;所述皮尔斯振荡网络模块,其被配置为生成本地时钟信号,即时间数据;所述定时控制模块,其被配置为基于时间数据生成时序控制数据;所述调节控制模块,其被配置为调节皮尔斯振荡网络模块输出的时间数据;所述数字信号转换模块,其被配置为协调各模块的数字信号的输入、输出转换;该计时装置用控制装置及其控制方法,提高石英晶振构成的皮尔斯振荡网络模块输出的精度。
  • 一种计时装置控制及其方法
  • [发明专利]一种多时钟动态切换电路-CN201711391540.7有效
  • 白永强;罗旻;鲍东山 - 新岸线(北京)科技集团有限公司
  • 2017-12-21 - 2023-10-13 - H03K5/135
  • 本申请公开了一种多时钟动态切换电路,本申请采用的技术方案是:时钟输入端包括慢速时钟、参考时钟、低速时钟、中速时钟和高速时钟;时钟输出端包括第一输出时钟、第二输出时钟和第三输出时钟,在时钟输入端和时钟输出端之间包括:慢速时钟切换子电路、参考时钟切换子电路、低速时钟切换子电路、中速时钟切换子电路、高速时钟切换子电路;经上述子电路输出的结果进行或运算得到输出时钟。采用本发明的技术方案能够无毛刺动态切换SoC芯片所需要的高速时钟、中速时钟、低速时钟,参考时钟和慢速时钟并产生同步时钟域时钟相位指示信号和状态,满足了SoC芯片在高性能场景和多个低功耗场景之间的时钟切换需要。
  • 一种多时动态切换电路
  • [发明专利]基于授时脉冲校时的时钟电路、电子设备、芯片-CN202310889499.5有效
  • 陈越;陈子松 - 泉州艾奇科技有限公司
  • 2023-07-20 - 2023-10-10 - H03K5/135
  • 本发明属于脉冲技术领域,具体为一种基于授时脉冲校时的时钟电路、电子设备、芯片,其高频放大电路将长波授时信号进行放大,以形成第一正弦波信号并连接至混频电路,单片机发出脉冲波经过积分电路以形成第二正弦波信号亦连接至混频电路,第一正弦波信号与第二正弦波信号在混频电路中混频,形成携带有第三正弦波信号的信号,并通过混频电路的输出端输出;选频电路连接于混频电路之后,并对混频电路的输出进行选频,以输出第三正弦波信号;经过中频放大器高增益放大;整形放大电路用于第三正弦波信号进行整形和放大,以形成适合单片机读取的授时脉冲,单片机以此获取当前时间信息。本发明能够以极低成本实现智能物联网设备处于极其精准的时钟运行状态。
  • 基于授时脉冲时钟电路电子设备芯片
  • [发明专利]一种相位插值器和相位插值方法-CN202310507265.X有效
  • 吕伟;王晓阳;张晓辉 - 上海奎芯集成电路设计有限公司
  • 2023-05-05 - 2023-10-10 - H03K5/135
  • 本发明提供一种相位插值器和相位插值方法,利用第一波形斜率调整电路和第二波形斜率调整电路分别对第一相位的第一时钟信号和第二相位的第二时钟信号的波形进行斜率调整,并结合斜率反馈电路判断第一波形斜率调整电路具体将第一时钟信号的斜率调整到何种程度为止,具体基于斜率反馈电路判断第一波形斜率调整电路输出的时钟信号的波形斜率是否满足预设条件,在不满足预设条件的情况下同步调整第一波形斜率调整电路和第二波形斜率调整电路的电路参数,使得第一波形斜率调整电路和第二波形斜率调整电路输出的时钟信号的波形斜率满足预设条件,从而保证相位插值器的线性度在工艺角或温度变化的情况下也能满足预设线性度要求。
  • 一种相位插值器方法
  • [发明专利]时钟相移电路-CN201510337146.X有效
  • 刘永锋 - 意法半导体研发(深圳)有限公司
  • 2015-06-17 - 2023-09-29 - H03K5/135
  • 本公开的实施方式涉及时钟相移电路。具体地,一种电子设备包括第一电路,第一电路用于响应于具有第一逻辑电平的输入信号,当跨接收输入电流的第一电容器的第一电压超过阈值电压时生成输出控制信号。输入电流与输入信号的频率成比例。第二电路用于响应于具有第二逻辑电平的输入信号,当跨接收输入电流的第二电容器的第二电压超过阈值电压时生成输出复位信号。触发器用于响应于输出控制信号而将信号输出生成为具有第一逻辑电平,以及响应输出复位信号而将信号输出复位并且生成为具有第二逻辑电平。
  • 时钟相移电路
  • [发明专利]偏置信号生成电路与时钟输入电路-CN202210237656.X在审
  • 刘忠来 - 长鑫存储技术有限公司
  • 2022-03-11 - 2023-09-19 - H03K5/135
  • 本公开提供一种偏置信号生成电路和应用该偏置信号生成电路的时钟输入电路。偏置信号生成电路包括:第一支路,第一端通过第一节点连接电源电压,第二端通过第二节点连接电流稳定模块,第一支路用于产生偏置信号并通过第二节点输出偏置信号,电流稳定模块用于为第二节点提供恒定电流;第二支路,两端分别连接第一节点和第二节点,包括串联的第一电阻单元和第一开关元件,第一开关元件受控于低速模式控制信号开启或关闭;其中,低速模式控制信号用于控制第一开关元件开启以控制第二支路与第一支路并联,提高第二节点的偏置信号的偏置电压。本公开实施例可以实现对偏置电压的灵活调节,继而扩大偏置电路的应用范围。
  • 偏置信号生成电路时钟输入
  • [实用新型]信号延时电路以及存储读写装置-CN202320200830.3有效
  • 许应新;陈乃军;张耀文 - 摩星半导体(广东)有限公司
  • 2023-02-09 - 2023-09-19 - H03K5/135
  • 本申请提供一种信号延时电路以及存储读写装置,信号延时电路包括:多个延时模块,每个延时模块用于对自该延时模块的第一输入端和第二输入端输入的信号进行延时处理;多个延时模块依次串联形成串联结构,所述串联结构中第N个延时模块的第一输入端与第N‑1个延时模块的第一输出端连接,所述串联结构中第N个延时模块的第二输入端与第N+1个延时模块的第二输出端连接;其中,N为大于1且小于M的任意整数,M为多个延时模块的数量。本申请利用多个延时模块得到经过延时处理后的时钟信号,在控制芯片通过时钟信号访问外部存储装置时,可以避免由于数据采集时序紧张从而导致数据读写错误的现象。
  • 信号延时电路以及存储读写装置
  • [发明专利]一种线性度好的相位插值电路-CN202210895396.5有效
  • 李伟伟;魏来;高丹丹 - 灿芯半导体(苏州)有限公司
  • 2022-07-28 - 2023-09-01 - H03K5/135
  • 本发明公开了一种线性度好的相位插值电路,由数据时钟恢复电路、I路,Q路和IQ路组成,所述I路包括六个结构相同的I路电流电路,Q路包括六个结构相同的Q路电流电路,IQ路包括IQ路相位选择电路、两个IQ路常开电流电路和九个IQ路选择电流电路,I路电流电路分别连接数据时钟恢复电路和IQ路相位选择电路,本发明提供了一种线性度好的相位插值电路,保证数据时钟恢复电路恢复出来的时钟在采样数据的中心,使得数据采样的建立和保持时间都比较大,减小误码;本发明提供的相位插值电路,结构简单,可以减小系统复杂度和芯片面积。
  • 一种线性相位电路
  • [发明专利]时钟产生电路与时钟信号产生方法-CN202210144748.3在审
  • 陈聪明 - 瑞昱半导体股份有限公司
  • 2022-02-17 - 2023-08-29 - H03K5/135
  • 一种时钟产生电路,包括控制电路与相位内插器。控制电路转换输入信号以产生编码信号,并且根据指针调整编码信号的位排列,以产生包含多个控制位的控制信号。相位内插器包括第一驱动电路、第二驱动电路与用以输出内插的时钟信号的输出端。第一驱动电路接收第一时钟信号,并且响应于多个第一控制位开启或关闭多个第一驱动单元,以驱动第一时钟信号。第二驱动电路接收第二时钟信号,并且响应于多个第二控制位开启或关闭多个第二驱动单元,以驱动第二时钟信号。
  • 时钟产生电路信号方法
  • [发明专利]用于时间数字转换器的装置以及时间数字转换的方法-CN201710802849.4有效
  • 姚智伟 - 三星电子株式会社
  • 2017-09-08 - 2023-08-22 - H03K5/135
  • 提供了用于时间数字转换器的装置、时间数字转换的方法、制造时间数字转换器的方法和构建集成电路的方法。装置包括:延迟处理器;粗转换器和节点选择器,连接到延迟处理器,并被配置为选择延迟处理器的相邻级的相反极性的第一电压V1和第二电压V2;精细转换器,连接到粗转换器和节点选择器,并且被配置为确定与第一电压V1和第二电压V2相关的过零时刻;编码器,连接到粗转换器和节点选择器以及精细转换器,并且被配置为接收第一电压V1、第二电压V2和过零时刻,并对第一电压V1、第二电压V2和过零时刻进行编码,其中,V1是过零时刻之前的第一负电压,V2是过零时刻之后的第一正电压。
  • 用于时间数字转换器装置以及转换方法
  • [实用新型]直接脉冲产生电路-CN202223328117.1有效
  • 陈波;杨兆良 - 芯睿微电子(昆山)有限公司;昆山睿翔讯通通信技术有限公司
  • 2022-12-13 - 2023-08-22 - H03K5/135
  • 本申请实施例提供一种直接脉冲产生电路,属于电子电路技术领域,所述直接脉冲产生电路工作在超宽带频率,包括脉冲产生子电路和脉冲调制子电路,脉冲产生子电路用于产生至少n个延迟不同的脉冲信号;脉冲调制子电路为m个,用于将脉冲产生子电路输出的脉冲信号调制为脉冲控制信号,每个脉冲调制子电路的第一脉冲信号输入端和第二脉冲信号输入端分别与脉冲产生子电路的各脉冲信号输出端电连接,脉冲宽度控制信号输入端用于接收脉冲宽度控制信号,脉冲控制信号输出端用于输出脉冲控制信号。本申请实施例整个电路为全数字电路,功耗低,从而当该直接脉冲产生电路应用于脉冲雷达发射机芯片时提高了基于该芯片的UWB系统整机的待机和工作时间。
  • 直接脉冲产生电路
  • [发明专利]延迟单元-CN202110490607.2有效
  • 陈培炜;陈宪谷 - 连恩微电子有限公司
  • 2021-05-06 - 2023-08-11 - H03K5/135
  • 本发明提供一种延迟单元。第一输入晶体管耦接于一供应电源以及一第一输出端之间,具有控制端用以接收一第一输入信号。第二输入晶体管耦接于上述供应电源以及一第二输出端之间,具有控制端用以接收一第二输入信号。第一镜射晶体管耦接于一可变电流源以及一接地端之间,具有控制端耦接于上述可变电流源。第二镜射晶体管耦接于上述第一输出端以及上述接地端之间,具有控制端耦接于上述可变电流源。第三镜射晶体管耦接于上述第二输出端以及上述接地端之间,具有控制端耦接于上述可变电流源。可变电容耦接于上述第一以及第二输出端之间。
  • 延迟单元

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