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[发明专利]一种可变浮点数据微处理器-CN201510449047.0有效
发明人：周海林 -专利权人：成都腾悦科技有限公司
申请日： 2015-07-28 - 公布日： 2018-01-16 - 主分类号： G06F7/57 文献下载
摘要：本发明公开了一种可变浮点数据微处理器，浮点数由符号域、阶码域、尾数域组成，在程序使用自定义浮点数时需要配置自定义浮点配置寄存器0，自定义浮点配置寄存器1，自定义浮点配置寄存器2，自定义浮点配置寄存器3；自定义浮点数的组成顺序就是自定义浮点配置寄存器配置组成顺序，自定义浮点数组成顺序自定义浮点配置寄存器3，自定义浮点配置寄存器2，自定义浮点配置寄存器1，自定义浮点配置寄存器0；尾数域长度加阶码域长度加符号域长度等于浮点数据长度本发明在计算过程中可以改变浮点数中符号位、指数位和尾数位的顺序和长度，还有浮点数的宽度，可移植性好，而且可以表示更高精度的浮点数据，安全性也更高。
一种可变浮点数据微处理器

[发明专利]支持多格式半精度浮点的编译方法-CN202110324723.7在审
发明人：钱宏;管茂林;朱琪;吴伟;杨涛;王飞 -专利权人：无锡江南计算技术研究所
申请日： 2021-03-26 - 公布日： 2022-03-22 - 主分类号： G06F8/41 文献下载
摘要：本发明公开一种支持多格式半精度浮点的编译方法，包括以下步骤：S1、用户代码使用编译器提供的float16关键字来申明半精度浮点数据类型；S2、用户代码根据需要调用半精度浮点数据格式切换接口进行格式切换；S3、用户代码在切换半精度浮点数据格式后，调用编译器提供的半精度浮点数据转换接口进行数据格式转换；S4、在完成半精度浮点数据格式切换与数据转换后，用户程序在当前半精度浮点格式下进行后续的计算，需要再次切换半精度浮点格式时重复本发明可以在不增加代码编写复杂度的前提下发挥FP16和BF16两种半精度浮点格式的优势，满足应用场景使用半精度浮点加速计算的需求。
支持格式精度浮点编译方法

[发明专利]一种应用于8位单片机的浮点数显示方法和装置-CN201510507764.4在审
发明人：陈志杰;宋志超 -专利权人：深圳市振邦智能科技有限公司
申请日： 2015-08-18 - 公布日： 2015-12-23 - 主分类号： G06F7/57 文献下载
摘要：本发明适用于单片机领域，提供了一种应用于8位单片机的浮点数显示方法，以解决8位单片机中浮点数运算降低代码运行效率进而影响单片机性能的问题。所述方法包括：获取待显示浮点数的计算公式；根据所述待显示浮点数显示精度的要求，对所述计算公式进行乘以10ⁿ处理，所述n为自然数；对所述乘以10ⁿ处理后的计算公式进行整数计算得到所述待显示浮点数的每一位显示值通过本发明，将浮点运算简化为整数运算，在不需要强制转换变量类型和浮点数运算的情况下得到相同精度的浮点数显示值，从而提高代码运行效率，使产品性能更优。
一种应用于单片机浮点显示方法装置

[发明专利]嵌入控制装置-CN200910004934.1有效
发明人：藤本慎哉;大川圭一朗 -专利权人：株式会社日立制作所
申请日： 2009-02-20 - 公布日： 2009-10-07 - 主分类号： G06F7/57 文献下载
摘要：本发明提供一种嵌入控制装置，能够确保基于浮点数形式的数据的运算精度，并且能够避免存储装置的存储区域的不足。根据基于本发明的嵌入控制装置，在将浮点数形式的离散数据保存在读取专用存储装置中时，将浮点数形式的离散数据转换为尾数部缩短型浮点数形式的数据后保存。这里，所谓尾数部缩短型浮点数是从浮点数的尾数部中删除了低位比特后的数据。进一步地，在根据离散数据进行插值运算时，将保存在读取专用存储装置中的尾数部缩短型浮点数形式的离散数据恢复为浮点数形式的离散数据后进行插值运算。
嵌入控制装置

[发明专利]基于posit数据格式的浮点数乘法运算方法及装置-CN202010138192.8有效
发明人：王中风;徐铭阳;方超;林军 -专利权人：南京大学
申请日： 2020-03-03 - 公布日： 2023-03-14 - 主分类号： G06F7/487 文献下载
摘要：本申请提供了一种基于posit数据格式的浮点数乘法运算方法及装置。所述方法包括：获取第一浮点数和第二浮点数之后，分别对第一浮点数和第二浮点数进行分析，根据分析后得到的值，确定目标浮点数。采用posit数据格式进行乘法运算，则可以在0附近保证精度的同时，又可以很大程度的减少数据位宽，从而减少神经网络的训练时间，也降低了对于存储，位宽等资源的需求。
基于 posit 数据格式浮点乘法运算方法装置

[发明专利]基于低精度浮点数数据表现形式的CNN硬件加速计算方法及系统-CN201910940659.8有效
发明人：吴晨;王铭宇;徐世平 -专利权人：梁磊
申请日： 2019-09-30 - 公布日： 2022-10-04 - 主分类号： G06N3/04 文献下载
摘要：本发明公开了基于低精度浮点数数据表现形式的CNN硬件加速计算方法及系统，涉及CNN加速计算领域；其加速计算方法包括步骤：浮点数功能模块根据控制信号从存储系统中接收输入激活值和权重，将输入激活值和权重分发至不同的处理单元PE进行卷积计算，完成CNN加速计算；卷积计算包括对通过低精度浮点数表现形式量化的MaEb浮点数进行点积计算完成的卷积层的前向计算；本发明通过计算和使用低精度浮点数表现形式MaEb，实现在不需要重新训练的情况下，保证量化后CNN的准确率；通过进行低精度浮点数乘法运算，通过DSP实现Nm个MaEb浮点数乘法器，实现在保证准确率的情况下，大大提升定制电路或者非定制电路上加速的性能
基于精度浮点数据表现形式 cnn 硬件加速计算方法系统

[发明专利]高精度雷达信号运算芯片的数据处理架构和运算芯片系统-CN202310287014.5在审
发明人：肖国尧;肖凯;全英汇;赵佳琪;于沅弘 -专利权人：西安电子科技大学
申请日： 2023-03-22 - 公布日： 2023-07-25 - 主分类号： G06G7/16 文献下载
摘要：本发明公开了一种高精度雷达信号运算芯片的数据处理架构，包括：连接为阵列的若干个PE单元及多个超级计算单元；超级计算单元内集成有除法器和开根号器；PE单元包括单精度浮点加法器、乘法器、数据选择器MUX0～MUX2、D触发器、单精度浮点数据端口A、B、C、D、E、S、M及控制MUX0～MUX2的PE功能控制端口M0～M2；PE单元通过端口M0～M2的不同配置方式实现实数运算功能，且通过阵列中不同位置、不同数量的本发明能实现高速浮点实数或复数基本运算，具备雷达常用算法、计算通用性。
高精度雷达信号运算芯片数据处理架构系统

[发明专利]一种基于CORDIC算法的可重构浮点运算装置-CN201810574109.4有效
发明人：胡善清;方琳琳;李炳沂;谢宜壮;陈亮 -专利权人：北京理工大学
申请日： 2018-06-06 - 公布日： 2022-11-25 - 主分类号： G06F7/57 文献下载
摘要：一种基于CORDIC算法的可重构浮点运算装置，其包括：预处理模块，用于完成输入数据从IEEE‑754标准的单精度浮点格式到定点格式的转换，并将其映射到收敛域内；串‑并混合的可重构CORDIC迭代单元模块用于串行流水结构的实现，实现模块复用最大化，旋转模块B基于旋转方向并行预测方法，采用树状加法器结构，用于旋转模式下并行结构的实现；在后处理模块，根据预处理模块的编码信号选择相应的结果输出，并完成尾数的规格化处理，输出单精度浮点数据格式计算结果；本发明具有原理简单、低延迟、高精度、硬件开销低的特点。
一种基于 cordic 算法可重构浮点运算装置

[发明专利]浮点数矩阵的处理方法、装置、设备及计算机可读存储介质-CN201710165155.4有效
发明人：欧阳剑;周妮;王勇;漆维 -专利权人：北京百度网讯科技有限公司
申请日： 2017-03-20 - 公布日： 2022-11-25 - 主分类号： G06F17/16 文献下载
摘要：本发明提供一种浮点数矩阵的处理方法、装置、设备及计算机可读存储介质。本发明实施例通过根据待压缩的浮点数模型矩阵，获取所述浮点数模型矩阵的最小值和所述浮点数模型矩阵的最大值，进而根据所述数位宽度、所述浮点数模型矩阵的最小值和所述浮点数模型矩阵的最大值，对所述浮点数模型矩阵进行压缩处理，以获得定点数模型矩阵，通过采用定点化方法，对深度学习模型的浮点数模型矩阵进行压缩处理，以获得定点数模型矩阵，从而降低了深度学习模型的存储空间和运算量，同时提出该装置在深度学习网络中的实现框架以最大化深度学习网络精度，即矩阵乘法部分用该装置，其它部分例如激活函数等操作保留浮点操作。
浮点矩阵处理方法装置设备计算机可读存储介质

[发明专利]一种基于浮点数类型转换和运算的不透明谓词代码混淆装置及方法-CN202211455879.X在审
发明人：王庆丰;扈红超;梁浩;王亚文;程国振;刘文彦;仝玉;吴燕鹏;商珂;霍树民;范学云 -专利权人：中国人民解放军战略支援部队信息工程大学
申请日： 2022-11-21 - 公布日： 2023-05-16 - 主分类号： G06F8/41 文献下载
摘要：本发明公开一种基于浮点数类型转换和运算的不透明谓词代码混淆装置及方法，该装置包括浮点数类型转换精度损失数字收集模块、浮点数加法运算精度损失数字收集模块、浮点数乘法运算精度损失数字收集模块、不透明谓词数据库本发明通过预先收集的符合条件的浮点数或者浮点数对，可以构造一系列不透明谓词用于对目标软件进行代码混淆。
一种基于浮点类型转换运算不透明谓词代码混淆装置方法

[发明专利]浮点数运算方法及装置-CN202010815069.5在审
发明人：张伟;潘秋萍;黄江乐;徐晓忻 -专利权人：华为技术有限公司
申请日： 2020-08-13 - 公布日： 2022-02-22 - 主分类号： G06F7/485 文献下载
摘要：一种浮点数运算方法，该方法包括：根据预存关系确定第一浮点数的第一存储位置和第二浮点数的第二存储位置，所述预存关系用于记录所述浮点数运算中多个浮点数排序结果和每个浮点数的存储位置的对应关系；根据所述第一存储位置和所述第二存储位置分别获取所述第一浮点数和所述第二浮点数；根据所述浮点数运算的类型，完成所述第一浮点数和所述第二浮点数的运算处理。
浮点运算方法装置

[发明专利]进行浮点数或定点数乘加运算的装置和方法-CN201910734434.7有效
发明人：解玉凤;王渝;胡显武;冯佳韵;闫石林;吴丹青 -专利权人：复旦大学
申请日： 2019-08-09 - 公布日： 2023-06-23 - 主分类号： G06F7/57 文献下载
摘要：本发明提供一种进行浮点数或定点数乘加运算的架构，其特征在于，包括：缓冲存储器，用于对输入的多个浮点数或定点数进行缓冲存储，浮点数包含浮点指数以及浮点尾数；计算单元阵列，含有多列至少包含一个乘法计算单元的乘法单元列，每一列乘法单元列连接到一个加法计算单元；浮点控制与运算器模块，至少包括指数运算器、尾数移位加法器、移位校正器；外部输入输出接口，用于将浮点数输入给缓冲存储器或将浮点乘加结果输出。本发明的架构可以扩展为任意精度，兼顾计算效率和计算精度；同时兼容多种存储器结构，具有极高的适应性。本架构可经过适当修改变体为在存储器内部进行任意精度定点数运算。
进行浮点点数运算装置方法

[发明专利]一种浮点倒数和/或平方根倒数运算方法及其装置-CN201510037527.6有效
发明人：王惠娟;肖偌舟;林玻;刘檬;张志伟 -专利权人：中国科学院自动化研究所
申请日： 2015-01-26 - 公布日： 2017-05-31 - 主分类号： G06F7/57 文献下载
摘要：本发明公开了一种浮点倒数和/或平方根倒数运算方法及装置。所述方法包括根据输入的浮点数获取查找地址；根据所述查找地址从浮点数的倒数或平方根倒数尾数查找表中进行查找，得到所述浮点数的倒数或平方根倒数的尾数；计算得到所述浮点数的倒数或平方根倒数的指数；计算得到所述浮点数的倒数或平方根倒数的符号位；根据所述浮点数的倒数或平方根倒数的指数、尾数和符号位得到所述浮点数的倒数或平方根倒数的运算结果。本发明通过硬件查表获得尾数计算结果，该硬件查找表可配置可复用，根据不同精度要求获得不同位宽输出结果，通过计算获得指数部分结果，最终得到一个硬件计算结果供软件迭代使用。
一种浮点倒数平方根运算方法及其装置

[发明专利]一种浮点数计算电路以及浮点数计算方法-CN202080102852.5在审
发明人：蒋东龙;董镇江;谢环;李震桁 -专利权人：华为技术有限公司
申请日： 2020-10-31 - 公布日： 2023-03-17 - 主分类号： G06F7/485 文献下载
摘要：一种浮点数计算电路(100)以及浮点数计算方法，浮点数计算电路(100)包括的拆分电路(102)拆分第一浮点数的尾数部分与第二浮点数的尾数部分。计算电路(105)根据拆分后的各尾数部分以及拆分后的各尾数部分的第二移位数计算第一浮点数与所述第二浮点数的尾数部分的乘积。该浮点数计算电路(100)可以把位数较大的浮点数拆分为位数较小的浮点数，从而采用较小位数的乘法器来计算该位数较大的浮点数，该浮点数计算电路(100)时序开销短，硬件设计代价低，合理的利用了乘法器的计算性能
一种浮点计算电路以及计算方法

[发明专利]基于原子状态函数的浮点数误差检测方法和装置-CN202010056313.4有效
发明人：邹达明;曾沐焓;熊英飞;张路 -专利权人：北京大学
申请日： 2020-01-18 - 公布日： 2021-04-20 - 主分类号： G06F11/36 文献下载
摘要：本发明涉及一种基于原子状态函数的浮点数误差检测方法和装置。本发明对源代码或程序进行插桩以获取程序运行时的内部状态；通过程序运行时的内部状态，计算每个浮点数运算的原子状态函数，挖掘原子状态函数与浮点数误差的内在联系，推断出原子状态函数与误差的强关联性；构建搜索框架，利用搜索算法得到会触发高危原子状态函数的测试用例集合；该测试用例集合即为揭错率高，会触发显著浮点数误差的输入。由于计算原子状态函数不需要引入高精度浮点数，不依赖于测试预言，使得本发明不依赖于测试预言，并且揭错率高，运行开销小，不依赖于高精度浮点数，运行时间快。
基于原子状态函数浮点误差检测方法装置