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农业化学；冶金建筑机械工程区域搜索

主分类

B 作业；运输

C 化学；冶金

D 纺织；造纸

E 固定建筑物

F 机械工程、照明、加热

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公布日期

2023-10-24 公布专利

2023-10-20 公布专利

2023-10-17 公布专利

2023-10-13 公布专利

2023-10-10 公布专利

2023-10-03 公布专利

2023-09-29 公布专利

2023-09-26 公布专利

2023-09-22 公布专利

2023-09-19 公布专利

专利权人

国家电网公司

华为技术有限公司

中兴通讯股份有限公司

三星电子株式会社

中国石油化工股份有限公司

鸿海精密工业股份有限公司

松下电器产业株式会社

上海交通大学

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[发明专利]内插器-CN201980086383.X在审
发明人：李钟旻;李吉善;申正均;安咏晙 -专利权人：阿莫善斯有限公司
申请日： 2019-11-04 - 公布日： 2021-08-06 - 主分类号： H01L23/00 文献下载
摘要：本发明涉及一种内插器(300)，其中内插器(300)包括：由陶瓷材料制成的支撑体(310)；用于连接支撑体(310)的上表面和下表面的连接电极(320)；以及设置在支撑体的外表面上的屏蔽材料(330)，内插器(300)的至少一部分沿着基板(100)的边缘设置，并将基板(100)电连接到基板(200)。
内插

[发明专利]内插器-CN202010696794.5在审
发明人：桥本信一;白井浩史;相泽正幸 -专利权人：泰科电子日本合同会社
申请日： 2020-07-20 - 公布日： 2021-01-29 - 主分类号： H01R33/76 文献下载
摘要：本发明提供了内插器，其使沿宽度方向邻接的两个信号接触件的间隔比基部彼此的间隔窄，从而使电气特性提高。第一信号接触件(40A)和第二信号接触件(40B)形成信号接触件对(40P)。
内插

[发明专利]内插器-CN201710187735.3有效
发明人：李永胜 -专利权人：上海兆芯集成电路有限公司
申请日： 2017-03-27 - 公布日： 2020-06-09 - 主分类号： H03K5/134 文献下载
摘要：一种内插器，包括一第一延迟电路、一第二延迟电路以及一可调延迟电路。第一延迟电路将一第一输入信号延迟一固定延迟时间，以产生一第一输出信号。可调延迟电路将第一输入信号延迟一可调延迟时间，以产生一输出内插信号。可调延迟时间根据第一输出信号、第二输出信号以及输出内插信号而决定。本发明的内插器具有高准确度的特性。
内插

[发明专利]内插器-CN90106540.4无效
发明人：伊安·卡尔·布尔林 -专利权人：兰克·泰勒·霍布森有限公司
申请日： 1990-06-23 - 公布日： 1993-10-20 - 主分类号： G01B11/00 文献下载
摘要：一种内插器，特别是在计量装置中和光栅一起使用，用于检测位置，它接收正交的输入信号。对输入信号中的一个进行平方并把两个输入信号乘在一起，以提供频率为输入信号频率二倍频的进一步的正交信号。在所说明的计量装置中，检测输出信号的过零点以实现对表面传感器的输出高分辨率的采样。在高频范围会产生内插噪声，通过对来自表面传感器的采样信号进行低通滤波可以滤掉噪声。
内插

[发明专利]数字内插器与内插方法-CN201510289337.3有效
发明人： M·布拉科 -专利权人：斯沃奇集团研究和开发有限公司
申请日： 2015-05-29 - 公布日： 2017-11-21 - 主分类号： H03H17/06 文献下载
摘要：本发明涉及数字内插器，其包括在第一时钟频率(f1)上接收输入信号的输入(12)，并且包括在第二时钟频率(f2)上提供内插信号的输出(18)，该第二时钟频率(f2)大于第一时钟频率(f1)。内插器包括连接到输入(12)的微分器(20)，连接到微分器输出(25)的内插器级(30)，以及连接到输出(18)并连接到内插器级(30)的输出(39)的积分器(40)。
数字内插方法

[发明专利]内插模块、内插器及其方法-CN200610006377.3有效
发明人：黄柏钧;林佳欣 -专利权人：威盛电子股份有限公司
申请日： 2006-01-20 - 公布日： 2006-08-23 - 主分类号： H04L27/26 文献下载
摘要：一种内插模块，其用于恢复一时序恢复电路的时序，包括：一第一符号反向单元、一内插器、以及一第二符号反向单元。该内插器，耦接于该第一符号反向单元，其用于依据一分数区间值来内插该第一反向信号内的该多个取样值，以产生一内插信号，其中该内插信号包含有多个内插子。该第二符号反向单元，耦接于该内插器，其用于将该内插信号的相位作180度反向以输出一第二反向信号。
内插模块及其方法

[发明专利]内插器和内插器的制造方法-CN201911318497.0在审
发明人：桥本信一;白井浩史;相泽正幸 -专利权人：泰科电子日本合同会社
申请日： 2019-12-19 - 公布日： 2020-06-26 - 主分类号： H01R13/24 文献下载
摘要：本发明提供适于小间距化的构造的内插器及其制造方法。对于该内插器(10)，考虑将壳体(20)沿该第一面(20A)与第二面(20B)重叠的方向投影。此时，构成该内插器(10)的接触件(30)处于第一接点部(321)和第二接点部(331)两者从贯通孔(21)的贯通的区域(D1)超出的位置。这样，该内插器(10)成为适于小间距化的构造。该构造通过例如在将接触件(30)压入至贯通孔(21)内后进一步弯折而完成。
内插制造方法

[发明专利]相位内插器与内插法-CN202111155896.7在审
发明人：安德鲁斯·雅各布松 -专利权人：华为技术有限公司
申请日： 2016-12-16 - 公布日： 2022-01-18 - 主分类号： H03L7/081 文献下载
摘要：一种用于接收具有第一和第二输入时钟边沿(111、121)的第一和第二输入时钟(110、120)的相位内插器(100)包括内插电路单元，所述内插电路单元包括：并联的电阻(153a、153b)；对于每个电阻所述相位内插器(100)允许控制所述连接开关(157a)的一部分根据所述第一输入时钟(110)进行操作，并允许控制所述连接开关(157b)的其余部分根据所述第二输入时钟(120)进行操作；以及基于所述内插电路单元(150)的输出信号(170)确定所述相位内插器(100)的所述输出时钟(130)，所述输出信号(170)由所述第二输入时钟边沿(121)之后的所述电容(161)上的电压定义。
相位内插内插法

[发明专利]相位内插器与内插法-CN201680091643.9有效
发明人：安德鲁斯·雅各布松 -专利权人：华为技术有限公司
申请日： 2016-12-16 - 公布日： 2021-10-01 - 主分类号： H03L7/081 文献下载
摘要：一种用于接收具有第一和第二输入时钟边沿(111、121)的第一和第二输入时钟(110、120)的相位内插器(100)包括内插电路单元，所述内插电路单元包括：并联的电阻(153a、153b)；对于每个电阻所述相位内插器(100)允许控制所述连接开关(157a)的一部分根据所述第一输入时钟(110)进行操作，并允许控制所述连接开关(157b)的其余部分根据所述第二输入时钟(120)进行操作；以及基于所述内插电路单元(150)的输出信号(170)确定所述相位内插器(100)的所述输出时钟(130)，所述输出信号(170)由所述第二输入时钟边沿(121)之后的所述电容(161)上的电压定义。
相位内插内插法

[发明专利]电压内插器-CN202211044478.5在审
发明人： G·莫拉普查尔特;I·C·米蒂纳桑奇斯卡斯特罗;J·博纳什马丁内斯 -专利权人：亚德诺半导体国际无限责任公司
申请日： 2022-08-30 - 公布日： 2023-03-03 - 主分类号： H03M1/36 文献下载
摘要：本公开涉及电压内插器。描述了在不加载两个电压并且不需要显著功率或额外面积的情况下内插两个电压的技术。
电压内插

[发明专利]相位内插器-CN201610737453.1有效
发明人：陈建文 -专利权人：瑞昱半导体股份有限公司
申请日： 2016-08-26 - 公布日： 2021-08-20 - 主分类号： H03K5/13 文献下载
摘要：本公开提供一种相位内插器，包含多个差动对、开关电路、输出级以及校正电路。多个差动对响应于第一组输入信号与第二组输入信号产生第一信号与第二信号。本公开所提供的相位内插器可通过多个校正机制改善相位内插器的准确度，以取得具有高精准度的输出信号。
相位内插

[发明专利]内插器组件-CN201811236106.6有效
发明人：桥本信一 -专利权人：泰科电子日本合同会社
申请日： 2018-10-23 - 公布日： 2023-10-27 - 主分类号： H01R12/71 文献下载
摘要：本发明提供一种缩短内插器接触件的对信号传送没有贡献的部分长度的内插器组件。在壳体(20)中，形成有具有第一壁面(211)以及第二壁面(212)的接触件配置孔(21)。内插器接触件(30)具有形成有肩部(311)的基部(31)和接触臂部(32)。基部(31)配置为靠近第一壁面(211)。防脱突部(211a)抑制内插器接触件(30)从接触件配置孔21的脱离。在狭缝部(213)中，插入各个肩部(311)。而且，狭缝部(213)阻止内插器接触件(30)向第二壁面(212)侧的移动。
内插组件

[发明专利]相位内插器-CN200680042548.6无效
发明人： Y·范;I·A·扬 -专利权人：英特尔公司
申请日： 2006-12-08 - 公布日： 2008-11-19 - 主分类号： H03H11/16 文献下载
摘要：相位内插器包括第一电路和相位混合器(105)，所述第一电路产生具有第一相位延迟的第一信号(PHIN0)和具有第二相位延迟的第二信号(PHIN1)。将相位混合器(105)耦合成从所述第一电路接收第一和第二信号。相位混合器(105)包括多个电流驱动器(510)，每一个电流驱动器包括电流驱动器输入端和电流驱动器输出端，所述电流驱动器输入端被耦合成选择性地延迟第一或第二信号中的一个，所述电流驱动器输出端被耦合成输出相位延迟信号将电流驱动器(510)的电流驱动器输出端(01)耦合到一起以组合来自电流驱动器的相位延迟信号，从而生成具有从第一信号(PHIN0)和第二信号(PHIN1)内插的相位的输出相位延迟信号。
相位内插

[发明专利]相位内插器和实施相位内插器的方法-CN201680080390.5有效
发明人： C·赫恩;P·乌帕德亚雅;K·吉尔里 -专利权人：赛灵思公司
申请日： 2016-11-16 - 公布日： 2022-05-03 - 主分类号： H03K5/135 文献下载
摘要：本申请描述了用来产生时钟信号的、在集成电路中实施的相位内插器。所述相位内插器包括：被耦接成接收多个时钟信号的多个输入(121)；多个晶体管对(330、332、340、342)，每个晶体管对具有被耦接到第一输出节点(310)的第一晶体管和被耦接到第二输出节点(314)的第二晶体管，其中与所述晶体管对相关联的第一时钟信号被耦接到所述第一晶体管的栅极，并且与所述晶体管对相关联的第一时钟信号的反相信号被耦接到所述第二晶体管的栅极；被耦接到所述第一输出节点的第一有源电感器负载(308)；以及被耦接到所述第二输出节点的第二有源电感器负载(312)。
相位内插实施方法

[发明专利]相位内插器、多相位内插装置及内插时钟的产生方法-CN201110303531.4有效
发明人：谷立军 -专利权人：瑞昱半导体股份有限公司
申请日： 2011-10-09 - 公布日： 2013-04-10 - 主分类号： H03K5/15 文献下载
摘要：一种相位内插器、多相位内插装置、内插时钟的产生方法及多相位的时钟产生方法，其关于具有差动转单端转换器、负载电路、二差动对、电流产生电路、至少一电流源以及至少一开关对的相位内插器。利用开关对控制电流源提供给共享负载电路的二差动对的电流，并且通过调节负载电路的负载大小和/或电流源的参考电流的大小，使第一输出信号和第二输出信号的交点落在第一输入时钟与第二输入时钟重叠的时间内，以致于可内插出均匀的多相位输出时钟
相位内插多相装置时钟产生方法

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