[发明专利]鉴相器、延迟锁相环电路及信号处理方法在审
| 申请号： | 202310587772.9 | 申请日： | 2023-05-23 |
| 公开（公告）号： | CN116667845A | 公开（公告）日： | 2023-08-29 |
| 发明（设计）人： | 杨剑儒;任丛飞 | 申请（专利权）人： | 北京奕斯伟计算技术股份有限公司 |
| 主分类号： | H03L7/085 | 分类号： | H03L7/085;H03L7/081 |
| 代理公司： | 北京市立方律师事务所 11330 | 代理人： | 陈振玉 |
| 地址： | 100176 北京市大兴区北京经*** | 国省代码： | 北京;11 |
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| 摘要： | 本申请实施例提供了一种鉴相器、延迟锁相环电路及信号处理方法，涉及集成电路技术领域。鉴相器包括：边沿检测电路和SR锁存器，其中，边沿检测电路，其用于在输入时钟信号的上升沿对反馈时钟信号进行采样，并将反馈时钟信号的采样结果输出至SR锁存器；SR锁存器，其用于根据采样结果和输入时钟信号，确定输出端Q的输出信号。本申请实施例中的鉴相器中设置了边沿检测电路和SR锁存器，因此，可以采用边沿采样方式检测两个输入信号的相位关系，使得相位关系的判断更加容易，且由于该鉴相器的输出信号不是周期性的脉冲信号，因此能够消除鉴相死区的影响。 | ||
| 搜索关键词： | 鉴相器 延迟 锁相环 电路 信号 处理 方法 | ||
【主权项】：
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