[实用新型]一种多模存储电路有效
| 申请号： | 201920863907.9 | 申请日： | 2019-06-10 |
| 公开（公告）号： | CN209785555U | 公开（公告）日： | 2019-12-13 |
| 发明（设计）人： | 陈弈星;曹毅;于钦杭 | 申请（专利权）人： | 南京芯视元电子有限公司 |
| 主分类号： | G11C11/406 | 分类号： | G11C11/406;G11C11/408 |
| 代理公司： | 32224 南京纵横知识产权代理有限公司 | 代理人： | 耿英;董建林 |
| 地址： | 210012 江苏省南京市雨*** | 国省代码： | 江苏;32 |
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| 摘要： | 本实用新型提出了一种多模存储电路，包括DAC输入模块、存储阵列、地址分组译码选择电路以及ADC输出模块。输入的多位数据经过DAC输入模块转换成对应的电压梯度，由地址分组译码选择模块选择存储阵列中对应的存储单元存储，ADC输出模块将接收的电压或电流信号进行量化输出相应的数字信号，从而降低存储单元输入输出端的寄生参数，减少了存储单元的数量，达到数据高速传输以及低功耗、低成本的要求。 | ||
| 搜索关键词： | 存储单元 分组译码 输出模块 输入模块 存储单元存储 数据高速传输 本实用新型 存储电路 存储阵列 电流信号 电压梯度 多位数据 寄生参数 数字信号 选择存储 选择电路 选择模块 输出 低成本 低功耗 多模 量化 转换 | ||
【主权项】：
1.一种多模存储电路，其特征在于，包括DAC输入模块、地址分组译码选择电路、存储阵列以及ADC输出模块；/n由DAC输入模块将多位数据转换成相应的电流或电压数据信号输出到存储阵列中，地址分组译码选择电路产生分组控制信号SEL、读控制信号READ和写控制信号WRITE选择存储阵列中相应的存储单元进行读写操作，将存储单元中的数据读写至ADC输出模块，经ADC输出模块转换后输出。/n
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