[发明专利]半导体集成电路布局的设计方法和制造半导体装置的方法在审
| 申请号： | 201711021953.6 | 申请日： | 2017-10-26 |
| 公开（公告）号： | CN108063119A | 公开（公告）日： | 2018-05-22 |
| 发明（设计）人： | 朴相俊;金柄成;朴哲弘;朴春烨 | 申请（专利权）人： | 三星电子株式会社 |
| 主分类号： | H01L21/82 | 分类号： | H01L21/82;H01L27/02 |
| 代理公司： | 广州华进联合专利商标代理有限公司 44224 | 代理人： | 刘培培;黄隶凡 |
| 地址： | 韩国京畿道水*** | 国省代码： | 暂无信息 |
| 权利要求书： | 查看更多 | 说明书： | 查看更多 |
| 摘要： | 一种半导体集成电路布局的设计方法和一种制造半导体装置的方法，所述设计方法包含选择包含至少一个第一栅极图案的第一单元布局；选择包含至少一个第二栅极图案的第二单元布局，所述至少一个第二栅极图案具有与所述至少一个第一栅极图案的栅极长度不同的栅极长度；从第一单元布局和第二单元布局生成图案布局；以及在图案布局上生成选择性交叠第一单元布局的掩模布局。 | ||
| 搜索关键词： | 半导体 集成电路 布局 设计 方法 制造 装置 | ||
【主权项】：
1.一种半导体集成电路布局的设计方法，包括：选择包含至少一个第一栅极图案的第一单元布局；选择包含至少一个第二栅极图案的第二单元布局，所述至少一个第二栅极图案具有与所述至少一个第一栅极图案的栅极长度不同的栅极长度；根据所述第一单元布局和所述第二单元布局生成图案布局；以及在所述图案布局上生成选择性交叠所述第一单元布局的掩模布局。
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H01 基本电气元件
H01L 半导体器件；其他类目中不包括的电固体器件
H01L21-00 专门适用于制造或处理半导体或固体器件或其部件的方法或设备
H01L21-02 .半导体器件或其部件的制造或处理
H01L21-64 .非专门适用于包含在H01L 31/00至H01L 51/00各组的单个器件所使用的除半导体器件之外的固体器件或其部件的制造或处理
H01L21-66 .在制造或处理过程中的测试或测量
H01L21-67 .专门适用于在制造或处理过程中处理半导体或电固体器件的装置；专门适合于在半导体或电固体器件或部件的制造或处理过程中处理晶片的装置
H01L21-70 .由在一共用基片内或其上形成的多个固态组件或集成电路组成的器件或其部件的制造或处理；集成电路器件或其特殊部件的制造
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