[发明专利]MTP器件及其制造方法有效
申请号: | 201710960907.6 | 申请日: | 2017-10-17 |
公开(公告)号: | CN107799526B | 公开(公告)日: | 2020-04-10 |
发明(设计)人: | 许贻梅 | 申请(专利权)人: | 上海华虹宏力半导体制造有限公司 |
主分类号: | H01L27/11521 | 分类号: | H01L27/11521;H01L27/11526 |
代理公司: | 上海浦一知识产权代理有限公司 31211 | 代理人: | 郭四华 |
地址: | 201203 上海市浦东*** | 国省代码: | 上海;31 |
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摘要: | 本发明公开了一种MTP器件,包括:作为选择管、存储管和字线管的第一至三NMOS管都形成于P阱中,位于中间的第二NMOS管的多晶硅栅为多晶硅浮栅,多晶硅浮栅的第一延伸端形成编程耦合结构,第二延伸端形成擦除结构;多晶硅浮栅的第二延伸端跨越由第一N阱组成的第一有源区;擦除结构还包括第一P+区和第一N+区,两注入区在沿和多晶硅浮栅的第二延伸端平行的方向上相互交叠于第一有源区,交叠区大小根据第一N+区和第一有源区的套刻精度确定,保证在套刻偏差最大的条件下能实现有效擦除的交叠结构。本发明还公开了一种MTP器件的制造方法。本发明能提高器件的擦除效率,防止MTP擦除失败以及由此而带来的测试失效的问题。 | ||
搜索关键词: | mtp 器件 及其 制造 方法 | ||
【主权项】:
一种MTP器件,其特征在于,包括:由第一NMOS管组成的选择管,由第二NMOS管组成的存储管,由第三NMOS管组成的字线管;所述第一NMOS管、所述第二NMOS管和所述第三NMOS管都形成于P阱中,所述第一NMOS管的多晶硅栅连接栅选择信号,所述第二NMOS管的多晶硅栅为多晶硅浮栅,所述第三NMOS的多晶硅栅连接字线;所述多晶硅浮栅位于所述第一NMOS管的多晶硅栅和所述第三NMOS的多晶硅栅的中间,所述第二NMOS管位于所述第一NMOS管和所述第三NMOS管的中间;所述多晶硅浮栅沿所述第二NMOS管的沟道的宽度方向延伸到所述第二NMOS管的两侧,所述多晶硅浮栅的第一延伸端在所述第二NMOS管的第一侧形成编程耦合结构,所述多晶硅浮栅的第二延伸端在所述第二NMOS管的第二侧形成擦除结构;所述擦除结构形成于第一N阱中,所述多晶硅浮栅的第二延伸端跨越由所述第一N阱组成的第一有源区;所述擦除结构还包括第一P+区和第一N+区,所述第一P+区的注入区和所述第一N+区的注入区在沿和所述多晶硅浮栅的第二延伸端垂直的方向上跨越所述多晶硅浮栅;所述第一P+区的注入区和所述第一N+区的注入区在沿和所述多晶硅浮栅的第二延伸端平行的方向上相互交叠;所述第一P+区的注入区和所述第一N+区的注入区的交叠区的大小根据所述第一N+区的注入区和所述第一有源区的套刻精度确定,保证在所述第一N+区的注入区和所述第一有源区的套刻偏差最大的条件下,注入后形成的所述第一N+区依然会和所述第一有源区形成能实现有效擦除的交叠结构。
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H01 基本电气元件
H01L 半导体器件;其他类目中不包括的电固体器件
H01L27-00 由在一个共用衬底内或其上形成的多个半导体或其他固态组件组成的器件
H01L27-01 .只包括有在一公共绝缘衬底上形成的无源薄膜或厚膜元件的器件
H01L27-02 .包括有专门适用于整流、振荡、放大或切换的半导体组件并且至少有一个电位跃变势垒或者表面势垒的;包括至少有一个跃变势垒或者表面势垒的无源集成电路单元的
H01L27-14 . 包括有对红外辐射、光、较短波长的电磁辐射或者微粒子辐射并且专门适用于把这样的辐射能转换为电能的,或适用于通过这样的辐射控制电能的半导体组件的
H01L27-15 .包括专门适用于光发射并且包括至少有一个电位跃变势垒或者表面势垒的半导体组件
H01L27-16 .包括含有或不含有不同材料结点的热电元件的;包括有热磁组件的
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