[发明专利]三维存储器及其形成方法有效
申请号: | 201710751281.8 | 申请日: | 2017-08-28 |
公开(公告)号: | CN107482013B | 公开(公告)日: | 2018-09-18 |
发明(设计)人: | 吕震宇;黄郁茹;陶谦;胡禺石;陈俊;戴晓望;朱继锋;李勇娜;宋立东 | 申请(专利权)人: | 长江存储科技有限责任公司 |
主分类号: | H01L27/11556 | 分类号: | H01L27/11556;H01L27/11582 |
代理公司: | 北京辰权知识产权代理有限公司 11619 | 代理人: | 刘广达 |
地址: | 430074 湖北省武汉市洪山区东*** | 国省代码: | 湖北;42 |
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摘要: | 本发明公开了一种三维存储器及其形成方法,属于半导体技术领域。所述方法包括:提供主体结构,主体结构包括衬底,形成于衬底上的叠层结构;在叠层结构上形成顶层选择门和沟道通孔,使每个顶层选择门对应预设列的沟道通孔;对沟道通孔进行填充形成立柱,至与叠层结构的上表面齐平;刻蚀叠层结构至露出立柱顶部,并对露出的立柱顶部进行修剪形成塞结构;形成覆盖塞结构的门极层,及覆盖门极层的第一氧化物层。本发明中的方法,形成的三维存储器的单位单元(Unit Cell)为8列交错排布的沟道通孔,缩小了占用面积,进而降低了晶片的尺寸需求,减小了三维存储器的体积及其制作成本。 | ||
搜索关键词: | 三维 存储器 及其 形成 方法 | ||
【主权项】:
1.一种三维存储器的形成方法,其特征在于,包括:提供主体结构,所述主体结构包括衬底,形成于衬底上的叠层结构;在所述叠层结构上形成顶层选择门和沟道通孔,使每个顶层选择门对应预设列的沟道通孔;在所述沟道通孔的侧壁和底层沉积多晶硅,并形成覆盖所述叠层结构上表面的第一多晶硅层;在含有多晶硅的沟道通孔中填充氧化物,并形成覆盖所述第一多晶硅层的第二氧化物层;去除所述第二氧化物层及沟道通孔中的部分氧化物,形成沟道通孔凹槽;在所述沟道通孔凹槽中填充多晶硅,并形成覆盖所述第一多晶硅层的第二多晶硅层;去除所述第一多晶硅层和所述第二多晶硅层至呈现所述叠层结构的上表面,得到对所述沟道通孔进行填充形成的立柱,所述立柱的上表面与所述叠层结构的上表面齐平;刻蚀所述叠层结构至露出立柱顶部,将露出的立柱顶部的外围去除形成塞结构;形成覆盖所述塞结构的门极层,及覆盖所述门极层的第一氧化物层。
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H01 基本电气元件
H01L 半导体器件;其他类目中不包括的电固体器件
H01L27-00 由在一个共用衬底内或其上形成的多个半导体或其他固态组件组成的器件
H01L27-01 .只包括有在一公共绝缘衬底上形成的无源薄膜或厚膜元件的器件
H01L27-02 .包括有专门适用于整流、振荡、放大或切换的半导体组件并且至少有一个电位跃变势垒或者表面势垒的;包括至少有一个跃变势垒或者表面势垒的无源集成电路单元的
H01L27-14 . 包括有对红外辐射、光、较短波长的电磁辐射或者微粒子辐射并且专门适用于把这样的辐射能转换为电能的,或适用于通过这样的辐射控制电能的半导体组件的
H01L27-15 .包括专门适用于光发射并且包括至少有一个电位跃变势垒或者表面势垒的半导体组件
H01L27-16 .包括含有或不含有不同材料结点的热电元件的;包括有热磁组件的
H01L 半导体器件;其他类目中不包括的电固体器件
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