[发明专利]数字到相位转换器有效
| 申请号： | 201580060085.5 | 申请日： | 2015-10-06 |
| 公开（公告）号： | CN107078726B | 公开（公告）日： | 2020-05-19 |
| 发明（设计）人： | H·科恩 | 申请（专利权）人： | 高通股份有限公司 |
| 主分类号： | H03K5/135 | 分类号： | H03K5/135;H03L7/00 |
| 代理公司： | 上海专利商标事务所有限公司 31100 | 代理人： | 唐杰敏;陈炜 |
| 地址： | 美国加利*** | 国省代码： | 暂无信息 |
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| 摘要： | 公开了用于将数字信号转换成时钟相位的系统和方法。示例数字到相位转换器电路接收互补的同相和正交时钟信号并且在由数字相位控制输入控制的相位处产生四个时钟输出。该数字到相位转换器使用第一和第二预驱动器模块来缓冲该同相和正交时钟信号并且产生对应的具有受控的转换速率的经缓冲时钟信号。混频器模块通过形成经缓冲时钟信号的加权组合来产生时钟输出。该加权基于相位控制输入来确定。经缓冲时钟信号的受控的转换速率允许数字混频器模块提供准确的相位控制。该数字到相位转换器还可包括输出缓冲器，该输出缓冲器补偿时钟输出的相位与相位控制输入之间的关系中的非线性。 | ||
| 搜索关键词： | 数字 相位 转换器 | ||
【主权项】：
一种用于产生具有受数字地控制的相位的时钟输出的数字到相位转换器电路，所述电路包括：第一预驱动器模块，所述第一预驱动器模块配置成接收互补的同相时钟信号并且产生具有受控转换速率的第一对互补的经缓冲时钟信号；第二预驱动器模块，所述第二预驱动器模块配置成接收互补的正交时钟信号并且产生具有受控转换速率的第二对互补的经缓冲时钟信号；以及混频器模块，所述混频器模块配置成基于相位控制输入、通过形成所述经缓冲时钟信号的加权组合来产生所述时钟输出。
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