[实用新型]锁相环有效

专利信息
申请号: 201520969265.2 申请日: 2015-11-27
公开(公告)号: CN205249185U 公开(公告)日: 2016-05-18
发明(设计)人: 王晓光 申请(专利权)人: 上海兆芯集成电路有限公司
主分类号: H03L7/18 分类号: H03L7/18
代理公司: 北京汇泽知识产权代理有限公司 11228 代理人: 张瑾
地址: 201203 上海市浦东新*** 国省代码: 上海;31
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摘要: 一种锁相环,包括降频单元、相位频率侦测单元、电荷泵、滤波单元以及压控振荡器单元。降频单元降低输入时钟的频率,用以产生参考时钟,并降低输出时钟的频率,用以产生回授时钟。相位频率侦测单元耦接降频单元,并根据参考时钟及回授时钟的相位差,产生侦测信号。电荷泵耦接相位频率侦测单元,并根据侦测信号调整控制电压。滤波单元耦接电荷泵,并滤除控制电压的高频噪声。压控振荡器单元耦接滤波单元,并根据控制电压产生输出时钟。
搜索关键词: 锁相环
【主权项】:
一种锁相环,其特征在于,包括:降频单元,降低输入时钟的频率,用以产生参考时钟,并降低输出时钟的频率,用以产生回授时钟;相位频率侦测单元,耦接该降频单元,并根据该参考时钟及该回授时钟的相位差,产生侦测信号;电荷泵,耦接该相位频率侦测单元,并根据该侦测信号调整控制电压;滤波单元,耦接该电荷泵的输出端,并滤除该控制电压的高频噪声;以及压控振荡器单元,耦接该滤波单元,并根据该控制电压产生该输出时钟。
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  • 2018-12-28 - 2019-07-19 - H03L7/18
  • 本实用新型公开了一种射频本振信号校准电路,包括小数分频器、整数分频器、混频器、低通滤波器、ADC转换器和FPGA芯片;所述小数分频器为基于Δ∑调制技术的小数分频器;所述FPGA芯片给小数分频器配置用于调制的初始值,所述FPGA芯片给整数分频器配置用于调制的初始值;所述小数分频器和整数分频器的输出端连接混频器的输入端,所述混频器的输出端连接低通滤波器的输入端,所述低通滤波器的输出端连接ADC转换器的输入端,所述ADC转换器的输出端连接FPGA芯片。本实用新型的射频本振信号校准电路,通过引入校准通道来减小主信号频谱两边的杂散,能够提高使用该校准电路的系统的性能。
  • 锁相环电子电路及其电子装置及修正工作循环的方法-201811531582.0
  • 吴王华;姚智伟 - 三星电子株式会社
  • 2018-12-14 - 2019-07-16 - H03L7/18
  • 本文公开一种锁相环电子电路及其电子装置及修正工作循环的方法。根据一个实施例,一种电子电路包括:时钟倍频器;比较器,输出代表电压‑电流(Gm)电路处的电压与参考电压之间的差的值,所述参考电压经调整以补偿所述比较器的偏移;以及工作循环校准电路,接收由所述比较器输出的值并通过从由所述比较器输出的值提取误差以及根据所提取的误差对锁相环的工作循环的时钟边沿进行延迟来调整所述工作循环。
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