[发明专利]3D闪存沟道的制造方法有效
申请号: | 201510174637.7 | 申请日: | 2015-04-10 |
公开(公告)号: | CN104766866B | 公开(公告)日: | 2017-12-08 |
发明(设计)人: | 唐兆云 | 申请(专利权)人: | 武汉新芯集成电路制造有限公司 |
主分类号: | H01L27/11563 | 分类号: | H01L27/11563;H01L21/768 |
代理公司: | 上海思微知识产权代理事务所(普通合伙)31237 | 代理人: | 屈蘅,李时云 |
地址: | 430205 湖北*** | 国省代码: | 湖北;42 |
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摘要: | 本发明提出了一种3D闪存沟道的制造方法,在形成第一沟道介质层和沟道硅后,刻蚀减薄第一沟道介质层暴露出沟道硅的侧壁,接着在沟道硅的侧壁形成侧墙,并且侧墙的厚度大于第一沟道介质层的宽度,从而在后续进行刻蚀时由侧墙保护第一沟道介质层不被过刻蚀,避免第一沟道介质层过刻蚀引起的性能下降等问题,并且相比于现有技术还能够减少刻蚀光罩的使用,有利于进行大量生产。 | ||
搜索关键词: | 闪存 沟道 制造 方法 | ||
【主权项】:
一种3D闪存沟道的制造方法,其特征在于,包括步骤:提供半导体结构,所述半导体结构包括形成在基底上的绝缘层,形成在所述绝缘层内相互隔离的多层牺牲层及形成在绝缘层上的层间介质层,所述半导体结构设有沟道通孔,所述沟道通孔贯穿所述绝缘层、多层牺牲层和层间介质层;在所述沟道通孔中依次形成具有预定宽度的第一沟道介质层、沟道硅及第二沟道介质层,所述第一沟道介质层位于所述沟道两侧壁,所述沟道硅位于所述第一沟道介质层的两侧壁,所述第二沟道介质层位于所述沟道硅之间,并被所述沟道硅覆盖;刻蚀减薄所述层间介质层和第一沟道介质层,暴露出沟道硅的部分侧壁;在暴露出的沟道硅的两侧壁形成侧墙,所述侧墙的厚度大于所述第一沟道介质层的宽度。
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H01 基本电气元件
H01L 半导体器件;其他类目中不包括的电固体器件
H01L27-00 由在一个共用衬底内或其上形成的多个半导体或其他固态组件组成的器件
H01L27-01 .只包括有在一公共绝缘衬底上形成的无源薄膜或厚膜元件的器件
H01L27-02 .包括有专门适用于整流、振荡、放大或切换的半导体组件并且至少有一个电位跃变势垒或者表面势垒的;包括至少有一个跃变势垒或者表面势垒的无源集成电路单元的
H01L27-14 . 包括有对红外辐射、光、较短波长的电磁辐射或者微粒子辐射并且专门适用于把这样的辐射能转换为电能的,或适用于通过这样的辐射控制电能的半导体组件的
H01L27-15 .包括专门适用于光发射并且包括至少有一个电位跃变势垒或者表面势垒的半导体组件
H01L27-16 .包括含有或不含有不同材料结点的热电元件的;包括有热磁组件的
H01L 半导体器件;其他类目中不包括的电固体器件
H01L27-00 由在一个共用衬底内或其上形成的多个半导体或其他固态组件组成的器件
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