[发明专利]经由用于硅上异质集成的模板工程的改进的包覆层外延有效
申请号: | 201380079216.5 | 申请日: | 2013-09-27 |
公开(公告)号: | CN106030810B | 公开(公告)日: | 2019-07-16 |
发明(设计)人: | N·慕克吉;M·拉多萨夫列维奇;J·T·卡瓦列罗斯;R·皮拉里塞泰;N·戈埃尔;V·H·勒;G·杜威;B·舒金 | 申请(专利权)人: | 英特尔公司 |
主分类号: | H01L29/78 | 分类号: | H01L29/78;H01L21/336 |
代理公司: | 永新专利商标代理有限公司 72002 | 代理人: | 陈松涛;王英 |
地址: | 美国加*** | 国省代码: | 美国;US |
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摘要: | 一种设备,包括:半导体主体,所述半导体主体包括沟道区以及设置在所述沟道区的相对的侧上的结区,所述半导体主体包括:具有第一带隙的第一材料;以及多个纳米线,所述纳米线包括第二材料,所述第二材料具有与所述第一带隙不同的第二带隙,所述多个纳米线设置在延伸穿过所述第一材料的分立平面中以使得所述第一材料围绕多个纳米线中的每者;以及设置在所述沟道区上的栅极堆叠体。一种方法,包括:在衬底上方的分立平面中形成多个纳米线,所述多个纳米线中的每者包括具有第一带隙的材料;在所述多个纳米线中的每者周围独立地形成包覆材料,所述包覆材料具有第二带隙;使所述包覆材料接合;以及在所述包覆材料上设置栅极堆叠体。 | ||
搜索关键词: | 经由 用于 硅上异质 集成 模板 工程 改进 覆层 外延 | ||
【主权项】:
1.一种半导体设备,包括:三维半导体主体,所述三维半导体主体包括沟道区以及设置在所述沟道区的相对的侧上的结区,所述三维半导体主体包括:具有第一带隙的第一材料;以及包括第二材料的多个纳米线,所述第二材料具有与所述第一带隙不同的第二带隙,所述多个纳米线设置在延伸穿过所述第一材料的分立平面中,以使得接合成一个主体的所述第一材料围绕所述多个纳米线中的每个纳米线,从而形成鳍状物,其中所述多个纳米线沿所述沟道区的长度方向设置;以及设置在所述沟道区上的栅极堆叠体,所述栅极堆叠体包括设置在栅极电介质上的栅极电极,其中,所述第一材料的带隙小于所述第二材料的带隙。
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