[发明专利]半导体装置的制造方法有效
申请号: | 201210548069.9 | 申请日: | 2012-12-17 |
公开(公告)号: | CN103871958B | 公开(公告)日: | 2017-03-29 |
发明(设计)人: | 吴承颖;欧阳自明 | 申请(专利权)人: | 华邦电子股份有限公司 |
主分类号: | H01L21/768 | 分类号: | H01L21/768 |
代理公司: | 北京三友知识产权代理有限公司11127 | 代理人: | 任默闻 |
地址: | 中国台*** | 国省代码: | 台湾;71 |
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摘要: | 本发明提供一种半导体装置的制造方法,该制造方法包括提供一基底,其具有交替排列的多个第一隔离结构及多个第二隔离结构;在基底的每一第二隔离结构上形成一绝缘突出部;在每一绝缘突出部的两相对侧壁上分别形成一导电间隙壁,以露出每一第一隔离结构;在露出的每一第一隔离结构上形成一绝缘层。通过本发明,由于掩膜图案层仅覆盖对应于第二隔离结构的氧化硅层,使绝缘层中开口深宽比降低,进而减少刻蚀工艺中发生开口底部缩口或刻蚀不完全造成桥接的问题发生,因此,降低了后续形成的接触插塞出现缺陷的可能性。 | ||
搜索关键词: | 半导体 装置 制造 方法 | ||
【主权项】:
一种半导体装置的制造方法,其特征在于,所述半导体装置的制造方法包括:提供一基底,所述基底具有交替排列的多个第一隔离结构及多个第二隔离结构;在所述基底的每一所述多个第二隔离结构上形成一绝缘突出部,包括:在所述基底上形成一氧化硅层;在所述氧化层上形成一掩膜图案层,以覆盖对应于每一所述多个第二隔离结构的所述氧化硅层;以及对所述掩膜图案层下方的所述氧化硅层进行一刻蚀工艺,以露出所述多个第一隔离结构及形成所述绝缘突出部;在每一所述绝缘突出部的两相对侧壁上分别形成一导电间隙壁,以露出每一所述多个第一隔离结构;以及在露出的每一所述多个第一隔离结构上形成一绝缘层。
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H01 基本电气元件
H01L 半导体器件;其他类目中不包括的电固体器件
H01L21-00 专门适用于制造或处理半导体或固体器件或其部件的方法或设备
H01L21-02 .半导体器件或其部件的制造或处理
H01L21-64 .非专门适用于包含在H01L 31/00至H01L 51/00各组的单个器件所使用的除半导体器件之外的固体器件或其部件的制造或处理
H01L21-66 .在制造或处理过程中的测试或测量
H01L21-67 .专门适用于在制造或处理过程中处理半导体或电固体器件的装置;专门适合于在半导体或电固体器件或部件的制造或处理过程中处理晶片的装置
H01L21-70 .由在一共用基片内或其上形成的多个固态组件或集成电路组成的器件或其部件的制造或处理;集成电路器件或其特殊部件的制造
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H01L21-64 .非专门适用于包含在H01L 31/00至H01L 51/00各组的单个器件所使用的除半导体器件之外的固体器件或其部件的制造或处理
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