[发明专利]锁相环有效

专利信息
申请号: 201210418275.8 申请日: 2012-10-26
公开(公告)号: CN103795409B 公开(公告)日: 2016-11-23
发明(设计)人: 朱红卫;唐敏;刘国军 申请(专利权)人: 上海华虹宏力半导体制造有限公司
主分类号: H03L7/099 分类号: H03L7/099
代理公司: 上海浦一知识产权代理有限公司 31211 代理人: 丁纪铁
地址: 201203 上海市浦东*** 国省代码: 上海;31
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摘要: 发明公开了一种锁相环,其压控振荡器采用差分环形结构,在压控振荡器的振荡环外设置有一个控制电压产生电路,控制电压产生电路复制一个压控振荡器的差分延迟子单元就能实现,控制电压产生电路能够实现闭环反馈并输出两个稳定的正负控制电压给压控振荡器,从而能实现压控振荡器的稳定振荡,能提高锁相环输出频率的稳定性,以及能改善锁相环的抗噪声能力并提高锁相环的性能。
搜索关键词: 锁相环
【主权项】:
一种锁相环,包括依次连接的鉴频鉴相器、电荷泵、低通滤波器和压控振荡器,其特征在于:所述压控振荡器为一个由多级差分延迟子单元串联而成的环形结构,各级差分延迟子单元的结构相同且都包括:差分增益电路,由两个对称的第一放大器耦接形成,包括第一输入端、第二输入端、第一输出端和第二输出端;所述第一输入端和所述第二输入端的信号互为反相,所述第一输出端和所述第二输出端的信号互为反相;第一电流源电路,耦接于所述差分增益电路;对称的第一负载和第二负载,第一负载和第一输出端耦接,第二负载和第二输出端耦接;所述第一电流源电路通过第一控制电压控制其电流大小,所述第一负载和所述第二负载都通过第二控制电压控制其电流大小;所述第一控制电压和所述第二控制电压为互相反相;锁相环还包括一控制电压产生电路,用于产生所述第一控制电压和所述第二控制电压,该控制电压产生电路包括:第一镜像电路,包括第一NMOS管、第一PMOS管和第一电阻,所述第一PMOS管的漏极和栅极都和所述第一NMOS管的漏极相连,所述第一NMOS管的源极通过所述第一电阻接地或负电源,所述第一PMOS管的源极连接正电源;所述第一NMOS管的栅极接所述电荷泵输出的控制电压,所述第一NMOS管的漏极输出所述第一控制电压;第二镜像电路,包括第二NMOS管、第二PMOS管,所述第二NMOS管的漏极和栅极都和所述第二PMOS管的漏极相连,所述第二NMOS管的源极接地或负电源,所述第二PMOS管的源极连接正电源;所述第二PMOS管的栅极接所述第一NMOS管的漏极,所述第二NMOS管的漏极输出所述第二控制电压;运算放大器,其反相输入端连接所述第二NMOS管的漏极;单端延迟子单元,由所述差分延迟子单元的一半组成,所述单端延迟子单元包括:单端增益电路,由所述差分增益电路的两个第一放大器中的一个组成;第二电流源电路,由所述差分增益电路的第一电流源电路组成,所述第二电流源电路耦接于所述单端增益电路;所述第二电流源电路通过所述第一控制电压控制其电流大小;第三负载,由所述差分增益电路的第一负载和第二负载中的任一个组成,所述第三负载耦接于所述单端增益电路的输出端;所述运算放大器的同相输入端连接所述单端增益电路的输出端,所述运算放大器的输出端连接所述第三负载的控制端并控制所述第三负载的电流大小,所述运算放大器和所述单端延迟子单元形成一闭环控制使所述第一控制电压和所述第二控制电压稳定。
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  • 本发明涉及一种用于压控振荡器的脉冲生成电路,包括被配置为检测压控振荡器的输出信号的跨零时间的跨零检测器。跨零时间对应于输出信号从第一极性跨越到第二极性的时刻。延迟电路被配置为等待基于跨零时间和输出信号的电压峰值的延迟时段。脉冲生成模块被配置为在延迟时段之后生成脉冲。能量注入器被配置为,响应于脉冲,在脉冲持续期间,将电源电压连接到压控振荡器的输出信号。
  • 用于锁相环的电荷泵电路-201511023348.3
  • A·拉希里 - 意法半导体国际有限公司
  • 2015-12-30 - 2019-06-07 - H03L7/099
  • 一种锁相环包括鉴频鉴相器(PFD),该鉴频鉴相器比较输入信号和反馈信号的相位并且从其生成多个控制信号。与该PFD串联的衰减电路包括在压控振荡器(VCO)控制节点与地之间的滤波器。放大器被耦接至该VCO控制节点。阻抗网络被耦接至该VCO控制节点并且具有阻抗元件,该阻抗元件被耦接至第一电流源,使得当多个控制信号指示该输入信号的相位超前于该反馈信号的相位时在该VCO控制节点处的电压增加,并且该阻抗元件被耦接至第二电流源,使得当多个控制信号指示滞后相位时在该VCO控制节点处的电压减小。VCO被耦接至该VCO控制节点以生成输出信号,其中该输出信号的相位匹配该输入信号的相位。该反馈信号是基于该输出信号的。
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