[发明专利]一种双晶体管零电容动态RAM的制备方法有效
申请号: | 201110163852.9 | 申请日: | 2011-06-17 |
公开(公告)号: | CN102420192A | 公开(公告)日: | 2012-04-18 |
发明(设计)人: | 黄晓橹;颜丙勇;陈玉文;邱慈云 | 申请(专利权)人: | 上海华力微电子有限公司 |
主分类号: | H01L21/8242 | 分类号: | H01L21/8242;H01L21/84;H01L21/266 |
代理公司: | 上海新天专利代理有限公司 31213 | 代理人: | 王敏杰 |
地址: | 201210 上海市浦*** | 国省代码: | 上海;31 |
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摘要: | 本发明公开了一种双晶体管零电容动态RAM的制备方法,本发明的目的是提供一种具有可制造性设计的基于绝缘体上硅的后栅极工艺制造的双晶体管零电容动态RAM的制备方法,在工艺上通过自对准有效实现不同于常规CMOS工艺的T1源漏与栅极有较大的交叠Overlap和T2源漏与栅极有较大的距离Underlap特性,适用于45nm以下的采用后栅极工艺的高介电常数氧化层金属栅的集成电路制备中,具体通过离子注入调节T1和T2的栅靠近源和漏处的功函数,或者栅下靠近源极和漏极的沟道区域的掺杂类型,使得T1的沟道区域中靠近源极和漏极的沟道区域在不加栅压情况下反型为与源漏区相同类型,并使得T2的源极和漏极的栅下扩散区域在不加栅压情况下反型为与源漏区相反类型。 | ||
搜索关键词: | 一种 双晶 体管零 电容 动态 ram 制备 方法 | ||
【主权项】:
一种双晶体管零电容动态RAM的制备方法,其中的双晶体管为形成在共同衬底上的两个级联MOS晶体管T1和T2,其特征在于,包括前备工序,所述前备工序包括:在T1和T2各自源漏极间的沟道表面分别形成有薄氧化层;在薄氧化层上方通过附加样本栅湿回蚀分别形成有T1和T2各自的栅极沟槽,并分别在T1和T2各自的栅极沟槽中形成有高介电层和其上方的金属氧化物介电材料层;通过T1、T2各自栅极沟槽的开口,通过离子注入分别改变T1、T2所包含的金属氧化物电介材料层靠近源极和漏极的两端的功函数,以使T1沟道区域中靠近源极和漏极的区域在不加栅压情况下反型为与源漏区相同的掺杂类型,T2沟道区域中靠近源极和漏极的区域在不加栅压情况下反型为与源漏区相反的掺杂类型。
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H01 基本电气元件
H01L 半导体器件;其他类目中不包括的电固体器件
H01L21-00 专门适用于制造或处理半导体或固体器件或其部件的方法或设备
H01L21-02 .半导体器件或其部件的制造或处理
H01L21-64 .非专门适用于包含在H01L 31/00至H01L 51/00各组的单个器件所使用的除半导体器件之外的固体器件或其部件的制造或处理
H01L21-66 .在制造或处理过程中的测试或测量
H01L21-67 .专门适用于在制造或处理过程中处理半导体或电固体器件的装置;专门适合于在半导体或电固体器件或部件的制造或处理过程中处理晶片的装置
H01L21-70 .由在一共用基片内或其上形成的多个固态组件或集成电路组成的器件或其部件的制造或处理;集成电路器件或其特殊部件的制造
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