[实用新型]两线制无极性485芯片无效
| 申请号： | 201020641175.8 | 申请日： | 2010-12-03 |
| 公开（公告）号： | CN201877423U | 公开（公告）日： | 2011-06-22 |
| 发明（设计）人： | 刘爱民 | 申请（专利权）人： | 刘爱民 |
| 主分类号： | H01L23/48 | 分类号： | H01L23/48 |
| 代理公司： | 暂无信息 | 代理人： | 暂无信息 |
| 地址： | 116100 辽*** | 国省代码： | 辽宁;21 |
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| 摘要： | 本实用新型涉及一种两线制无极性485芯片，给485芯片的收发控制引脚串接一个延时电路，给485芯片的数据I/O引脚或通信引脚串接一个极性转换开关，当485通信线路A线、B线间的电压Vab>0或Vba>0，且持续时间超过一定时间时，控制极性转换开关动作，使线路极性与485芯片的内部极性一致。将消除应用485芯片接线错误问题和两线制带来的负载下降问题，给使用485带来极大方便。适用于所有485通信场合。 | ||
| 搜索关键词： | 两线制无 极性 485 芯片 | ||
【主权项】：
一种两线制无极性485芯片，包括差分输出电压比较器、差分输出数据驱动器、数据I/O引脚和通信引脚，其特征在于：差分输出电压比较器具有正反两个输出端，所述差分输出数据驱动器具有正反两个输入端；而且还包括：极性转换开关，其串接于所述485芯片的数据I/O引脚上；0.8秒延时电路，其输入端连接于所述差分输出电压比较器的正向输出端，其控制输出端连接于所述极性转换开关的控制极；2毫秒延时电路，其输入端连接于所述485芯片的收发控制引脚，其第一控制输出端连接于所述差分输出数据驱动器的控制端，第二控制输出端连接于所述差分输出数据驱动器的输入极性转换开关的控制极。
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