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[发明专利]一种用于部件级和部件联合级的缓存一致性模拟验证方法-CN201910858606.1有效
发明人：胡向东;李辉;周李庆;吴文俊 -专利权人： 上海高性能集成电路设计中心
申请日： 2019-09-11 - 公布日： 2023-10-03 - 主分类号： G06F12/0815 文献下载
摘要：本发明涉及一种用于部件级和部件联合级的缓存一致性模拟验证方法，包括以下步骤：对核心缓存进行建模；根据核心和核外缓存一致性控制模块的接口协议，对处理器核心功能进行建模；创建核心的指令监测器模型，所述指令监测器模型用来监测核心模型与核外缓存一致性控制模块的通信情况；建立数据比对模型；创建记分板模型，所述记分板模型与所述指令监测器模型进行通信，用于接收指令监测器模型发送的消息，并根据消息类型分别进行处理以完成验证。本发明解决了因核心数变化引起的设计架构修改造成Cache一致性部件级和部件联合级验证环境重新搭建问题。
一种用于部件联合缓存一致性模拟验证方法

[发明专利]一种支持PCI-E弱序请求乱序发射的装置-CN202310654508.2在审
发明人：班冬松;王锦涵;颜世云;尹飞;田桂兰 -专利权人： 上海高性能集成电路设计中心
申请日： 2023-06-05 - 公布日： 2023-09-19 - 主分类号： G06F15/173 文献下载
摘要：本发明涉及一种支持PCI‑E弱序请求乱序发射的装置，包括：判断逻辑器，用于判断收到的请求是强序请求还是弱序请求；请求寄存器，用于采用队列的形式存储不满足发射条件的强序请求；译码逻辑器，用于对发出的请求和收到的响应进行解析，确定需要进行操作的计数器；计数器，所述计数器的数目与请求寄存器中的队列数目相同，用于记录已发射请求的数目；判断逻辑器在判断出收到的请求为弱序请求时，直接将弱序请求发往片上网络，在判断出收到的请求为强序请求时，请求寄存器以队列方式保存强序请求，当强序请求处于请求寄存器中的队列头，且对应的计数器的值为零时，强序请求满足发射条件，将强序请求发往片上网络。本发明能够减少硬件资源。
一种支持 pci 请求发射装置

[发明专利]一种软件可控的片上网络动态信用管理装置、系统及方法-CN202310598742.8在审
发明人：李媛;杨剑新;吴安权;尹飞;颜世云;班冬松;王锦涵 -专利权人： 上海高性能集成电路设计中心
申请日： 2023-05-25 - 公布日： 2023-08-22 - 主分类号： G06F15/78 文献下载
摘要：本发明涉及一种软件可控的片上网络动态信用管理装置、系统及方法。其中，装置包括：信用管理模块、顺时针输入信用槽、顺时针输出信用槽、逆时针输入信用槽和逆时针输出信用槽。系统包括多个片上网络动态信用管理装置，各个片上网络动态信用管理装置的顺时针输入信用槽和顺时针输出信用槽依次串联形成顺时针信用环网，各个片上网络动态信用管理装置的逆时针输入信用槽和逆时针输出信用槽依次串联形成逆时针信用环网；信用环网初始化结束后，各节点根据软件配置的信用预申请阈值提前申请各个节点的信用，减少消息发送时申请信用的延时。本发明提高了消息目标接收缓冲的利用率以及片上网络的消息传输效率，使得片上网络能够更加高效地运行。
一种软件可控网络动态信用管理装置系统方法

[发明专利]一种基于网表的超大规模芯片信息分析方法-CN201910859148.3有效
发明人：胡向东;马彦;张新;王飙 -专利权人： 上海高性能集成电路设计中心
申请日： 2019-09-11 - 公布日： 2023-08-11 - 主分类号： G06F30/367 文献下载
摘要：本发明涉及一种基于网表的超大规模芯片信息分析方法，包括以下步骤：读入设计的完整网表，并根据该完整网表构建内部网表数据结构；指定所述内部网表数据结构任意一层作为顶层，自该顶层向下遍历并提取每一层次的信息，直到最底层晶体管；从提取出的信息中获取晶体管信息，并进行分类汇总。本发明可以快速准确的完成网表内容分析与信息统计。
一种基于超大规模芯片信息分析方法

[发明专利]一种二级缓存标记阵列的校验单错处理方法-CN201910859104.0有效
发明人：胡向东;尹飞;张晓东;路冬冬 -专利权人： 上海高性能集成电路设计中心
申请日： 2019-09-11 - 公布日： 2023-08-08 - 主分类号： G06F11/10 文献下载
摘要：本发明涉及一种二级缓存标记阵列的校验单错处理方法，包括以下步骤：并行执行校验标记阵列的读数据和命中判断；根据校验结果和命中结果综合判断请求是否能够正常执行；对于无法正常执行的请求，进入重试处理流程获得正确的数据。本发明能够提高芯片的设计频率。
一种二级缓存标记阵列校验错处方法

[发明专利]一种基于仿真的处理器性能事件动态监测方法-CN201910859116.3有效
发明人：胡向东;宋仕奇;王超杰;施一舟;周婷婷 -专利权人： 上海高性能集成电路设计中心
申请日： 2019-09-11 - 公布日： 2023-08-08 - 主分类号： G06F11/34 文献下载
摘要：本发明涉及一种基于仿真的处理器性能事件动态监测方法，包括以下步骤：在硬件仿真器上建立处理器芯片的系统级仿真验证环境；对各种性能事件的统计类型进行分类，并使用性能事件监测模块中不同的性能事件采集单元对不同类型的性能事件进行监测；在硬件仿真器的性能事件监测模块中设置轮转缓冲控制单元来控制性能事件采集单元的数据记录和存储；所述轮转缓冲控制单元中的计数器，所述计数器根据时钟上升沿自动累加，当累加值与采样间隔周期相等时，所述轮转缓冲控制单元将这段时间累加记录的性能事件数据写入数据缓冲单元中。本发明能够用较短的时间得到大量完整、全面、动态的性能事件数据结果。
一种基于仿真处理器性能事件动态监测方法

[发明专利]一种应用于处理器芯片仿真验证的可控随机故障注入方法-CN201910858595.7有效
发明人：胡向东;孙路;田增;张蓓莉;倪超 -专利权人： 上海高性能集成电路设计中心
申请日： 2019-09-11 - 公布日： 2023-06-23 - 主分类号： G06F11/26 文献下载
摘要：本发明涉及一种应用于处理器芯片仿真验证的可控随机故障注入方法，包括以下步骤：定义故障注入结构体；根据芯片的设计方案和设计代码，找到故障注入的设计信号路径和名称，通过仿真器支持的绑定方式与故障注入环境中的变量关联起来；监测并获取当前的退出指令编号，当所述退出指令编号在故障注入指令编号区间内时，获取记录的当前故障注入编号；获取数据位宽度size，使用伪随机数生成的方法，获得两个不同的随机数r0和r1，且随机数r0和r1取值范围在0到size‑1之间；根据不同的造错情况，采用随机数r0和r1选择数据位或信号位进行故障注入。本发明增强了故障处理流程验证的可控性、随机性和可扩展性。
一种应用于处理器芯片仿真验证可控随机故障注入方法

[发明专利]一种基于硬件仿真加速器的指令集模拟器校准方法-CN201910858569.4有效
发明人：胡向东;倪超;陈诚;刘晓峰;文俊杰 -专利权人： 上海高性能集成电路设计中心
申请日： 2019-09-11 - 公布日： 2023-06-16 - 主分类号： G06F30/331 文献下载
摘要：本发明涉及一种基于硬件仿真加速器的指令集模拟器校准方法，包括以下步骤：在现有微处理器设计的基础上通过硬件仿真加速器运行操作系统程序，同时捕获所有的仿真轨迹作为基准模型轨迹；在指令集模拟器上运行所述操作系统程序，同时捕获所有的仿真轨迹；将指令集模拟器上生成的仿真轨迹与基准模型的轨迹进行逐条对比，实现对指令集模拟器的校对。本发明能够缩短重复的查错时间，提高验证效率。
一种基于硬件仿真加速器指令模拟器校准方法

[发明专利]一种存内计算单元及阵列-CN202310048853.1在审
发明人：刘建文;赵信;方华;张立;童仙雨 -专利权人： 上海高性能集成电路设计中心
申请日： 2023-02-01 - 公布日： 2023-05-23 - 主分类号： G06F1/3234 文献下载
摘要：本发明涉及一种存内计算单元和阵列，其中，存内单元包括单端口SRAM和计算部分，单端口SRAM用于存储权重，计算部分用于进行乘法运算，包括第七MOS管、第八MOS管、第九MOS管、第十MOS管、第十一MOS管和第十二MOS管；单端口SRAM的存储节点分别与第九MOS管的栅极和第十二MOS管的栅极相连；第九MOS管的漏极分别与第七MOS管的源极和第八MOS管的源极相连，第十二MOS管的漏极分别与第十MOS管的源极和第十一MOS管的源极相连；第九MOS管的源极和第十二MOS管的源极均接地；第七MOS管、第八MOS管、第十MOS管和第十一MOS管的栅极分别与第一输入端、第二输入端、第三输入端和第四输入端相连，漏极分别与第一输出端、第二输出端、第三输出端和第四输出端相连。本发明能够进行高速低功耗的卷积计算。
一种计算单元阵列

[发明专利]一种兼具乘加功能的存储器-CN202310066346.0在审
发明人：方华;赵信 -专利权人： 上海高性能集成电路设计中心
申请日： 2023-02-06 - 公布日： 2023-05-09 - 主分类号： G11C11/417 文献下载
摘要：本发明涉及一种兼具乘加功能的存储器，包括基于8T存储单元的存储阵列、地址译码器、读写数据通路和读写控制模块，还包括CIM控制电路；所述地址译码器、读写数据通路和读写控制模块，用于控制所述存储阵列进行读操作或写操作；所述CIM控制电路用于完成对输入的二进制数据和存储于所述存储阵列中的二进制数据的乘加运算。本发明能够有效提高计算性能，同时提高能效。
一种兼具功能存储器

[发明专利]一种时钟分布网络快速设计方法-CN201910835765.X有效
发明人：胡向东;潘达杉;童中华;黄金明 -专利权人： 上海高性能集成电路设计中心
申请日： 2019-09-05 - 公布日： 2023-04-18 - 主分类号： G06F30/18 文献下载
摘要：本发明涉及一种时钟分布网络快速设计方法，将时钟网络分为第一级时钟网络和第二级时钟网络，其中，第一级时钟网络由第一级时钟网络驱动单元驱动，第二级时钟网络由第二级时钟网络驱动单元驱动，包括以下步骤：采用时序优先的布局，并获取触发器位置；根据布局参数采用聚类算法将触发器划分成若干个局部区域，建立第二级时钟网络；根据布局参数采用聚类算法将第二级时钟网络驱动单元划分为若干负载均匀的区域，建立第一级时钟网络；对第一级时钟网络和第二级时钟网络进行绕线。本发明能够降低时钟网络延迟，减少时钟网络负载。
一种时钟分布网络快速设计方法

[发明专利]一种伪随机激励生成器的基于双向约束树指令集实现方法-CN201911257836.9有效
发明人：王寅娣 -专利权人： 上海高性能集成电路设计中心
申请日： 2019-12-10 - 公布日： 2023-04-07 - 主分类号： G06F30/398 文献下载
摘要：本发明涉及一种伪随机激励生成器的基于双向约束树指令集实现方法，包括以下步骤：分别定义指令单元和多级指令组，其中，指令单元是伪随机激励生成器中最基本的指令定义，指令组是将同一类型的指令或指令组编为一组；根据所述指令单元和多级指令组在指令的分组之间建立约束关系，形成树形约束模型结构；基于所述树形约束模型结构生成随机指令。本发明使指令集具有高度的结构法和伪随机控制更加精细。
一种随机激励生成器基于双向约束指令实现方法

[发明专利]一种超标量微处理器中重发自陷立即处理方法-CN201910858587.2有效
发明人：胡向东;尹飞;路冬冬;何军;范好好;姚慧 -专利权人： 上海高性能集成电路设计中心
申请日： 2019-09-11 - 公布日： 2023-03-31 - 主分类号： G06F9/38 文献下载
摘要：本发明涉及一种超标量微处理器中重发自陷立即处理方法，包括以下步骤：访存部件内部仲裁后向重排序缓冲和整数执行部件报重发自陷；重排序缓冲将收到的重发自陷信息固定寄存两拍后登记到重排序缓冲条目中；整数执行部件收到的重发自陷信息固定寄存两拍后仲裁发出广播清空流水线信息；重排序缓冲在收到重发自陷的下一拍向取值部件发送重发自陷请求和取指地址，流水线站台重新启动；重排序缓冲条目中的重发自陷到达头部后，从条目中删除，恢复重发自陷指令发射。本发明缩短了重发自陷的处理时间，使得指令流水线能更快的恢复重启。
一种标量微处理器发自立即处理方法

[发明专利]一种基于记分牌原理的两级缓置发射装置-CN201910858592.3有效
发明人：胡向东;范好好;李俊;尹飞;王国澎 -专利权人： 上海高性能集成电路设计中心
申请日： 2019-09-11 - 公布日： 2023-03-31 - 主分类号： G06F9/38 文献下载
摘要：本发明涉及一种基于记分牌原理的两级缓置发射装置，包括一级等待队列和二级发射队列，所述一级等待队列和二级发射队列之间设置有推测记分牌，所述二级发射队列的发射处设置有一个精确记分牌，所述推测记分牌解锁时机是根据指令在执行部件执行的周期来确定指令从所述一级等待队列发射至所述二级发射队列后解推测记分牌的时机；所述精确记分牌解锁时机是根据指令在执行部件执行的周期来确定指令从二级发射子队列至执行部件后解整数精确记分牌的时机。本发明简化复杂的发射选择逻辑，调整二级队列的利用率，提高发射效率。
一种基于记分牌原理两级发射装置

[发明专利]一种基于指令集模拟器的指令信息查询及执行调试方法-CN201910858616.5有效
发明人：胡向东;刘晓峰;巨鹏锦;喻文星;张文珑 -专利权人： 上海高性能集成电路设计中心
申请日： 2019-09-11 - 公布日： 2023-03-31 - 主分类号： G06F9/30 文献下载
摘要：本发明涉及一种基于指令集模拟器的指令信息查询及执行调试方法，包括以下步骤：将测试激励加载到指令集模拟器；启动指令集模拟器开始执行测试激励中的各种指令，并通过进入debug模式来加载本发明装置；根据需要使用until命令设置好各种调试断点；使用run命令来运行单条或多条指令；检查是否满足断点条件，若不满足则继续运行，若满足就暂停执行指令；通过各种不同的查询命令，来查询指令执行过程中的所有信息，用于分析是否存在错误；检查是否完成调试，若已找到问题则完成调试并退出，若未完成调试则重新设置断点并继续调试。本发明可以有效降低对调试人员的要求，从而提高调试效率。
一种基于指令模拟器信息查询执行调试方法

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