专利名称
主分类
A 农业
B 作业;运输
C 化学;冶金
D 纺织;造纸
E 固定建筑物
F 机械工程、照明、加热
G 物理
H 电学
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公布日期
2023-10-24 公布专利
2023-10-20 公布专利
2023-10-17 公布专利
2023-10-13 公布专利
2023-10-10 公布专利
2023-10-03 公布专利
2023-09-29 公布专利
2023-09-26 公布专利
2023-09-22 公布专利
2023-09-19 公布专利
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专利权人
国家电网公司
华为技术有限公司
浙江大学
中兴通讯股份有限公司
三星电子株式会社
中国石油化工股份有限公司
清华大学
鸿海精密工业股份有限公司
松下电器产业株式会社
上海交通大学
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  • [发明专利]视频解码数据存储方法及运动向量数据的计算方法-CN201510275792.8有效
  • 王军;张建辉;原顺;李洁珺 - 珠海全志科技股份有限公司
  • 2015-05-26 - 2017-09-22 - H04N19/433
  • 本发明提供一种视频解码数据存储方法及运动向量的计算方法,视频解码数据存储方法包括在静态随机存储器内设置参考帧队列表格,将多个参考帧的基本信息存储在参考帧队列表格内,参考帧队列表格的每一个单元存储有一个参考帧对应在解码缓冲区内的索引信息;在解码缓冲区内存储与索引信息对应的多组帧缓冲信息,每一组帧缓冲信息包括帧显示顺序数据、运动向量存储地址信息;在动态随机存储器内存储每一参考帧的运动向量数据,运动向量存储地址信息为参考帧的对应块的编码树单元的运动向量数据存储在动态随机存储器的地址信息。应该本发明的方法可以提高视频解码的效率,并且节省硬件的开销,并节省视频解码是所占用的带宽资源。
  • 视频解码数据存储方法运动向量计算方法
  • [发明专利]用于基于GPU的解块的高并行依赖性模式-CN201580061427.5在审
  • H.吴;J.A.古尔德 - 英特尔公司
  • 2015-11-02 - 2017-08-29 - H04N19/436
  • 线程依赖性方案可显著减少依赖性负担,并在一些实施例中改进采用相对高的依赖性的视频压缩技术(诸如VP9)中的并行效率。一个基本特征是要将单独的大内核程序分裂成多个不那么依赖的较小内核程序,由此显著提高了能够潜在地并行运行的软件线程的数量。另一个特征是要定义具有特定线程的空间位置和相关联的上下文的较大数量的线程依赖性(用于各线程的所有依赖性候选的超集),并且掩蔽一些不必要的线程依赖性。
  • 用于基于gpu并行依赖性模式
  • [发明专利]图像压缩解压缩装置-CN201580038688.5在审
  • 齐藤和则;小味弘典;柏原义昌;谷田部佑介 - 株式会社日立信息通信工程
  • 2015-02-09 - 2017-04-19 - H04N19/436
  • 一种装置,其进行基于编码对原图像数据进行压缩,此外对编码后的数据进行解压缩的图像压缩解压缩处理,其具有一个以上的图像处理部以及一个以上的可变长度编码解码处理部,图像处理部按照基于图像的分辨率或帧率的并行数进行并行处理,可变长度编码解码处理部通过基于图像压缩解压缩装置所处理的比特流的比特率的并行数来进行并行处理。另外,在图像压缩解压缩装置中,将决定并行数的图像的分辨率和帧率的两方,或者将图像的分辨率和帧率中的一方作为参数而输入。由此,能够根据考虑了分辨率、帧率、比特率的用户的使用用途来降低消耗功率。
  • 图像压缩解压缩装置
  • [发明专利]一种JPEG髙速解码的方法-CN201611114317.3在审
  • 包训阳 - 天津君邦科技有限公司
  • 2016-12-07 - 2017-04-05 - H04N19/436
  • 本发明涉及一种高速JPEG解码的方法,该方法包括并行哈夫曼解码算法设计与实现,从编码块中提取实际局部编码的数据;根据提取的局部编码数据通过全局检查恢复为原始的编码数据;并行IDCT算法设计与实现,将每个处理单元用到的操作数据复制到共享内存中;每个处理单元计算IDCT两个步骤,中间需要进行一次同步操作,确定所有处理单元完成上一步骤;每个处理单元将计算完成后的结果经过量化恢复为实际的图像数据。与现有技术相比,本发明在普通配置有当前主流显卡GPU的PC机上,可以实现分辨率为(1024*768)JPEG图像的实时解码每秒60FPS以上,CPU占有率小于10%,可以经过简单的改造,实现支持高清视频的解码。
  • 一种jpeg解码方法
  • [发明专利]一种按行交错划分任务和数据的多核并行视频解码方法-CN201510162056.1有效
  • 宋立锋;杜永红;郭俊兵;刘诏书 - 佛山世寰智能科技有限公司
  • 2015-04-07 - 2017-02-22 - H04N19/436
  • 本发明提供了一种按行交错划分任务和数据的多核并行视频解码方法,按以下步骤划分共享图像数据以及相应的数据处理(11)把HxW图像的图像数据及其处理任务按码流基本单元行交错划分给m个核心,其中第0行分给核心0、第1行分给核心1、第2行分给核心2、…,核心i处理第i、i+m、i+2m、...、行码流基本单元,每个核心处理hxW子图像的视频解码,(12)划分后完整图像全局行坐标到核心序号及其子图像局部行坐标的映射关系为图像Y分量行坐标映射global_y=核心序号×16k+local_y×m;图像U、V分量行坐标映射global_y=核心序号×8k+local_y×m;码流基本单元行坐标映射global_mb_y=核心序号+local_mb_y×m;具有在任务分摊到多核后数据缓存也相应分摊到多核,并且都达到均衡,共享数据存取效率以及并行加速比显著提高的优点。
  • 一种交错划分任务数据多核并行视频解码方法
  • [发明专利]一种用于多核并行视频编码和解码的共享内存接口-CN201510162075.4有效
  • 宋立锋;杜永红;郭俊兵;刘诏书 - 佛山世寰智能科技有限公司
  • 2015-04-07 - 2016-11-09 - H04N19/436
  • 本发明提供一种用于多核并行视频编码和解码的共享内存接口,包括数据结构和创建、使用方法,创建步骤为:(11)以等分原则划分图像数据到m个核心;(12)m个核心在共享内存中开辟一段连续存储空间,把系统返回的一块数据缓冲区首地址通过核间消息发到指定核心A;(13)所有核心在私有内存中开辟一段连续内存空间,并且从系统返回的一块数据缓冲区首地址开始设置;(14)核心A从每个核心发来的缓冲区首地址开始依次设置图像数据所有p维数组的第p‑1级表内容;(15)核心A把图像数据所有p维数组的第p‑1级表内容通过组内广播经过核间高速互连网络送达所有核心。具有在任务分摊到多核后数据缓存也相应分摊到多核,并且都达到均衡,共享数据存取效率显著提高的优点。
  • 一种用于多核并行视频编码解码共享内存接口
  • [发明专利]一种基于多核处理器的编码器-CN201610494160.5在审
  • 卞凤杰;齐金鹏;刘树娟;宋巧红 - 东华大学
  • 2016-06-29 - 2016-10-26 - H04N19/436
  • 本发明涉及一种基于多核处理器的编码器,包括并行运动估计模块,所述并行运动估计模块并行获取子块的运动矢量信息和残差块数据,其中运动矢量信息作为运动矢量模块的输入信息,用于计算子块的运动矢量信息;所有运动矢量信息计算完成后,残差数据获取模块访问存放在参考帧内存中的子块数据,并输送给DCT变换模块得到量化后的变换系数,所述变换系数作为失真估计模块的输入;MV成本查表模块用于查表从所述并行运动估计模块获取运动矢量编码的比特数,所述比特数作为比特率估计模块的输入;所述失真估计模块和比特率估计模块的输出作为RDO帧间模式决策模块的输入进行最佳模式决策。本发明能够提高整个的视频编码效率。
  • 一种基于多核处理器编码器
  • [发明专利]数据流的解码方法及装置-CN201510005309.4在审
  • 陈峻峰 - 中兴通讯股份有限公司
  • 2015-01-06 - 2016-08-03 - H04N19/436
  • 本发明公开了一种数据流的解码方法及装置,其中,该方法包括:接收多路压缩数据流,其中,压缩数据流为采用了第一编码方式的数据流,第一编码方式需要采用串行解码方式进行解码;采用多个解码器分别对多路压缩数据流进行并行解码,得到多路解码后的数据流;将多路解码后的数据流进行缓存;对缓存后的多路解码后的数据流采用轮询的方式进行后续解码处理。通过本发明解决了相关技术中在JPEG解码过程中只能一个一个串行解码导致解码速度较低的问题,进而达到了简化电路结构,节省FPGA资源,提高解码速度的效果。
  • 数据流解码方法装置
  • [发明专利]一种基于计数器的流水控制方法和装置-CN201511005239.9在审
  • 李仙辉 - 福州瑞芯微电子股份有限公司
  • 2015-12-29 - 2016-03-23 - H04N19/436
  • 本发明公开了一种基于计数器的流水控制方法和装置,所述装置包括功能单元、计数单元、控制单元、判断单元,所述功能单元包括多个功能模块,所述计数单元包括多个计数模块,每一功能模块对应一计数模块,通过判断计数模块的值实现了对各个功能模块流水作业(如视频的编解码)的有效控制,特别是在遇到阻塞(“满”情况)或则前级无法取数(“空”情况)的情况下,功能模块可以暂时停止流水作业,保证不会出现数据丢失或产生无效数据的情况,使得视频编码具有更强的稳健性,因而在计算机芯片领域具有广阔的市场前景。
  • 一种基于计数器流水控制方法装置
  • [发明专利]可扩展的高吞吐量视频编码器-CN201380069767.3在审
  • 张磊;罗英;爱德华·哈罗德 - ATI科技无限责任公司
  • 2013-12-17 - 2015-09-09 - H04N19/436
  • 本文描述一种可扩展的高吞吐量视频编码器。多个专用的硬件视频编码器以交错、平行的体系结构运行,其中每个视频编码器编码视频帧并且所述交错或延迟是可编程数量的宏块列。在一个示例方法中,在第一视频编码器完成编码帧的第一x个宏块列后,所述第一视频编码器用信号通知第二视频编码器开始编码下一未处理帧的宏块列。两个视频编码器继续以同步、交错方式平行地编码。在所述帧的末尾,所述第一视频编码器开始编码另一未处理帧的x个宏块列。
  • 扩展吞吐量视频编码器

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