[发明专利]半导体器件及芯片的制造方法在审
| 申请号: | 202310465648.5 | 申请日: | 2023-04-26 |
| 公开(公告)号: | CN116344447A | 公开(公告)日: | 2023-06-27 |
| 发明(设计)人: | 丁一凡;梁成栋;何亮亮 | 申请(专利权)人: | 上海华力微电子有限公司 |
| 主分类号: | H01L21/78 | 分类号: | H01L21/78;H01L23/544;H01L21/66 |
| 代理公司: | 上海思捷知识产权代理有限公司 31295 | 代理人: | 罗磊 |
| 地址: | 201314*** | 国省代码: | 上海;31 |
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| 摘要: | |||
| 搜索关键词: | 半导体器件 芯片 制造 方法 | ||
1.一种半导体器件,其特征在于,包括:
一晶圆,具有多个曝光区以及连接相邻所述曝光区之间的第一切割道区,所述曝光区具有多个芯片区以及连接相邻所述芯片区之间的第二切割道区;
多个测试结构,位于所述第一切割道区和/或所述曝光区的拐角和中心处。
2.如权利要求1所述的半导体器件,其特征在于,所述第一切割道区的宽度大于所述测试结构的宽度,且所述测试结构的宽度大于所述第二切割道区的宽度时,所述测试结构位于所述第一切割道区;所述第一切割道区的宽度等于所述第二切割道区的宽度,且所述测试结构的宽度大于所述第二切割道区的宽度时,所述测试结构位于所述曝光区的拐角和中心处,或者,所述测试结构位于所述曝光区的拐角和中心处,且位于所述曝光区的拐角处的测试结构还延伸至所述第一切割道区。
3.如权利要求2所述的半导体器件,其特征在于,所述测试结构的宽度为49微米~51微米。
4.如权利要求3所述的半导体器件,其特征在于,所述第一切割道区的宽度大于所述测试结构的宽度,且所述测试结构的宽度大于所述第二切割道区的宽度时,所述第一切割道区的宽度为60微米~80微米,所述第二切割道区的宽度为19微米~20微米;所述第一切割道区的宽度等于所述第二切割道区的宽度,且所述测试结构的宽度大于所述第二切割道区的宽度时,所述第一切割道区和所述第二切割道区的宽度均为19微米~20微米。
5.如权利要求1所述的半导体器件,其特征在于,所述测试结构位于所述第一切割道区时,所述测试结构环绕所述曝光区。
6.如权利要求1所述的半导体器件,其特征在于,所述曝光区的数量为60个~70个。
7.如权利要求1所述的半导体器件,其特征在于,位于单个所述曝光区外围的所述第一切割道区和/或单个所述曝光区的拐角和中心处的所述测试结构的数量为70个~80个。
8.一种芯片的制造方法,其特征在于,包括:
提供如权利要求1~7中任一项所述的半导体器件;
切割所述晶圆的第一切割道区和第二切割道区,以得到芯片。
9.如权利要求8所述的芯片的制造方法,其特征在于,所述晶圆包括衬底以及形成于所述衬底上的钝化层,所述钝化层中形成有金属互连结构。
10.如权利要求9所述的芯片的制造方法,其特征在于,切割所述晶圆的第一切割道区和第二切割道区的步骤包括:
采用干法刻蚀工艺切割所述第一切割道区和所述第二切割道区的所述金属互连结构上的钝化层和所述金属互连结构中的顶层金属层;
采用激光切割所述第一切割道区和所述第二切割道区剩余的所述钝化层、剩余的所述金属互连结构以及所述衬底。
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H01L 半导体器件;其他类目中不包括的电固体器件
H01L21-00 专门适用于制造或处理半导体或固体器件或其部件的方法或设备
H01L21-02 .半导体器件或其部件的制造或处理
H01L21-64 .非专门适用于包含在H01L 31/00至H01L 51/00各组的单个器件所使用的除半导体器件之外的固体器件或其部件的制造或处理
H01L21-66 .在制造或处理过程中的测试或测量
H01L21-67 .专门适用于在制造或处理过程中处理半导体或电固体器件的装置;专门适合于在半导体或电固体器件或部件的制造或处理过程中处理晶片的装置
H01L21-70 .由在一共用基片内或其上形成的多个固态组件或集成电路组成的器件或其部件的制造或处理;集成电路器件或其特殊部件的制造





