[发明专利]多路串口通信中实现时钟同步校准的方法及系统有效
| 申请号: | 202210258227.0 | 申请日: | 2022-03-16 |
| 公开(公告)号: | CN114610669B | 公开(公告)日: | 2023-10-20 |
| 发明(设计)人: | 赵观星;董渊;竺际隆;李丰军;张强礴 | 申请(专利权)人: | 无锡英迪芯微电子科技股份有限公司 |
| 主分类号: | G06F13/42 | 分类号: | G06F13/42;G06F1/12;G06F1/24;G06F15/78 |
| 代理公司: | 无锡华源专利商标事务所(普通合伙) 32228 | 代理人: | 过顾佳 |
| 地址: | 214028 江苏省无锡市*** | 国省代码: | 江苏;32 |
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| 摘要: | |||
| 搜索关键词: | 串口 通信 实现 时钟 同步 校准 方法 系统 | ||
1.一种多路串口通信中实现时钟同步校准的方法,包括多个待进行串口通信的驱动芯片,每个驱动芯片内包括一用于串口通信处理的串口通信模块;其特征是:配置利用驱动芯片内串口通信模块在串口通信时的串口通信数据帧,其中,所配置的串口通信数据帧包括用于时钟校准的时钟校准字段,所述时钟校准字段包括串行采样基准数据;
任一驱动芯片的串口通信模块接收一串口通信数据帧后,利用当前驱动芯片内串口通信模块的通信模块时钟OSC对串行采样基准数据采样并计数,以得到采样计数值N,且根据采样计数值N、通信模块时钟OSC的频率fosc、串口通信波特率B、串行采样基准数据的长度m以及串口通信时的目标时钟频率fsys确定当前驱动芯片内串口通信模块的校准系统时钟fsys_trim,以实现基于驱动芯片内串口通信模块的校准系统时钟fsys_trim下多个驱动芯片串口通信时的时钟同步校准。
2.根据权利要求1所述的多路串口通信中实现时钟同步校准的方法,其特征是:根据采样计数值N、通信模块时钟OSC的频率fosc、串口通信波特率B、串行采样基准数据的长度m以及串口通信时的目标时钟频率fsys确定当前驱动芯片内串口通信模块的校准后系统时钟fsys_trim时,则有
其中,coe为分频系数比,为对分频系数比的四舍五入取整运算。
3.根据权利要求1或2所述的多路串口通信中实现时钟同步校准的方法,其特征是:所述串口通信数据帧还包括通信复位字段,其中,通信复位字段位于串口通信数据帧的头部,通信复位字段位于时钟校准字段的前并紧邻所述时钟校准字段;
利用串口通信数据帧对一驱动芯片内的串口通信模块复位时,通信复位字段的复位电平持续时间大于串口通信模块的复位基准电平持续时间。
4.根据权利要求3所述的多路串口通信中实现时钟同步校准的方法,其特征是:所述串口通信数据帧还包括依次排布的通信命令字段、通信设备地址字段、寄存器地址字段以及循环校验字段,其中,通信命令字段紧邻时钟校准字段,通信命令字段、通信设备地址字段以及寄存器地址字段内均包括一起始位、8个数据位以及一结束位。
5.根据权利要求4所述的多路串口通信中实现时钟同步校准的方法,其特征是:利用串口通信数据帧内的通信命令字段配置驱动芯片内串口通信模块的串口通信模式,其中,所配置的串口通信模式包括广播写模式、单设备写模式或单设备读模式;
串口通信模式为单设备写模式或单设备读模式时,对通信完成的驱动芯片,利用所述驱动芯片内的串口通信模块发送一通信应答响应,其中,串口通信模式为单设备写模式时,通信应答响应包括通信设备地址字段;串口通信模式为单设备读模式时,通信应答响应包括响应通信数据字段以及响应循环校验字段。
6.根据权利要求4所述的多路串口通信中实现时钟同步校准的方法,其特征是:对通信命令字段内的8个数据位,低两数据位构成通信模式配置位,中间的四数据位构成通信数据字段长度配置位,高两数据位构成奇偶校验位;
利用奇偶校验位进行奇偶校验时,则有
P0=CMD[0]+CMD[1]+CMD[2]+CMD[4];
P1=~(CMD[1]+CMD[3]+CMD[4]+CMD[5]);
其中,P0为低位的奇偶校验值,P1为高位的奇偶校验值,CMD[0]为通信命令字段第1数据位的值,CMD[1]为通信命令字段第2数据位的值,CMD[2]为通信命令字段第3数据位的值,CMD[3]为通信命令字段第4数据位的值,CMD[4]为通信命令字段第5数据位的值,CMD[5]为通信命令字段第6数据位的值。
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