[实用新型]掩膜结构和存储器有效
申请号: | 201920955059.4 | 申请日: | 2019-06-24 |
公开(公告)号: | CN210272255U | 公开(公告)日: | 2020-04-07 |
发明(设计)人: | 不公告发明人 | 申请(专利权)人: | 长鑫存储技术有限公司 |
主分类号: | H01L21/027 | 分类号: | H01L21/027;H01L21/8242;H01L27/108 |
代理公司: | 上海盈盛知识产权代理事务所(普通合伙) 31294 | 代理人: | 孙佳胤;董琳 |
地址: | 230001 安徽省合肥市蜀山*** | 国省代码: | 安徽;34 |
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摘要: | |||
搜索关键词: | 膜结构 存储器 | ||
1.一种掩膜结构,其特征在于,包括:
依次堆叠的第一掩膜层、第一缓冲层以及位于所述第一缓冲层表面的第一侧墙;
相邻所述第一侧墙两侧之间的刻蚀图形沿第一方向延伸,且深度均相同;
覆盖所述第一掩膜层、所述第一缓冲层和所述第一侧墙并填充满所述刻蚀图形的第三掩膜层;
位于所述第三掩膜层表面的第二缓冲层以及位于所述第二缓冲层表面的第二侧墙,相邻所述第二侧墙之间的刻蚀图形沿第二方向延伸,且深度均相同。
2.根据权利要求1所述的掩膜结构,其特征在于,所述第一缓冲层包括多晶硅层、碳化硅层以及锗硅层中的至少一层,所述第二缓冲层包括多晶硅层、碳化硅层以及锗硅层中的至少一层。
3.根据权利要求1所述的掩膜结构,其特征在于,所述第一掩膜层和所述第三掩膜层均包括有机掩膜层和硬掩膜层。
4.根据权利要求3所述的掩膜结构,其特征在于,所述第三掩膜层的所述有机掩膜层覆盖所述第一掩膜层并填充满相邻所述第一侧墙之间的刻蚀图形,且与所述第一侧墙的顶部表面齐平。
5.一种掩膜结构,其特征在于,包括:
第一掩膜层;
位于所述第一掩膜层表面的第一侧墙;
相邻所述第一侧墙之间的刻蚀图形沿第一方向延伸,且深度均相同;
覆盖所述第一掩膜层和所述第一侧墙并填充满相邻所述第一侧墙之间的刻蚀图形的第三掩膜层;
位于所述第三掩膜层表面的第二侧墙,相邻所述第二侧墙之间的刻蚀图形沿第二方向延伸,且深度均相同。
6.根据权利要求5所述的掩膜结构,其特征在于,所述第一掩膜层和所述第三掩膜层均包括有机掩膜层和硬掩膜层。
7.根据权利要求5所述的掩膜结构,其特征在于,所述第一侧墙和所述第一掩膜层的刻蚀选择比大于5;所述第二侧墙与所述第三掩膜层的刻蚀选择比大于5。
8.一种存储器,其特征在于,包括:
基底,所述基底内形成有若干沿第一方向、第二方向阵列排布的电容孔,所述电容孔通过以权利要求1至7中任一项所述的掩膜结构为掩膜刻蚀所述基底而形成;
所有所述电容孔的尺寸均相同。
9.根据权利要求8所述的存储器,其特征在于,所述基底包括衬底和位于所述衬底表面的叠层结构,所述叠层结构包括交替层叠的牺牲层和支撑层;所述电容孔贯穿所述叠层结构。
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H01L 半导体器件;其他类目中不包括的电固体器件
H01L21-00 专门适用于制造或处理半导体或固体器件或其部件的方法或设备
H01L21-02 .半导体器件或其部件的制造或处理
H01L21-64 .非专门适用于包含在H01L 31/00至H01L 51/00各组的单个器件所使用的除半导体器件之外的固体器件或其部件的制造或处理
H01L21-66 .在制造或处理过程中的测试或测量
H01L21-67 .专门适用于在制造或处理过程中处理半导体或电固体器件的装置;专门适合于在半导体或电固体器件或部件的制造或处理过程中处理晶片的装置
H01L21-70 .由在一共用基片内或其上形成的多个固态组件或集成电路组成的器件或其部件的制造或处理;集成电路器件或其特殊部件的制造